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"아주대학교 논리회로실험" 검색결과 61-80 / 447건

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    아주대학교 논리회로실험 실험10 예비보고서
    following this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과과목명: 논리회로실험EXPERIMENT 10 ... - D/A & A/D converter -1. 실험목적- D/A 와 A/D 변환기 회로의 구성과 동작 원리를 이해한다.2. 이론1) 아날로그 신호 : 시간 상에서 연속인 신호이 ... )4. 실험 방법 및 결과 예상실험 1. 2-bit RAM위와 같은 회로를 구성한다.주파수 발생기를 이용해 계단파형이 나오는지 관찰하고 파형을 그린다.DAC의 출력되는 파형을 확인
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    | 리포트 | 7페이지 | 1,500원 | 등록일 2019.02.20
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    아주대학교 논리회로실험 실험5 결과보고서
    - 분석이번 실험은 2×4 Decoder 의 회로를 구성해 확인해보는 실허이었다. 디코더는 n비트의 2진코드를 2^n 개의 서로 다른 정보로 바꾸어 주는 조합 놀리회로이다. 모든 ... 는 수는 개,즉 4개이다.- 분석이번 실험은 BCD to Decimal Decoder 의 회로를 구성해 확인해 보는 실험이었다. 모든 입력값의 경우를 실험해 보았고 모두 올바른 ... 출력값을 얻었다.- 분석 이번 실험은 코딩 10진 / Excess-3 코드(BCD에서 3을 더함) 회로를 구성하고 확인해 보는 실험이었다. 모든 경우에 대해서 올바른 출력값을 얻
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    | 리포트 | 6페이지 | 1,500원 | 등록일 2019.02.20
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    아주대학교 논리회로실험 실험3 예비보고서
    this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과제출일:과목명: 논리회로실험학 번:성 명 ... 요소인 가산기와 감산기의 기본 구조및 동작원리를 이해한다.2. 이론가산기 이진수의 덧셈을 하는 논리회로이며, 디지털 회로, 조합회로의 하나이다. 가산기의 종류로는자리올림수를 고려 ... 와 윗자리로부터 빌려올 자리빌림B _{0}을 출력회로도진리표변수입력출력xyzcs00000001110101101110100011010011000111113. 실험 부품-반가산기 구성
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    | 리포트 | 5페이지 | 1,500원 | 등록일 2019.02.20
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    아주대학교 논리회로실험 실험5 예비보고서
    this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.과목명: 논리회로실험EXPERIMENT 5- Decoder ... 하는 디코드 논리 회로이다.2) decoder의 진리표3) encoder : 여러 개의 입력 단자와 여러 개의 출력 단자로 이루어져 있으며, 어느 1개의 입력 단자에 “1”이 ... 에 출력이 나온다. 다이오드메트릭스게이트나 논리회로의 조합으로 구성되며 대표적인 기능을 갖는 것은 집적회로화되어 있다. PCM통신에서는 아날로그디지털 변환기를 코더라 한다.4
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    | 리포트 | 6페이지 | 1,500원 | 등록일 2019.02.20
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    아주대학교 논리회로실험 실험7 결과보고서
    this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.과목명: 논리회로실험EXPERIMENT 7- Shift ... 게 회로를 구성했고 올바른 결과를 얻었다.3) D F/FD F/F결선도D=1, C=D=X, C=0- 진리표- 분석이번 실험은 D F/F을 확인해보는 실험이었다. 플립플롭은 래치 ... Latch with Enable (Gate 이용)8×3 Priority 의 회로도결선도- 진리표- 분석이번 실험은J-K Latch with Enable을 확인해보는 실험이었다. 플립
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    | 리포트 | 6페이지 | 1,500원 | 등록일 2019.02.20
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    아주대학교 논리회로실험 실험6 결과보고서
    에 맞게 회로를 구성했고 올바른 결과를 얻었다.- 분석이번 실험은 D Latch with Enable을 확인해보는 실험이었다. D=1, C=1 일 때 1이 출력되었고 D=X, C=0 ... - 분석이번 실험은 R-S Latch with Enable을 확인해보는 실험이다. 첫 번째 사진은 S=0, R=1, C=1 일 때 Q(t)= 0 : Reset 의 결과를 확인 ... 했고 두 번째 사진은 S=1, R=0, C=1 일 때 1 : Set을 확인했다. 실험에서 위쪽에 위치한 LED를 결과값 Q 값이고 아래 LED는 Q의 부정값으로 결론적으로 두 LED
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    | 리포트 | 6페이지 | 1,500원 | 등록일 2019.02.20
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    아주대학교 논리회로실험 실험1 Basic Gates 결과보고서
    in following this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과제출일:과목명: 논리회로실험 ... 했던 논리 게이트의 동작을 LED를 이용하여 직접 확인함으로서 보다 정확하게 이해할 수 있었다. 논리회로의 배열에 따라 아주 다양한 논리연산이 가능하다는 것도 또한 알 수 있었다. ... 실험1 Basic Gates 결과보고서IEEE Code of Ethics(출처: http://www.ieee.org)We, the members of the IEEE, in
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    | 리포트 | 7페이지 | 1,500원 | 등록일 2019.02.20
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    아주대학교 논리회로실험 실험1 Basic Gates 예비보고서
    in following this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과제출일:과목명: 논리회로실험 ... . 참고 문헌1) 논리회로실험 7쪽, 정영모·조혜경·박영환 공저, 2003, 다산서고2) Digital 논리회로실험 57~58쪽, 고재원·김영채·김재평·문현옥 공저, 2007, 지앤북3) 논리회로실험, 이순흠·최관순 공저, 2007, 상학당결선도는 다음장에 있습니다6 결선도 ... 학 번:성 명:EXPERIMENT 1- Basic Gates -1. 실험목적1) NOT, OR, AND, XOR 등의 게이트의 기본적인 논리 함수와 동작 특성을 이해한다.2) 논리
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    | 리포트 | 5페이지 | 1,500원 | 등록일 2019.02.20
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    아주대학교 논리회로실험 실험2 CMOS의 회로의 전기적 특성 결과보고서
    this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과제출일:과목명: 논리회로실험학 번:성 명 ... :EXPERIMENT 2- CMOS의 회로의 전기적 특성 -1. 실험 결과실험 11) Inverter의 입출력 특성 확인logic diagram결선도실험 사진오실로스코프 화면2) 분석결선도 ... 기 위해 세가지 측면에서 접근했다. 실험 1,2 에서는 신호의 입력, 실험 3에서는 신호의 출력, 실험 4에서는 신호의 시간지연에 대해 알아봤다.실험 1에서는 CMOS회로가 입력
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    아주대학교 논리회로실험 실험3 가산김.감산기 결과보고서
    this code of ethics.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과제출일:과목명: 논리회로실험학 번:성 명 ... 한 연산을 하는 논리회로가 바로 전가산기이다.실험 31) 반감산기logic diagram결선도x=0, y=0x=0, y=1x=0, y=02) 진리표입력출력ABB(내림수)D(차 ... 수)*************1013) 분석이 실험은 반가산기의 회로를 미리 설계하였다. 그리고 그 예상 값을 구해와 실제로 회로를 구성하고 결과를 예상 값과 비교 해보았다. 결과
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    | 리포트 | 6페이지 | 1,500원 | 등록일 2019.02.20
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    아주대학교 논리회로실험 설계 에비보고서
    [설계 Project. Up/Down Counter 설계]? 실험 목적- FPGA를 이용하여 Up ? Down Counter를 설계한다.? 작동 원리 설명1. 기능 설명- 보드 ... 를 받으면 현재 상태에서 99999까지 남은 숫자를 down-counting으로 전환한다.- 동작 중 key0 신호를 받으면 현재 상태에서 정지한다.2. Part별 설계 회로 분석 ... [Switch Part] : Start/Stop 버튼오른쪽의 회로에서 각각의 두 버튼에 JK플립플롭을 사용하였다. JK플립플롭은 SR플립플롭에서 정의되지 않은 S와R이 ‘11’상황
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    | 리포트 | 6페이지 | 1,500원 | 등록일 2016.06.16
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    아주대학교 논리회로 실험 설계 예비보고서
    논리회로 실험설계설계주제:스톱워치목차1. 설계 목표2. 동작 조건3. 동작 설명 및 알고리즘4. 1차 설계 및 분석(1) Clock dividing part(2) 7-s ... ) 총 설계 회로5. 예상 결과 & 미작동 시 대처1. 설계 목표- FPGA를 사용하여 자유 주제로서 스톱워치를 설계한다.(기본의 심화 과제인 start/stop의 기능과 up ... 할 수 없음을 고려하고, 이를 해결하기 위해 74151 MUX와 7447 Decoder를 이용해 회로를 구성한다. MUX는 필연적으로 control signal이 필요할 수 밖에 없
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    | 리포트 | 10페이지 | 2,000원 | 등록일 2016.06.14
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    아주대학교 논리회로실험Basic Gates결과
    논리회로 실험 결과보고서실험1.Basic Gates 결과보고서1.실험의 결과실험1) 3-input AND gate 구성-회로를 구성하고, 출력결과를 토대로 Truth table ... Truth table을 작성하라.truth tableINPUTOUTPUTABXYZ000000111110101111012. 실험에 대한 고찰이번 실험은 논리회로실험에서 쓰이는 가장 기본적인 ... 사용하기도 했다. 이번 실험을 통해 기초적인 논리회로를 구성할 수 있게 됐다. 기본적인 게이트들에 대해서도 이해할 수 있게 됐다.추가 적으로 De Morgan의 법칙과 PULL
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    | 리포트 | 8페이지 | 1,000원 | 등록일 2013.11.29
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    아주대학교 논리회로실험Basic Gates예비
    이해2. 실험 이론1) Logic Gate 의 기본적인 특성논리회로의 Logic Gates는 AND, OR, NOT, XOR등의 논리연산을 수행한다.논리회로의 Logic gates ... 한 것을 논리합 한 것과 같다는 것을 나타낸 정리. 이것을 이용하면 어떠한 논리 회로도 NAND와 NOR를 사용하여 간략하게 나타낼 수 있다.3.실험절차 및 예상결과1) 실험 준비물 ... 실험1. Basic Gates1. 실험 목적1) Logic gates의 이해2) Logic 회로 구성 법칙의 이해-Boolean equation의 이해-De Morgan의 법칙
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    | 리포트 | 6페이지 | 1,000원 | 등록일 2013.11.29
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  • 자료 표지
    아주대학교 논리회로실험 실험7 예비보고서
    1. 실험목적① 실험에 사용하는 7476, 7496 IC의 특성 파악② 시프트 레지스터의 동작 원리와 특성을 이해2. 실험이론시프트 레지스터시프트 레지스터는 저장된 데이터를 각 ... 된 비트에 대한 모든 출력을 가지고 있어, 다른 회로에서 사용할 수 있다. 이러한 시프트 레지스터는 직렬-병렬 변환을 수행하기 위하여 사용될 수 있다.역으로 병렬-입력, 직렬-출력 ... -병렬 변환은 ‘데이터를 처리하는’ 응용이지만 시프트 레지스터는 ‘데이터를 처리하지 않는’응용에도 사용할 수 있다. 시프트 레지스터를 조합 논리와 조합하여 순환 형태의 상태도를 가진
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    | 리포트 | 7페이지 | 1,000원 | 등록일 2014.02.28 | 수정일 2014.03.02
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    아주대학교 논리회로실험 실험9 예비보고서
    WritingHHLLLHHLStore-DisableOutputsHHXH4. 실험과정 및 예상결과실험 1. 2-bit RAM① 위의 사진과 같이 회로를 구성한 후에 Logic gate에 입력값 ... 1. 실험목적반도체 memory의 기본적인 동작 원리를 알아보고 64-bit 기억 소자의 동작을 실험을 통해 확인한다.2. 실험이론메모리의 사용메모리는 한 개 이상의 정보를 저장 ... 기 회로를 갖춘 마그네틱 테입이 대형 메모리의 예인데, 보통10 ^{12} 정도의용량을 갖고 있다.컴퓨터의 메모리는 주 메모리와 파일 메모리로 나뉜다. 주 메모리는 고속 반도체
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    | 리포트 | 8페이지 | 1,000원 | 등록일 2014.02.28 | 수정일 2014.03.02
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    아주대학교 논리회로실험 실험2 예비보고서
    1) 실험목적cmos 회로의 전기적 특성 이해2) 실험이론1. Logic levels & DC noise margins (논리 소자의 logic level 판정 방식V ... 하는 시간:VCC의 10%, 90% 값을 기준등가회로논리 회로의 출력이 한 상태에서 다른 상태로 변활 때 걸리는 시간을 천이시간(transition time)이라 ;부른다. 그림(a ... 결정된다. 큰 커패시턴스는 천이 시간을 증가시킨다. 이것은 원하는 바가 아니기 때문에 논리 설계자가 커패시터를 논리 회로의 출력에 의도적으로 연결하는 일은 드물다. 그러나 부유
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    | 리포트 | 7페이지 | 1,000원 | 등록일 2014.02.28 | 수정일 2014.03.02
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    아주대학교 논리회로실험CMOS 회로의 전기적 특성예비
    논리회로 실험 예비보고서실험2. CMOS 회로의 전기적 특성1. 실험 목적CMOS 회로의 전기적 특성을 이해해 본다1)Inverter의 입출력 특성과 Schmitt-trigger ... margins논리회로에서 사용하는 논리값은 1(High = VCC), 0(Low = GND)의 두 종류이다. 전형적인 CMOS 논리회로는 5V 전원으로 동작한다. 이러한 회로에서 0 ... 요소에 의해 결정된다. 큰 커패시턴스는 천이시간을 증가시킨다. 이것은 원하는 바가 아니기 때분에 논리설계자가 커패시터를 논리회로의 출력에 의도적으로 연결하는 일은 드물다. 하지
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    | 리포트 | 3페이지 | 1,000원 | 등록일 2013.11.29
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    아주대학교 논리회로실험 실험4 예비보고서
    IC칩 안에는 앞서 실험에서 구성한 회로가 들어 있을 것이라 예상할 수 있다.ⅱ) Demultiplexer☞ Enable을 갖는 1x4 디멀티플렉서를 74HC11과 74HC04 ... 를 이용하여 다음 회로와 같이 구성한다. 데이터 입력 D는 enable 입력의 역할도 동시에 함을 주목하여 실험한다.☞ 다음 표와 같이 입력을 가한 뒤에 출력 Y3, Y2, Y1, Y0 ... XXXXXX000111000+511010+5010110+5+50111☞ Truth Table을 살펴보면 앞선 실험과 다른 결과가 나온 것으로 보이는 이유는 앞선 실험의 구성 회로
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    | 리포트 | 10페이지 | 1,000원 | 등록일 2014.02.28 | 수정일 2014.03.02
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    아주대학교 논리회로실험 실험6 예비보고서
    1. 실험목적여러 종류의 filp-flop을 구성하고 그 동작 특성을 알아본다.2. 실험이론래치와 플립플롭은 대부분의 순차 회로를 구성하는 기본적인 블록이다. 래치와 플립플롭 ... 에 의해 미리 정의되어 있는 셀들로 구성되어 있다. 표준 IC와 ASIC에 각각의 래치와 플립플롭의 셀을 독자적인 논리 게이트나 귀환 루프를 사용하여 귀환 순서 회로롤 설계 ... 할 수 있는 회로이며 순차 회로의 기본요소이다. 조합논리회로에 비해 플립플롭은 이전상태를 계속 유지하여 저장한다. 디지털 공학에서 입력을 출력에 반영하는 시점을 클럭 신호의 순간
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    | 리포트 | 13페이지 | 1,000원 | 등록일 2014.02.28 | 수정일 2014.03.02
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2025년 10월 21일 화요일
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