"플립플롭기능"의 검색결과 입니다.

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래치와 플립플롭 플립플롭의 기능 쉬프터 레지스터 555타이머 쉬프트 레지스터 디지털시계 설계 비동기 카운터 디지털 시계 시프트 레지스터

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"플립플롭기능" 검색결과 601-620 / 917건

래치, 플립플롭, 쉬프트 레지스터(사전보고서/결과보고서)

래치, 플립플롭, 쉬프트 레지스터사전보고서/결과보고서과목디지털회로실험목적래치?래치의 기본 개념을 파악한다.??RS래치의 원리와 구성 및 동작 특성을 익힌다.???D래치의 원리 ... 와 구성 및 동작 특성을 익힌다.플립플롭?RS 플립플롭의 기본개념을 파악하고 RS-Latch와의 차이점을 발견한다.??D 플립플롭의 기본개념을 파악하고 D-Latch와의 차이점을 발견 ... 한다.???JK 플립플롭의 구성과 동작 특성 및 레이스(Race) 현상에서 나타나는문제점을 파악한다.????Master-Slave JK플립플롭의 구성과 동작 특성을 익힌다.쉬프트

리포트 | 8페이지 | 1,000원 | 등록일 2007.11.24

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45장 디지털 IC 예비레포트

들을 기억하기 위한 메모리 소자들을 가지게 되며, 일반적으로 많이 사용되는 메모리 소자로는 플립플롭(flip-flop)이라고 하는 소자가 있다. 플립플롭은 1비트의 정보(0 또는 ... 1)를 저장할 수 있는 소자이며, 논리 게이트들을 연결하는 방법에 따라 다음에 설명하는 바와 같이 다양하게 구성할 수 있다.래치(latch)는 기본적인 플립플롭(basic flip ... 디지털 IC: 플립-플롭1. 실험목적1) NOR 게이트를 이용하여 RS 플립-플롭을 구성한다.2) D 플립-플롭의 동작을 관찰한다.3) T 플립-플롭의 동작을 관찰한다.4) JK

리포트 | 6페이지 | 4,000원 | 등록일 2009.03.11

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디지털 시계 설계에 관하여

카운터 설계▲ 동기식 순차회로와 비동기식 순차회로순차회로는 동기식 순차회로와 비동기식 순차회로로 구분할 수 있다. 동기식 순차회로는 회로 구성에 사용된 모든 플립플롭들이 하나 ... 의 공통 클럭을 동시에 공급받도록 구성된 회로를 말한다. 이에 반해 비동기식 순차회로는 플립플롭들이 서로 다른 클럭을 사용하는 형태로 구성된 회로를 말한다. 동기식 순차회로와 비동기식 ... 카운터(n-bit binary counter)일 것이다. n비트 이진 카운터는 n개의 플립플롭으로 구성되며, 2n개의 상태를 가지는 카운터를 말한다. 예를 들어 3비트 이진 카운터

리포트 | 14페이지 | 2,000원 | 등록일 2008.07.02

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ENCODER, LANCH & FLIP-FLOP

하여 만들 수 있다. 만일 D 입력에 0이 들어오면 SR=01이 되고 따라서 SR 플립플롭은 리셋 기능을 수행하여 출력 Q=0이 된다. 만일 D 입력에 1이 들어오면 SR=10이 되 ... 고 SR 플립플롭은 세트 기능을 수행하여 출력 Q=1이 된다. 따라서 D 플립플롭에서는 클럭의 상승 모서리가 발생하는 시점에 입력 D 값이 그대로 출력 Q로 전달됨을 알 수 있다.그림 립플롭 ... 상출력이 변화되는 시점을 결정하는 역할을 하며, 제어신호는 플립플롭의 출력 값을 결정하는 역할을 수행한다고도 볼 수 있다. 만일 플립플롭이 클럭의 상승 모서리(0에서 1로 변하

리포트 | 21페이지 | 3,000원 | 등록일 2007.06.18 | 수정일 2015.08.26

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디지털 도어록 프로젝트 보고서

을 때 체크 스위치를 누르면 LED에 파란불이 들어오게 하는 도어락이다. 2,3,4번의 세그먼트에 카운트된 입력값을 유지시키기 위해서 각각의 입력값을 7474(D플립플롭 ... 에 7474(D 플립플롭)2개를 이용하여 2 카운트 회로를 만들어서 2,3,4번 세그먼트 스위치를 2번이상 누를 경우 모든 칩들이 클리어 되게끔 클리어입력 스위치와 세그먼트 스위치 ... 게 되어 다시 칩들을 줄이는 과정을 하게 되었다. 그래서 2,3,4번의 세그먼트에 입력 값들을 저장시켜주는 7474(D플립플롭)을 74174(6개의 D Flip-Flop이 내장

리포트 | 13페이지 | 3,000원 | 등록일 2010.06.24 | 수정일 2018.06.10

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조합논리회로와 순차논리회로의 종류 및 특징

을 변화시키기 위한 조건을 결정한다. 따라서 순차 회로는 입력, 출력, 내부 상태로 명시되며 외부 출력은 플립플롭의 현재 상태에 따라 경정된다. 순차 회로의 대표적인 종류로는 플립플롭 ... , 레지스터, 카운터 등이 있다. 레지스터는 플립플롭의 모임으로 구성되며, 플립플롭은 일반적으로 조합 논리 회로를 통해 입력된다.1. 플리플롭(기억회로)과 게이트(조합 논리 회로 ... )들로 구성2. 출력은 외부 입력과 플리플롭의 현재 상태에 의해서 결정되는 논리 회로(2) 종류1). 플립플롭 : 1비트의 정보를 저장할 수 있는 장치로 정상 출력과 보수화된 출력(Q

리포트 | 6페이지 | 1,000원 | 등록일 2008.03.06 | 수정일 2020.05.06

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실험 8. R A M

tatic) RAM은 하나의 이진 정보를 저장할 수 있는 플립플롭들로 구성되어 있어서 일단 어떤 하나의 워드가 어떤 위치에 기록되기만 하면 같은 위치에 저장되지 않고, 그 칩에 전원 ... 드나 라이트 입력(read/write input)은 소자가 어떠한 동작을 할 것인가를 결정한다. 이때 리이드/라이트 입력이 1이면 플립플롭과 출력 단자 사이의 통로를 열어 놓으며, 리 ... 이드/라이트 입력이 0이면, 입력 단자에 있던 정보가 플립플롭으로 전송된다. 이 경우에 플립플롭은 클럭 펄스없이 작동하게 되며 입력 정보의 한 비트를 2진 소자에 저장하게 된다

리포트 | 5페이지 | 2,000원 | 등록일 2009.03.10

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Lab#5]플립플롭 래치 IC 실습

에 2개의 독립적인 edge-triggered J-K 플립플롭이 있다-Vcc(핀#5)와 GND(핀#13) 핀 위치를 주의한다.-CLK이 ‘1’→‘0’(↓)로 떨어질 때만 J, K 입력 ... SetResetHoldSetHoldReset실습 결과 : 7400게이트를 이용하여 만든 플립플롭 회로로 각 Pulse Input을 Set, Reset, Hold의 3가지논리의 Output ... 의 기능과 구성도를 보고 활용할 수 있는 지혜가 생기고, 실습값에 따라 결과를 기록하는 방법도 익숙해졌다. 이번 실습은 NAND게이트를 이용했는데, 몇 달전에 배운 내용을 다시 상기

리포트 | 17페이지 | 1,000원 | 등록일 2011.06.02

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카운터를 이용한 시한폭탄.

)이진수의 이해 및 AND, OR, NOT 연산을 숙지.부울대수와 논리 간소화 및 카르노맵을 이용하여 논리회로를 간소화 시킴.7-segment의 동작원리를 숙지.조합 논리의 이해.에지-트리거 플립 플롭을 이해. D - 플립플롭을 사용하여 카운터의 동작을 이해. ... 한다. - 제한된 시간내에 버튼을 누르면 작동이 멈추게 되어 전구에 불이 안들어 오고 제한 시간을 초과하게 되면 전구의 불이 켜지는 효과(추가 기능설정)2-②. 기본지식(1

리포트 | 11페이지 | 2,000원 | 등록일 2008.11.20

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하드웨어 부품

와 연결되어 있음 ‧ 중요한 것으로는 명령 레지스터, 번지 레지스터, 인덱스 레지스터, 누산기 등 ‧ 레지스터 회로는 주로 플립플롭 회로를 많이 연결한 형태로 됨 - 데이터를 쉽 ... 2.4 레지스터레지스터의 구조■ 2조 컴퓨터 구성 프로젝트 발표보고서2.4 레지스터‧ 이진 정보를 저장하기 위한 플립플롭과 조합 회로로 구성 ‧ 이진 정보 입력시 공통 클럭신호 ... ‧ 로드 입력이 0인 경우 - 입력 차단 및 플립플롭의 D입력을 자신의 출력에 연결I3[ 그림 2-7 ] 병렬 로드를 가진 4비트 레지스터I2I1I0LoadClockA3A2A1A0병렬

리포트 | 29페이지 | 1,000원 | 등록일 2007.12.19

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충북대 전기전자공학 디지털실험 9장 예비보고서

실험 9. 플립플롭의 기능목 적1. 래치 회로의 기능을 이해하고 R-S 플립플롭의 구조와 동작원리를 이해한다.2. D, JK 플립플롭의 동작을 이해한다.원 리1. RS(Reset ... 적으로 edge-trigger flip flop은 게이트의 작은 delay차이를 이용하여 클럭 신호가 바뀔 때 의 입력만이 출력에 영향을 미치게 되어 있고 따라서 플립플롭의 setup ... 가 될 때까지 불안정 상태로 출력되는 것을 말한다. J=1, K=1을 입력하면 출력 Q=0에 클럭 펄스 1이 가해지면서플립플롭 회로는 전달 지연시간 후 출력이 Q=1로 나타난다. 그러나 클럭 펄스 지연시간

리포트 | 4페이지 | 1,000원 | 등록일 2008.02.18

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Ch13. 시프트 레지스터

레지스터- 좌측 시프트 레지스터는 오른쪽 시프트 기능과 비슷한 방법으로 이루어진다. 다만 레지스터가 다음 돌아올 단보다 앞단의 입력으로 플립플롭의 출력을 연결하는 즉, 회전시키는 특징 ... PageCh10. 시프트 레지스터사 전 보 고 서제출일학과조학번조원이름이름1. 실험목적(1)플립플롭과 시프트 레지스터와의 관계를 알아본다.(2)입출력 방식에 의한 분류에서 각 ... 는 4개의 플립플롭으로 구성되므로 4 bit의 데이터를 저장할 수 있으며, 하나의 데이터 입력, 클록 입력, 클리어 입력 및 2개의 콤플리 멘터리 출력을 가지고 있다.직렬 입력-직렬

리포트 | 6페이지 | 2,000원 | 등록일 2008.01.08

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컴퓨터구조 1장 노트정리

내부 연산 : Binary Number (2진법)?조합회로, 순차회로※ 조합회로 구현 : 게이트※ 순차회로 구현 : 플립플롭※ 플립플롭 구현 : 게이트c ... 반도체N? TR- 소신호 증폭- On-Off switch (회로에서는 스위치의 기능을 사용한다)? Decoder2 X 4 = input X outputA2 X 4DecoderD0BD1

시험자료 | 7페이지 | 1,500원 | 등록일 2009.09.28

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컴퓨터구조론 레지스터 주소계산 방식

register): 제어 기억 장치 속에서 특수한 주소에 자리하고 있어 프로그램에 의해 참조될 수 있는 레지스터.?플립플롭 레지스터(flip-flop register): 병렬로 되어 있는 2 ... 를 기억하는 레지스터. 명령 주소를 나타내는 레지스터를 명령 계수기(instruction counter)라고 하는데, 이 명령 계수기의 기능은 실행 중인 명령 또는 다음에 실행할 명령 ... 는 레지스터.?지연선 레지스터(delay line register): 지연선과 신호 재생 기능 및 피드백 기능을 통합한 레지스터. =time delay register.?지정 레지스터

리포트 | 7페이지 | 1,000원 | 등록일 2012.11.21

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디지털시스템설계_Baseline구조의이해&RegisterFile설계

의 4승인 16개의 플립플롭을 가져야 하지만, 이번 실험에서는 Addr_A와 Addr_B의 MSB를 무시하고 그냥 8개의 플립플롭을 가지는 것으로 한다. 즉, 내부에 r0에서 r7 ... 주소에 들어있는 값은 각각 Src 와 Dest 이다. WR 신호가 주어지게 될 때 Addr_B의 주소에 Data_in 을 저장하게 되고, Rst가 주어질 경우에는 모든 내부 플립플롭 ... FlipFlop에 데이터를 저장하고 있으면서, 입력 주소가 가리키는 데이터를 읽거나 쓰는 기능을 하는 블록이다. input 으로는 Addr_A, Addr_b, WR, CLK, RST

리포트 | 7페이지 | 1,500원 | 등록일 2008.02.19

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플립플롭

D 입력에 0이 들어오면 SR=01이 되고 따라서 RS 플립플롭은 리셋 기능을 수행하여 출력 Q=0이 된다. 만일 D 입력에 1이 들어오면 SR=10이 되고 SR 플립플롭은 세트 ... 기능을 수행하여 출력 Q=1이 된다. 따라서 D 플립플롭에서는 클럭의 상승 모서리가 발생하는 시점에 입력 D 값이 그대로 출력 Q로 전달됨을 알 수 있다.< D-플립플롭 회로도 ... 은 RS 플립플롭의 단점을 보완한 플립플롭으로, J와 K 입력단자에 동시에 1이 인가될 때 출력 값이 반대로 바뀌는 기능을 수행한다. 즉 JK 플립플롭의 J와 K 입력단자를 각각 RS

리포트 | 5페이지 | 1,000원 | 등록일 2007.01.11

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[논리회로실험]실험5결과보고서 래치와 플립플롭

실험 5. 래치와 플립플롭 (Latch & Flip-Flop)Ⅰ. 목 적여러 종류의 flip-flop을 구성하여 그 동작 특성을 알아본다.Ⅱ. 실험 결과 및 토의예비과제 (1 ... 는 반면에 J-K F/F은 출력 Q값이 Q(t-1)’ 인 값을 가진다. 즉, 이전 값의 보수값을 가지는 toggle 기능을 하게 된다. 이 회로 또한 클럭 입력 값을 가지는데 1일 ... 을 가지고 기능도 같았으며 (J,K) = (1,1)값을 가질 때 결과 데이터와 마찬가지로 앞의 ‘1’값과 보수값인 ‘0’값이 출력 되었다. 7476 칩 하나도 간단히 회로를 구성

리포트 | 7페이지 | 1,000원 | 등록일 2010.04.12

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FPGA와 Verilog를 이용한 co-simulation과 co-emulation.

하여 프로그래밍할 수 있다. 대부분의 FPGA는 programmable 논리 요소에 간단한 플립플롭이나 더 완벽한 메모리 블록으로 된 메모리 요소도 포함하고 있다. programmable ... 이 포함된 반도체 소자이다. programmble 논리 요소는 AND, OR, XOR, NOT, 더 복잡한 디코더나 계산기능의 조합 기능같은 기본적인 논리 게이트의 기능을 복제 ... 가 프로그램할 수 있으므로 요구되는 어떠한 논리기능도 수행할 수 있다. FPGA는 일반적으로 주문형 반도체(ASIC) 대용품보다 느리고, 복잡한 설계에 적용할 수 없으며, 소비전력

리포트 | 5페이지 | 4,000원 | 등록일 2009.12.24

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컴퓨터구조 7장 주관식 연습문제

다.인덱스 레지스터 : 유효번지 계산에 사용되는 레지스터이다.6. 직렬전송방식과 병렬전송방식의 차이를 비교 설명하시오.직렬전송방식 : 한번에 1비트씩 이웃한 플립플롭 회로로 이동되고 가장 ... 끝의 플립플롭 회로에 기억된 내용이 바깥으로 전송되는 형태이며, 1회선으로 데이터를 전송해야 하는 전화선을 이용한 통신등에 사용된다.병렬전송방식 : 레지스터에 기억된 내용을 다른 ... 주관식 문제1. 프로세서의 4가지 주요기능에 대해 설명하시오-기억기능레지스터에 의해 수행되며 레지스터는 당장 혹은 가까운 장래에 프로세서에 의해 사용될 데이터를 보관하는 임시

리포트 | 3페이지 | 1,500원 | 등록일 2008.11.23

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실험 제목 : 플립 플롭과 이진 카운터

고찰이번엔 플립 플롭의 세 종류인 D, JK, RS과 플립플롭으로 구성한 비동기 및 동기식 카운터에 관한 실험 이었다.첫 번째, D 플립 플롭에 대한 실험이다. 기본 기능이 데이터 ... 실험 7. 결과 보고서◎실험 제목 : 플립 플롭과 이진 카운터1. 에지 트리거형 D 플립플롭을 그림 7-7과 같이 구성하고 진리값을 표 7-4에 기록하시오.표 7-4DCLKQQ ... ´0↑011↑102. 에지 트리거형 JK플립플롭을 그림 7-8과 같이 구성하고 진리값을 표 7-5에 기록하시오.표 7-5JKCLKQQ´00↓1001↓0110↓1011↓013. 그림

리포트 | 6페이지 | 1,000원 | 등록일 2008.01.03

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