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"위상고정" 검색결과 21-40 / 6,945건

올-디지털 위상 고정 루프용 오프셋 및 데드존이 없고 해상도가 일정한 위상-디지털 변환기 (An Offset and Deadzone-Free Constant-Resolution Phase-to-Digital Converter for All-Digital PLLs)

대한전자공학회 최광천, 김민형, 최우영

논문 | 12페이지 | 무료 | 등록일 2025.06.13 | 수정일 2025.06.17

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고정 위상 동작 인버터를 포함하는 위상천이 풀 브리지 DC/DC 컨버터 (Phase-Shift Full-Bridge DC/DC Converter with Fixed-Phase Operation Inverter)

전력전자학회 김진호, 박재성, 김홍권, 박준우, 신용생, 지상근, 조상호, 노정욱, 홍성수

논문 | 7페이지 | 무료 | 등록일 2025.07.18 | 수정일 2025.07.21

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두 개의 이득 값을 가지는 전압제어발진기를 이용하여 유효 커패시턴스를 크게 하는 위상고정루프 (An Available Capacitance Increasing PLL with Two Voltage Controlled Oscillator Gains)

대한전자공학회 장희승, 최영식

논문 | 7페이지 | 무료 | 등록일 2025.03.12 | 수정일 2025.03.28

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주파수변동전환회로를 가진 이산시간 루프 필터 위상고정루프 (A Discrete-Time Loop Filter Phase-locked loop with a Frequency Fluctuation Converting Circuit)

한국정보전자통신기술학회 최영식, 박경석

논문 | 6페이지 | 무료 | 등록일 2025.07.01 | 수정일 2025.07.05

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위상 고정 루프의 기준 스퍼를 감소시키기 위한 이중 보상 방식 전하 펌프 (A Dual-compensated Charge Pump for Reducing the Reference Spurs of a Phase Locked Loop)

대한전기학회 이동건, 이정광, 정항근

논문 | 6페이지 | 무료 | 등록일 2025.03.12 | 수정일 2025.03.28

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두 개의 입력을 가진 VCO를 이용하여 루프필터와 스퍼 크기를 줄인 위상고정루프 (A Loop Filter Size and Spur Reduced PLL with Two-Input Voltage Controlled Oscillator)

한국정보통신학회 최영식, 문대현

논문 | 8페이지 | 무료 | 등록일 2025.03.14 | 수정일 2025.03.28

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금오공대 아날로그회로응용설계 - 위상 고정 루프(회로 설계) 레포트

1. OrCAD의 ABM(Analog Behavioral Modeling)을 이용한 PLL의 Simulation1) VCONT, FIN, FOUT을 monitor 하면서 PLL이 phase lock 하는 것을 확인하시오. 이 경우 VCONT의 파형을 통해 PPL이 ..

Non-Ai HUMAN
| 리포트 | 11페이지 | 10,000원 | 등록일 2021.07.02 | 수정일 2022.01.20

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금오공대 아날로그회로응용설계 - 위상 고정 루프(회로 설계2) 레포트

>▶ 결론 - 주어진 위상 고정 루프 회로를 ADALM2000을 통해 진행하였습니다. 원하는 파형의 모습이 잘 나오지 않아 여러 번 실험을 진행하여 위와 같은 형태의 주파수 파형 ... 을 나타내었고, 이를 통해 PLL의 주파수 locking 동작을 검증 하였습니다. 결과적으로, 두 신호의 파형의 형태는 동일하거나 비슷하고, 위상만 차이가 있던 것은 대략 2

Non-Ai HUMAN
| 리포트 | 8페이지 | 10,000원 | 등록일 2021.07.02 | 수정일 2022.01.20

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위상고정루프를 이용한 낮은 지터 성능을 갖는 스마트 오디오 디바이스용 이중 출력 주파수 합성기 설계 (A Low Jitter Dual Output Frequency Synthesizer Using Phase-Locked Loop for Smart Audio Devices)

대한전자공학회 백예슬, 이정윤, 류혁, 이종연, 백동현

논문 | 9페이지 | 무료 | 등록일 2025.03.13 | 수정일 2025.03.28

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LiDAR 시스템용 절대시간 측정을 위한 위상고정루프 기반 시간 디지털 변환기 설계 (Design of Phase Locked Loop (PLL) based Time to Digital Converter for LiDAR System with Measurement of Absolute Time Difference)

한국정보통신학회 유상선

논문 | 8페이지 | 무료 | 등록일 2025.06.26 | 수정일 2025.07.04

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낮은 분주비의 위상고정루프에 주파수 체배기와 지연변화-전압 변환기를 사용한 클럭 발생기 (A Low-N Phase Locked Loop Clock Generator with Delay-Variance Voltage Converter and Frequency Multiplier)

대한전자공학회 최영식

논문 | 8페이지 | 무료 | 등록일 2025.05.15 | 수정일 2025.05.21

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최적의 측정값 구간의 길이를 갖는 최소 공분산 유한 임펄스 응답 필터 기반 디지털 위상 고정 루프 설계 (A Digital Phase-locked Loop design based on Minimum Variance Finite Impulse Response Filter with Optimal Horizon Size)

한국전자통신학회 유성현, 배동성, 최현덕

논문 | 8페이지 | 무료 | 등록일 2025.03.12 | 수정일 2025.03.28

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샘플-홀드 커패시터와 전압제어발진기 신호에 동작하는 피드포워드 루프필터를 가진 단방향 전하펌프를 가진 위상고정루프 (A PLL with an Unipolar Charge Pump and a Loop Filter consisting of Sample-Hold Capacitor and FVCO-sampled Feedforward Filter)

한국정보전자통신기술학회 한대현

논문 | 7페이지 | 무료 | 등록일 2025.04.09 | 수정일 2025.05.08

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부경대학교 통신공학실험 위상고정루프

통신공학실험실험5. 위상고정루프(PLL:Phase-Locked Loop)1. 실험과정 5.6 및 5.12의 결과표를 표에 기록하시오.fin 및 fout 사이의 위상차주파수복조 ... , 주파수 위상차는 증가했으며, 복조 출력 전압 역시 증가했다. 이를 그래프로 나타내면 2차원 감소그래프로 표현할 수 있다. 또한 이때 입력 주파수는 주파수(또는 위상)가 고정 ... 며 출력 전압은 커지는 것을 볼 수 있었다. 두 번째는 최저 고정?포착 지점, 최고 고정?포착 지점을 확인하는 실험이었다. fin과 fout 사이 위상차가 180도 일 때 최저 고정

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| 리포트 | 4페이지 | 2,000원 | 등록일 2020.10.18

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위상고정루프 PLL 예비 보고서3

실험 예비 보고서정보통신공학과201530241 강준기● 실험 목적- 한 개의 IC와 몇 개의 소자를 이용하여 어떻게 평형 변조기를 구성하는지 확인한다.- 변조기의 균형을 정확하게 맞추는 방법과 정확하게 균형이 잡힌 변조기가 반송파 신호를 최대한 억제하는 것을 확인한다...

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| 리포트 | 5페이지 | 1,000원 | 등록일 2019.07.29

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위상고정루프 PLL 실험 결과 보고서(3)

의 크기도 변하는 것을 알수 있다. 따라서 회로가 고정되었다는 것을 알수 있다.8. 입력주파수를 10kHz 이하로 천천히 감소시키고, 입력 주파수가 감소될 때, 위상차가 멀어지 ... 는지 가까워지는지 확인하고 출력전압에는 어떤 결과가 나타나는지 확인하라.9. 내부 VCO는 입,출력 주파수 위상이 고정되거나 180도 차이가 날 때까지 입력주파수를 추적한다. 이 이상 ... 조정-입력주파수 인가및 위상관계 측정-최저,최고 고정 / 최저,최고 포착지점 측정● 실험 결과① 실험과정 5.6 및 5.12의 결과를 기록하시오.f _{i`n} 및f _{out

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| 리포트 | 6페이지 | 1,000원 | 등록일 2019.07.29 | 수정일 2023.06.22

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위상 고정 루프 회로(Phase Locked Loop, PLL) 예비보고서

위상 고정 루프 회로(Phase Locked Loop, PLL)예비보고서1. 실험 목적본 실험을 통해VCO(Voltage-Controlled Oscillator)의 동작을 확인 ... 기 등2.2 위상고정루프 (PLL, Phase Locked Loop)1)정의위상 고정 루프 (PLL)는 한 회로 기판이 온보드 클럭의 위상을 외부 타이밍 신호와 동기화 할 수 있 ... 하여 인가 조절 전압을 변화시킴으로써 주파수를 변화시킨다.4) VCO 활용전압 제어가 가능한 점을 이용하여 수신기에서 수신 클록의 추출 등에 많이 이용됨- PLL(위상동기루프)을 구성

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| 리포트 | 4페이지 | 1,000원 | 등록일 2020.07.27

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PLL 위상고정회로- PLL 회로와 동작

--대학교 정보통신학과제출일 : 2006.학번 :성명 :Pages : 8제목 : PLL 위상고정회로정보통신실험Ⅰ-Main-Report1. 실험 제목PLL 위상고정회로- PLL ... (phase detector)의 입력신호로 사용된다. fvco와 fi가 같아질 때, PLL 회로는 고정 상태에 있다고 한다. fi와 fvco에 간의 위상 변화에 의해 위상검파기 ... 변화하지 않는다. PLL즉 “위상고정회로(phase-locked loop)”는 RF와 VCO신호간의 고정된 위상관계와 피드백 회로에서 온 말이다. PLL 회로가 한번 고정 상태

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| 리포트 | 8페이지 | 1,000원 | 등록일 2009.12.14 | 수정일 2015.09.08

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PLL 위상고정회로- PLL 회로와 동작

--대학교 정보통신학과제출일 : 2006. 11학번 :성명 :Pages : 3제목 : PLL 위상고정회로정보통신실험Ⅰ-Pre-Report 91. 실험 제목PLL 위상고정회로 ... 사용된다.이 회로는 신호가 특정 위상으로 유지되도록 한다. 즉 주기적인 신호의 위상이 흔들리지 않게 정확한 고정점을 강제로 잡아주는 것이다. 특히 RF시스템에서는 주로 주파수원 ... 으로 이용되는 주파수의 흔들림을 막기 위해 사용된다. 위상은 주파수를 적분한 개념이므로 위상 고정과 주파수 고정의 개념은 거의 같기 때문이다.RF시스템에 필요한 주파수원을 끌어오

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| 리포트 | 3페이지 | 1,000원 | 등록일 2009.12.12 | 수정일 2015.09.08

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PLL 위상고정회로- PLL을 이용한 FM 검파

정보통신실험Ⅰ-Main-Report00대학교 정보통신학과제출일 : 2006. 11. 27학번 :성명 :Pages : 9제목 : PLL 위상 고정회로101. 실험 제목PLL 위상 ... 고정회로- PLL을 이용한 FM 검파2. 실험 목적● 위상검파기의 입력 주파수가 어떻게 출력신호에 영향을 주는가 설명.● VCO로의 피드백신호가 입력신호간의 위상변화에 따라 어떻게 ... 도록 있다.9. 오실로스코프를 채널 1으로 트리거시키도록 하고, 신호가 그림 7-19와 같이 되도록 하자. 채널 1의 fi가 채널 2의 fvco와 90도 위상차가 나는가??a. 그렇

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| 리포트 | 9페이지 | 1,000원 | 등록일 2009.12.14 | 수정일 2015.09.08

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