"AND회로"의 검색결과 입니다.

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전전설3 전전설2 atmega128 디지털 계산기 and 회로 bjt 증폭기 전자회로 111 detector de2보드 fpga

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"AND회로" 검색결과 3,041-3,060 / 15,380건

[부산대 이학전자 A+] 아두이노

우노 보드를 활용한 응용 예제 실험(아두이노, LDR 소자, 블루투스 모듈, RGB LED, 초음파 센서)- 아두이노를 이용하여 회로를 제작하고, 이를 이해한다.2.실험이론아두이노 ... 한 제품들이 아두이노를 기반으로 개발 가능하다. 또한 아두이노는 회로가 오픈소스로 공개되어 있으므로 누구나 직접 보드를 만들고 수정할 수 있다.최초의 아두이노는 2005년 이탈리아 ... 한다. B, C에서도 마찬가지로 B→ 녹색, C→ 파란색으로 상태를 전환한다.2) [그림 7]과 같이 회로를 구성한다. (저항은 10kΩ 사용)3) 스마트폰과 블루투스 연결을 하

리포트 | 19페이지 | 2,000원 | 등록일 2021.03.03 | 수정일 2021.03.13

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친환경에너지공학 예상문제

는 에너지는 광자가 가진 에너지에서 일 함수를 뺀 값이 된다.내부&외부 광전효과 서술내부 광전효과 : 절연체, 반도체에 빛을 조사하면 충만 띠 또는 불순물 준위에 있는 전자가 광 ... 이란 단위시간에 태양전지에서 외부 회로로 흘러나오는 전자수와 태양전지에 입사된 광자의 수에 대한 비율이다. 식으로 나타내면 (단락전류/전자의 전하)/단위시간 당 입사된 광자의 수 ... 로 처음부터 급감하는 구간이 나뉘어 진다.배터리 보호회로가 전압값을 컨트롤 하는 방법 4가지 서술하시오.과충전 보호, 과방전 보호, 과전류 보호, 단락 보호MPPT방식에 대해 서술

리포트 | 5페이지 | 1,000원 | 등록일 2020.12.29

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연성인쇄회로기판 상에 Au 스터드 플립칩 범프의 초음파 접합 (Ultrasonic Bonding of Au Stud Flip Chip Bump onFlexible Printed Circuit Board)

본 연구의 목적은 OSP, 전해 Au과 무전해 Ni/Au로써 표면처리를 달리한 연성회로기판 상에Au 스터드 플립칩 범프의 초음파 접합 가능성을 연구하는 것이었다. Au 스터드 ... 범프는 표면처리 방법에상관없이 성공적으로 연성회로기판의 패드 상에 초음파 접합되었다. 접합 강도는 접합 시간에 민감하게영향을 받았다. 접합 시간이 길어짐에 따라 접합 강도는 증가 ... preservative (OSP), electroplated Au and electroless Ni/immersion Au (ENIG). The Au stud flip chip bumps

논문 | 7페이지 | 무료 | 등록일 2025.07.09 | 수정일 2025.07.11

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CORDIC을 이용한 OFDM 시스템의 주파수 옵셋 제거 회로의 FPGA구현 (FPGA Implementation of Frequency Offset Cancel Circuit using CORDIC in OFDM)

본 논문은 OFDM 시스템에서 주파수 옵셋을 제거하기 위한 회로를 CORDIC 알고리듬을 이용하여 Simulink 모델로 설계하여 성능을 평가하고, 이를 FPGA로 구현하기 위해 ... Algorithm and evaluated its performance. And Simulink Model compared with Xilinx System Generator Model ... imulation with Xilinx Spartan3 xc3s1000 fg676 -4 Target Device, and timing analysis and resource estimation. 한국정보통신학회 한국정보통신학회논문지 변건식

논문 | 6페이지 | 무료 | 등록일 2025.05.25 | 수정일 2025.05.27

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빠른 Lock-Time을 위한 다중 이득 제어 디지털 위상 주파수 검출기 (A Multiple Gain Controlled Digital Phase and Frequency Detector for Fast Lock-Time)

본 논문은 다중 이득 제어를 통하여 빠른 lock-time을 갖는 디지털 위상 주파수 검출기 회로를 제안한다. 기준신호와 피드백 신호의 위상 차이가 클 때, 위상 차이가 적 ... gain controlled digital phase and frequency detector with a fast lock-time. Lock-time of the digital ... between reference and feedback signal, small phase difference and before lock-state, and after lock-s

논문 | 7페이지 | 무료 | 등록일 2025.07.01 | 수정일 2025.07.05

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전기철도 추진용 유도전동기 최적 설계 및 특성 분석 (Optimal Design and Analysis of Induction Motor for Propulsion of Electric Railway)

화하였다. 최종적으로 이러한 과정으로 도출한 최종모델이 등가회로와 유한요소해석 결과를 통해 목표 성능을 만족하고 효율이 기본 모델 대비 향상된 것을 확인하였다. This paper will ... process using theequivalent circuit. Then, Rotor slot and Airgap are determined by analysis and comparison ... of torque, torque ripple, efficiency,and power factor. In addition, Rotor slot shape is optimized

논문 | 9페이지 | 무료 | 등록일 2025.06.15 | 수정일 2025.06.17

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SOP Image SRAM Buffer용 다양한 데이터 패턴 병렬 테스트 회로 (Parallel Testing Circuits with Versatile Data Patterns for SOP Image SRAM Buffer)

System on panel 프레임 버퍼를 위한 메모리 셀 어레이와 주변회로가 설계되었다. 또한, system on panel 공정의 낮은 yield를 극복하기 위해, 블럭 단위 ... hierarchical bit line과 divided word line 구조에도 적용될 수 있다. Memory cell array and peripheral circuits are designed ... is capable of faster fault detection compared to conventional memory tests and also applicable to the

논문 | 11페이지 | 무료 | 등록일 2025.06.15 | 수정일 2025.06.17

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밀리미터파 대역 응용을 위한 직렬 급전 마이크로스트립 배열 안테나 설계 (Series-Fed Microstrip Array Antenna for Millimeter-Wave Applications)

)이 −20 dB가 되도록 설계 및 제작하였다. 등간격의 직렬 급전 배열 안테나를 전송 선로 등가 회로 모델로 해석하였으며, Taylor 및 Bayliss 분포를 적용하여 합/차 ... with sum and difference patterns is presented for millimeter- wave applications. The antenna was ... designed to exhibit high-gain and low side-lobe level(SLL) below —20 dB. A conventional transmission

논문 | 4페이지 | 무료 | 등록일 2025.07.16 | 수정일 2025.07.20

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A+실험보고서- 효모관찰

으로 산화시키며 소량의 ATP를 얻는데 이 과정에 있어서 조효소 가 로 환원된다. 산화된 피루브산은 계속 산화되어 시트르산회로를 거쳐 산화적 인산화를 통해 완전히 산화되고, 여기 ... 화 과정을 거쳐 다시 해당과정이 일어날 수 있게 되는 것이다. 하지만 산소가 없는 환경이라면 산화적 인산화 과정이 일어날 수 없고, 시트르산 회로도 돌아가지 않게 된다. 따라서 조 ... ?docId=1185549&cid=40942&categoryId=32314" https://terms.naver.com/entry.nhn?docId=1185549&cid=40942&8963

리포트 | 9페이지 | 1,000원 | 등록일 2021.06.03

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현대물리실험 메뉴얼

(mV)Photoresist를 이용한 Lithography1. 목 적Lithography란 극히 미세하고 복잡한 전자회로를 반도체 기판에 그려 직접회로를 만드는 기술이 ... -cos( theta _{i} )]그림 5. Coil Height Decreases 그림 6. Coil and Resistor Circuit저항(R)에서 방산된 열에너지는 다음과 같 ... 는 DataStudio 파일을 연다.4. 먼저, 완전한 회로에서 연결된 코일 없이 진자를 움직이게 하여 마찰에 손실된 에너지량을 측정한다. 저항기 플러그를 뽑아 내고 다시 플러그를 꽂

리포트 | 22페이지 | 2,500원 | 등록일 2023.01.13

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광대역 CMOS 저잡음 증폭기 설계 (Design of Ultra Wide-Band CMOS Low Noise Amplifier)

3.1～5.15 GHz 대역의 광대역 저잡음 증폭기를 새로운 입력 매칭 방식과 귀환회로 방식으로 구현하였다. 제안된 광대역 증폭기는 0.18μm RF CMOS 공정을 사용 ... 다. An ultrawideband(UWB) 3.1～5.15 GHz low-noise amplifier employing a novel input matching circuit and ... matching and, an input IP3 of －1 dBm, while comsuming only 14.5 mW of power. 한국전자파학회 한국전자파학회 논문지 문정호, 이창석, 정무일, 김유신, 이광두, 박상규, 한상민, 김영환

논문 | 8페이지 | 무료 | 등록일 2025.06.10 | 수정일 2025.06.16

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0.18μm CMOS 3.1Gb/s VCSEL Driver 코아 칩 설계 (Design of Core Chip for 3.1Gb/s VCSEL Driver in 0.18μm CMOS)

본 논문에서는 0.18μm CMOS 공정 기술을 이용하여 광트랜시버에 사용된 1550 nm 고속 VCSEL을 구동하는드라이버 회로를 제안한다. 3.1Gb/s 데이터 속도에서 기존 ... bandwidth, voltage gain and eye diagram at 3.1Gb/s data rate in comparison with existing topology ... . In this paper, the design and layout of a 3.1Gb/s VCSEL driver for optical transceiver having arrayed

논문 | 8페이지 | 무료 | 등록일 2025.07.12 | 수정일 2025.07.19

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PMIC용 Zero Layer FTP Memory IP 설계 (Design of Zero-Layer FTP Memory IP)

과 user memory 영역으로 나누는 dual memory 구조 대신 PMIC 칩의 아날로그 회로의 트리밍에만 사용하는 single memory 구조를 사용하였다. 또한 BGR ... (Bandgap Reference Voltage) 발생회로의 start-up 회로는 1.8V~5.5V의 전압 영역에서 동작하도록 설계하였다. 한편 64비트 FTP 메모리 IP ... addition of tunnel oxide and DNW mask. Also, from the viewpoint of memory IP design, a single

논문 | 9페이지 | 무료 | 등록일 2025.06.14 | 수정일 2025.06.17

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A+ 서평 하버드 회복탄력성 수업을 읽고 나서

&action=edit&redlink=1" \o "신경 회로 (없는 문서)" 신경 회로를 바꾸는 능력이다. 폭넓게는 어떤 유전자형의 발현이 특정한 환경 요인을 따라 특정 방향 ... (perseverance and passion for long-term goals)이 그릿이라고 정의했다. 영어로 이를 악문다고 말할 때 보통 그릿(grit)이란 동사를 쓰 ... 을 통해 뇌가 스스로 Hyperlink "https://ko.wikipedia.org/w/index.php?title=%EC%8B%A0%EA%B2%BD_%ED%9A%8C%EB%A1%9C

리포트 | 9페이지 | 5,500원 | 등록일 2021.07.01 | 수정일 2023.11.28

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인천대 물리실험2 고체저항과 전구물리 실험보고서

및 실험절차 (Apparatus & Procedure)1. 실험장치2. 실험절차Ⅳ. 데이터 및 결과 (Data & Results)1. 니크롬선의 저항 측정 및 비저항 계산2. 전구 ... 하고, -극에는 검은색 리드 봉을 연결한다.Ⅲ. 실험장치 및 실험절차 (Apparatus & Procedure)1. 실험장치필요한 장비수량필요한 장비수량바나나 플러그 패치 코드 ... (SE-9750)2악어집게4전구1기초 회로 시험 판1전구 소켓1버니어 캘리퍼스1굵기가 다른 니크롬 선 2종 (60cm)2멀티 테스터기12. 실험절차① - 실험 조건에 따른 변화를 확인

리포트 | 8페이지 | 5,000원 | 등록일 2021.05.28 | 수정일 2021.06.03

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노인우울증리플릿

생화학적 요인: 감정 조절을 작용하는 신경전달 물질의 저하.● 신경해부학적 요인: 감정을 조절하는 뇌 회로 부위의 모세혈관 이상● 유전질환은 아니지만, 부모나 형제, 친척 중 우울 ... 세로토닌이 풍부해요. 연어, 고등어, 참치, 청어, 정어리 등 등푸른생선, 견과류에 많아요.2. 유산균 & 발효식품장내 미생물을 건강하게 하는 유산균이나 발표식품 또한 우울증에 효과적이고, 요구르트, 김치, 된장에 많아요.

리포트 | 2페이지 | 3,000원 | 등록일 2023.12.15

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2020년 하반기 삼성전자 파운더리사업부 직무분석파일 및 실제 기출면접 정리자료

실 및 사무실 등이 함께 위치함.16.2 Clean Room- 청정실이라도 하는 Clean Room은 반도체 집적회로(IC) 제작 시설이다. 반도체는 아주 작은 파티클도 성능 ... 는 포토레지스트(Photoresist를 얇게 바른 후, 원하는 마스크 패턴을 올려놓고 빛을 가해 사진을 찍는 것과 같은 방법을 회로를 형성하는 것)16.2.1 먼지 입자가 반도체 ... 에 미치는 영향- 반도체 웨이퍼나 마스크에 증착하여 소자에서 회로를 불량하게 만들 수 있는 결함을 발생시킴- 웨이퍼 표면에 붙을 경우 Epitaxial 막의 단결정 성장을 파괴함

자기소개서 | 13페이지 | 5,000원 | 등록일 2020.12.25 | 수정일 2025.04.21

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인천대학교 현대물리학실험 Magnetic Force 예비보고서

hown)- Recommended Equipment:ME-9355 Base and Support RodSE-9720A Power SupplyME-8988 25-cm Stainless ... ), Large Base and Rod (ME-9355), Magnetic Force Accessory (EM-8642A)■ Demonstration 2: Magnetic Force on ... a Current-Carrying Wire Swing:Equipment NeededVariable Gap Magnet (EM-8618)Large Base and rod (ME

리포트 | 4페이지 | 2,000원 | 등록일 2021.12.16

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자동제어 과제3

equation을 작성하고 이를 토대로 AND, OR gate를 사용하여 디지털 로직회로를 그려라7. 압력탱크 325psi의 가스압력을 유지해야 한다. 그래서 압력센서는 제어변수의 조건 ... 가 가능하다.3. 시퀀스제어의 구성요소의 기기명을 설명하고 적용되는 건축설비의 예를 들고 그 회로도를 그리고 동작 시퀀스를 설명하라- 주요 구성 요소 : 작업 명령부, 명령 처리부 ... pressurehigh level with high temperaturehigh level woth low temperature and high pressure최종 logic

리포트 | 5페이지 | 6,000원 | 등록일 2022.01.14

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λ/8 병렬 스터브들을 이용한 새로운 광대역 위상 천이기에 대한 연구 (a study on new broadband phase shifter using λ/8 parallel stubs)

본 논문에서는 전송 회로망의 주파수에 따른 산란 위상 특성의 기울기를 조정할 수 있는 새로운 광대역 위상 천이기의 구조를 제안하였다. 새로운 기본 회로망은 중심 주파수에서 λ/2 ... the center frequency and two double stubs, each with a length of λ/8 at the center frequency, which ... are open and shorted, respectively, and which are shunted at the edge points of the main line

논문 | 10페이지 | 무료 | 등록일 2025.06.10 | 수정일 2025.06.16

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