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verilog 전전설2 논리회로 텀프로젝트 실험12 멀티플렉서 vhdl 디지털회로실험 라인트레이서
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"논리회로실험" 검색결과 3,001-3,020 / 4,696건

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    [결과]실험4. Multiplexer & Demultiplexer
    로 구성한 회로와 결과는 차이가 없기 때문에 1과 같은 실험값을 얻을 수 있었다. 실험1회로와 실험2의 Logic diagram에서 Enable이 0일 때 작동하게 하면 따로 전압 ... 을 걸어주지 않아도 되므로 enable에 인버터를 사용하여 회로를 구성한 것 같다.?실험3.INPUTOUTPUTDS _{0}S _{1}Y _{0}Y _{1}Y _{2}Y _{3}0 ... 하는 실험이었다. NOT gate와 3-input AND gate를 사용하여 아래 회로를 구성하였다. Demultiplexer는 하나의 데이터입력을 스위치신호에 따라 여러 개의 출력선
    리포트 | 8페이지 | 1,500원 | 등록일 2013.09.28
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    결과-전가산기
    에 진리표로 표현할 때나 논리 게이트로 회로를 구성할 때에 앞 문장에서와 동일한 2진 값을 부울 함수의 변수로 볼 수 있다. 이렇게 이 회로에서 쓰이는 비트들이 2가지의 다른 해석 ... 을 할 수 있다는 것을 인식하는 것은 중요한 일이다.전가산기의 카노맵전가산기 회로의 입출력 논리 관계는 각 출력 변수에 대해 하나의 부울 함수가 대응되므로 2개의 부울 함수로 표현 ... ★실험과정(1) C언어로 2-bit 전가산기 프로그램을 작성한다.(2) 프로그램을 다 작성했다면 Build 명령을 통해 소스파일을 컴파일/링크한다. 에러가 발생했다면 프로그램
    리포트 | 10페이지 | 1,000원 | 등록일 2013.05.24
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    텀프로젝트 cds를 이용한 셀
    , max 50㏀Dark Resistance (10sec after shut off 10Lux)min 5㏁..PAGE:6실험에 사용한 CdS전압 4V저항회로상 - 빛 감지시 : 2.8 ... ..PAGE:1CdS 셀을 이용한 회로..PAGE:2CdS 셀이란?CdS 셀(Cadmium Sulfide Cell)은 카메라에서 적성 노출을 검출하고, 연기를 감지하여 화재 ... )을 횡축에, R(CdS 셀의 저항치)을 종축에 놓고 각각 대수 눈금으로 잡으면 거의 직선적으로 저항치의 변화가 나타납니다. 이것을 통해 우리는 회로 설계상 빛의 레벨이 미치는 영향을 알
    리포트 | 14페이지 | 1,000원 | 등록일 2010.07.06
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    귀납법
    에는 전기가 통한다.② 초기조건 설정 : 실험조건 제시- 이 전선은 구리로 만들어져 있으며, 전기회로에 연결되어 있다.③ 예측진술(연역적 과정) : 가설설정- 이 전선에는 전기 ... 의 비교개념?원리 학습↑귀납적 일반화↗↖관찰실험개념?원리 학습↓연역적 예측↙↘관찰실험< 귀납법 > < 연역법 >5) 유추법① 몇 가지 대상의 유사성을 근거로 비슷한 속성을 비교 ... 가 흐를 것이다.④ 가설검증 : 가설을 검증한다.- 이 전선에 전기가 흐르므로, 구리에는 전기가 통한다.3) 가설연역법의 한계① 논리적?합리적 특성 강조 → 사회적 문제 소홀② 과학
    리포트 | 3페이지 | 1,000원 | 등록일 2014.07.22 | 수정일 2014.10.01
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    Half Adder, Full Adder 설계
    4월 1일 실험 Half Adder, Full Adder 설계1. 반가산기(Half Adder) : Behavial Modeling① HDL 코드library IEEE;use
    리포트 | 8페이지 | 1,000원 | 등록일 2009.12.06
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    실험13 CMOS-TTL interface 예비보고서
    이란?☞ TTL이란 디지털 회로에서 사용되는 각종 논리 소자 중, 입력과 출력을트랜지스터를 해서 받고 출력 또한 트랜지스터를 통해 하는 소자를 말한다.이름이 74xxx의 형태를 취하 ... Logic)소자는 디지털 회로에서 사용되는 각종 논리용 소자 중에서, 입력을 트랜지스터로 받아들이고, 출력 또한 트랜지스터로 내보내는 소자를 말한다. TTL IC의 명칭은 74xxxx ... 실험 13. CMOS-TTL interface목적1) CMOS의 동작을 이해한다.2) CMOS와 TTL의 interfacing 방법에 대하여 이해한다.이론.1. CMOS의 원리1
    리포트 | 6페이지 | 1,000원 | 등록일 2014.09.29 | 수정일 2018.10.15
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    파형발생기(결과)
    ? 실험 결과- 실험결과2) OP-AMP를 이용한 구형파 / 삼각파 발생 회로? OP-AMP 미분기출력 주파수(측정값)출력 주파수(기대값)% 오차1 KHz10 KHz100 KHz ... 하였다. 파형 발생에 대해서는 자세히 배운 적이 없어서 이번 실험이 힘들었지만 OP-AMP를 이용해서 미분 회로와 적분 회로를 구성해서 파형을 바꿔볼 수 있다는 사실은 흥미 ... 으로 요구되는 TTL 및 CMOS 논리 신호도 제공되므로 디지털회로 분석에도 용이하다.함수발생기는 금성사에서 제작된 다양한 신호소스를 제공하는 신호발생기이다.이 모델은 3가지 계측기
    리포트 | 2페이지 | 2,000원 | 등록일 2012.10.11
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    비안정 멀티 바이브레이터 예비보고서11
    ▣ 목 적(1) 비안정 멀티 바이브레이터의 동작을 이해한다.(2) 비안정 모드에서 사용된 555 타이ㅓ의 동작특성을 실험적으로 입증한다.(3) 단안정 멀티 바이브레이터의 동작특성 ... 는 안정되지 않는 두 개의 다른 사태를 갖는 스위칭 회로이다. 즉 이 회로는 두 개의 안정되지 않는 상태 사이를 계속하여 오가며 스위칭하고 있다. 따라서 이 회로는 발진하는 상태이고 ... 할 수 있다.● 주파수 (Frequency)발진기로 연결된 LM 555 타이머 논리심볼은 에 나타나 있다. 타이밍 콘덴서 C는 저항R _{A} ,`R _{B}을 통하여+V _{CC
    리포트 | 4페이지 | 1,000원 | 등록일 2013.12.10
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  • 자료 표지
    텀프로젝트 섯다게임
    ..PAGE:1섯다 한판*..PAGE:2목 차제작 동기실험 재료회로도(피스파이스)시스템 방식(예상결과)..PAGE:3제작 동기‘7segment로 할 수 있는 것이 뭘까 ... 개)커패시터 : 0.01㎌(4개), 0.1㎌(1개), 100㎌(1개)7 Segment(4개), 9V 전지(1개)..PAGE:5회로도(피스파이스)*..PAGE:6회로도 ①커패시터에 ... 다.NAND게이트가 4개씩 들어있는 실험시간에도 한번 써보았던 7400을 쓸 것이다. 그래서 두7400칩을 이용하여 최종출력의 랜덤한 숫자를 나타내기 위한 출발시점으로써 커패시터
    리포트 | 10페이지 | 1,000원 | 등록일 2010.07.06
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  • 자료 표지
    광전자맥박계
    ..PAGE:1의용생체공학 8조프로젝트조 : 8조..PAGE:2목 차작품개요동작원리기본회로구성도핵심부품특성 및 적용고찰 및 결론..PAGE:3작 품 개 요심장박동에 의해 대동맥속 ... 와 CDS를 사용하여 광전 맥박신호 검출.엄지손가락의 광전 맥파신호가 오실로스코프(CRT)로 검출 됨을 확인.Display부로 맥박수를 카운터.엠프회로를 통해 맥박음을 검출.밧데리사용 ... 한 회로에서 이론과 실측에서 어려움이 발견됨.1. LED의 밝기와 CDS의 수광감도2. 외부 잡음신호3. 필터링 된 맥파의 전달
    리포트 | 10페이지 | 1,000원 | 등록일 2010.07.06
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    실험9. Multiplecxer 가산-감산 예비
    access memory)이나 ROM(Read only memory)을 이용하여 논리회로의 합성도 가능하다.그림의 논리식을 의 멀티플렉서로 구성하는 경우는 멀티플렉서의 논리식에서 S ... =0, D0=0, D1=1, D2=1, D3=0로 하면로 구성할 수 있다.논리회로에서는 A, B, C 세 개의 입력변수가 주어지면 8개의 논리함수를 만들 수 있다(ABC=000 ... 하라.Decoder는 코드화된 입력을 출력으로 변환하는 다중 입력 다중 출력 논리회로이다. 이에 반해 demultiplexer는 하나의 입력 회선에 여러 개의 출력 회선을 연결
    리포트 | 6페이지 | 1,000원 | 등록일 2013.02.02
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    전자전기컴퓨터설계실험1 3주차 Prelab Function Generator & Ocsilloscope
    에서 높은 범위까지 가변될 수 있어서 회로시스템의 주파수 특성을 분석하는데 좋은 신호제공기가 된다. 디지털회로에서 입력파형으로 요구되는 TTL 및 CMOS 논리 신호도 제공 ... 전자전기컴퓨터설계실험 Ⅰ과목 : 전자전기컴퓨터설계실험1학과 : 전자전기컴퓨터공학부학번 : 2009440132이름 : 전상기1. Introduction1) Purpose of ... this Lab회로, 부품, 장치 등의 특성을 검사하기 위한 신호원으로써의 Function Generator와 함수발생기로부터 발생하는 파형을 시각적으로 나타내어 분석
    리포트 | 13페이지 | 1,500원 | 등록일 2014.03.11 | 수정일 2014.03.17
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    도둑감지기
    ..PAGE:13학년 전자실험TERM PROJECT< 도둑 감지기 >4조..PAGE:2* PROJECT 기본 개요 *회로의 동작구성 회로의 두 단자에 연결된 검색선을 외부의 침입 ... 자가 제거할 경우사이렌 소리와 함께, 경고등이 점멸..PAGE:3* PROJECT 기본 개요 *2) 회로 사용 소자트렌지스터 5개 227, 642저항 8개커페시터 5개발광 다이오드 ... 스피커스위치..PAGE:43) 회로의 구성..PAGE:54) 회로의 동작 원리회로 구성에 사용된 트렌지스터는 베이스와 이미터 사이에 약 0.7V 정도의 전압이 발생되어야 전류
    리포트 | 5페이지 | 1,000원 | 등록일 2010.07.06
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  • 자료 표지
    OR Gate
    1. Dataflow에 따른 OR Gate의 코드① HDL 코드library IEEE;use IEEE.std_logic_1164.all;entity or_gate1 isport (in_a , in_b : in std_logic; out_c : out std_logic)..
    리포트 | 3페이지 | 1,000원 | 등록일 2009.12.06
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  • 자료 표지
    비동기 카운터 설계
    5월 6일 실험 비동기 카운터 설계1. 비동기 카운터① 4bit 카운터 HDL 코드library IEEE;use IEEE.std_logic_1164.all;use IEEE.std
    리포트 | 4페이지 | 1,000원 | 등록일 2009.12.06
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  • 자료 표지
    메모리 설계
    1. RAM(Read Access Memory)① HDL 코드library IEEE;use IEEE.std_logic_1164.all;use IEEE.std_logic_unsigned.all; entity ram is port(ce : in std_log..
    리포트 | 4페이지 | 1,000원 | 등록일 2009.12.06
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  • 자료 표지
    디지털 시스템 실험
    를 참고하여 BCD 가감산을 수행할 수 있게 다음 블록도와 같이 회로를 구성한 후 실험하여라.실험 6-4. n비트 크기 비교기와 산술논리연산회로 구현하기1. 아래 진리표를 보고 1 ... 과목명디지털 시스템 실험제출일시2011.10.5분 반1전 공전자정보공학제 목6장. 산술논리연산학습목표· 반가산기, 전가산기의 개념을 알아본다.· 반감산기, 전감산기의 개념 ... 을 알아본다.· BCD가산기와 크기 비교기에 대해 알아본다.실 험 내 용실험 6-1 가산기 회로 구현하고 응용하기0. 다음 연산 규칙을 진리표로 작성하시오.0011+ 0+ 1+ 0
    리포트 | 10페이지 | 1,000원 | 등록일 2012.07.18
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    결과 Multiplexer & Demultiplexer
    을 수 있었다. 다만 두 실험의 차이가 있다면 다이오드의 밝기가 MUX보다 DeMUX가 더 밝았다. 원인에 대하여 생각을 해보았는데 회로를 구성하는데 있어 사용되는 IC의 개수 ... 실험1. MultiplexerSetting: 전압 공급기를 사용하여 5V 전압을 인가하였다.10S0S10YD0D1D2D311. 파란색 영역에서S _{0}와S _{1}의 High ... 00D11D10D11D10D20D21D21D20D31D30D30D31Y0Y1Y0Y1Comparison & Analysis: 회로를 구성 한 뒤 Enable 단자에 High를 인가
    리포트 | 4페이지 | 2,000원 | 등록일 2013.12.26
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  • 자료 표지
    3×8 Decorder, 8×3Encorder 설계
    1. 3×8 Decorder : Dataflow Modeling① HDL 코드library IEEE;use IEEE.std_logic_1164.all; entity decorder is port(in_x : in std_logic_vector(2 down..
    리포트 | 6페이지 | 1,000원 | 등록일 2009.12.06
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    FSM Vending-Machine 실험설계
    1. FSM Vending-Machine 설계① HDL 코드library IEEE;use IEEE.std_logic_1164.all;use IEEE.std_logic_unsigned.all; entity fsm is port ( in_clk :..
    리포트 | 4페이지 | 1,000원 | 등록일 2009.12.06
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2025년 06월 30일 월요일
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