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전전설3 4주차 진동및동적시스템 gransconductance 555 timer 광운대 전자회로 전전설3 12주차 low noise amplifier op amp 설계 PCB 다이오드 부산대 이학전자
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"Input Circuits" 검색결과 241-260 / 1,198건

  • 자료 표지
    기초회로실험1 Lab 12 Full Adder Report
    * Introduction1. 목적Full Adder circuit을 구성하고 논리식을 보인다.2. 과정logic lab unit, quadruple 칩을 사용하여 회로를 구성 ... 에 칩과 전선을 연결하여 회로를 구성한다.똑딱스위치: hi는 1, lo는 0을 나타내며 그만큼의 신호를 input으로 넣어준다.GRD, 5V 전압코드도 있어서, 단락시켜주거나 입력 ... 다리에는 GND를 연결하고 14번 다리에는 입력전압(5V)을 연결했다.7408칩: quadruple 2-input positive AND Gate7432칩: quadruple 2
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    | 리포트 | 5페이지 | 2,000원 | 등록일 2019.08.01
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  • 자료 표지
    [회로이론1] 기말고사 이론정리
    Equivalent Circuit 도 위와 방법은 동일하다.Maximum Power TransferOP-AMPCapacitorParallel CircuitSeries ... CircuitInductorParallel CircuitSeries CircuitFirst-Order Circuitf(t) is an input, while either i(t) or v(t) is an ... output of a given circuit.So, the complete response= transient response + steady-state response
    Non-Ai HUMAN
    | 시험자료 | 7페이지 | 1,500원 | 등록일 2019.06.08 | 수정일 2019.10.02
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  • 자료 표지
    verilog 7주차 Tri State buffer SRAM 보고서
    은 저항값(임피던스값) 을 의미한다. 이 상태에서 로직 게이트는 0이나 1의 로직을 전부 가지지 않고 open circuit 되어있다. (도선이 끊겨있다고 생각한다.)Tri State ... SRAM Cell logic circuit다음 [그림 2]는 SRAM에서 기억장치를 담당하는 6T SRAM Cell을 나타낸다. 회로에서 확인할 수 있듯이 하나의 Cell에는 6개 ... inverter들이다. [그림 3]은 이러한 cross-coupled inverter를 logic circuit으로 표현한 것이다.2. 실습 내용 : Verilog Code 및 주석Tri
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    | 리포트 | 14페이지 | 1,000원 | 등록일 2018.12.27
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  • 자료 표지
    디지털 논리 회로 실험 레포트 [AND OR 게이트의 이용]
    11 2AND-OR circuit이를 하나의 소자 즉 NAND gate로 통일할 수 있다. 방법은 Level 2에 있는 각 AND gate 오른쪽에 버블을 추가하고 Level 1 ... NAND-NAND circuit다음으로C(AB+D)를 살펴보자. 이 논리식을 논리회로로 표현하면 다음과 같다.그림 13 AND-OR-AND circuit만약 이를 앞에서 사용 ... 한 방법으로 간소화한다면 Level 2와 3는 NAND gate로 바꿀 수 있지만 Level 1은 바꿀 수 없다. 따라서 그림 12와 Gate 수가 같고 그림 12보다 Input의 개수
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    | 리포트 | 9페이지 | 1,000원 | 등록일 2020.01.03
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  • 자료 표지
    5. RLC회로에서 커패시터와 인덕터의 특징 확인하기
    를 구성한다. 회로에서 Unit step input을 구현하기 위해서 Pulse Current Source를 이용하여 Input 전류를 설계해 준다. 이때 Simulation ... 에서의 커패시터에 흐르는 전류가 0이 아닌 이유는 무엇일까? 먼저 2.0s에서 입력전류는 0이 되는 것을 확인할 수 있고 이렇게 되면 이 회로는 Source free circuit처럼 작동
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    | 리포트 | 3페이지 | 3,000원 | 등록일 2020.09.22
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  • 자료 표지
    8th Astable, Bistable circuit
    1. 실험 목적555 timer를 이용하여 astable, bistable 회로를 제작하고 특성을 알아보자.2. 실험 이론Astable circuitAstable 회로구성 ... 으로 충전된다.Bistable circuit일명 플립플롭 회로라 부르기도 한다. 1을 의미하는 세트와 0을 의미하는 리셋, 즉 high & low 상태의 안정된 두 가지 상태를 유지 ... 하는 회로이다. 이때 트리거 Input 펄스가 들어오면 회로는 처음과 다른 안정화된 상태로 전이하게 된다. 마찬가지로 트리거에 또 다시 펄스가 들어오면 처음의 안정화된 상태로 다시 전이
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    | 리포트 | 6페이지 | 1,000원 | 등록일 2019.06.10
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  • 자료 표지
    Voltage multiplier 설계 레포트. PSPICE 회로 및 시뮬레이션 결과 첨부. 8배율기 설계.
    Circuit 이용) 4개를 사용하여 아래와 같이 설계할 수 있다.-Simulation 결과, 위 Voltage multiplier의 INPUT, OUTPUT 및 Diode D9
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    | 리포트 | 3페이지 | 2,500원 | 등록일 2020.09.04
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  • 자료 표지
    기초전기실험_예비보고서_AC12_Series Resonant Circuits
    affects the selectivity of the circuit BW =f _{s} /Q resonanceV _{C} `` CONG QE _{input} half-power ... 기초전기실험 예비보고서 AC12 Series Resonant Circuitsac 12. Series Resonant Circuits1. 실험 목적- 직렬 공진 회로의 공진 주파수 ... 와 대역폭의 결과사이의 관계를 알아본다.2. 실험 이론- 공진회로 (resonance circuit)서로 다른 에너지 사이의 가역적 변환에 의해서 일어나는 자유 진동의 주파수
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    | 리포트 | 4페이지 | 1,000원 | 등록일 2020.10.05
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  • 판매자 표지 자료 표지
    일반물리학실험-전자기파의 측정 및 운동 분석
    11. Propagation of electromagnetic wave1. Abstract본 연구에서는 lecher line에서 3가지 실험 open circuit, short ... circuit, impedance matching을 구성하여v _{current}와v _{voltage}의 속도를 측정하였고, 이 속도가 광속과 매우 유사하다는 결론을 내 ... 으며, 이 역시 직접 line과 닿지 않도록 주의한다. 본 실험에서는 세 가지 방법으로 실험을 진행할 것이다.1. Open-Circuited(저항이 무한대로 생각 또는 연결되어 있지 않
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    | 리포트 | 5페이지 | 2,000원 | 등록일 2020.07.11
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  • 자료 표지
    연세대 전기전자 기초실험 chapter. 7 (2017년판) 예렙+결렙
    appropriate inputs and outputs of each gates. Second, we implemented 4-bits adder through Verilog circuit ... Experiment ResultIn this experiment, we implemented the digital circuit in two ways. First, we ... implemented 6 basic gates (AND, OR, NOT, NAND, NOR, XOR) through logic gate circuit design. It was a way
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    | 리포트 | 5페이지 | 1,500원 | 등록일 2018.07.17
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  • 자료 표지
    소뇌 (cerebellum) 해부, 회로, 질환
    CerebellumContents Gross anatomy Macroscopic structure Cerebellar input Cerebellar output Deep c ... erebellar nucleus Internal cerebellar circuitries Cerebrocerebellar and cerebellocerebral circuitries ... input Inferior cerebellar peduncle Connect with medullar Mainly inputMacroscopic Structure Cerebellar c
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    | 리포트 | 56페이지 | 4,000원 | 등록일 2018.10.31
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  • 자료 표지
    연세대학교 전기전자공학부 20-1학기 기초디지털실험 final project 보고서
    tate S7(writing state)endelse if (cnt_write%41==40) //the data input window is at the right endbegincnt ... hange the line of the input data windowdata_offset2 = 5'd0; //move the input data window to the left ... endstate = S3; //go back to state S3endelse //the data input window is not at the right endbegincnt
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    | 리포트 | 25페이지 | 10,000원 | 등록일 2020.08.18
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  • 자료 표지
    8. 브릿지 전파 정류 회로와 제너다이오드, 커패시터를 이용한 DC레귤레이터 만들기 클램프 서킷 파형 출력하기
    2020' IT시스템설계IT시스템설계과제 #88. 브릿지 전파 정류 회로와 제너다이오드, 커패시터를 이용한 DC레귤레이터 만들기 / 클램프 서킷 파형 출력하기1. 과제 목표 ... 었다. 브릿지 전파 정류 회로 + 제너다이오드 + 커패시터를 연결하여 다음과 같이 회로를 구성해보자.2. 피스파이스를 이용한 회로구성(1)회로 설계에 앞서 Input Source는 문제
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    | 리포트 | 4페이지 | 3,000원 | 등록일 2020.09.22
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  • 자료 표지
    소스 팔로워, 공통 게이트 증폭기 결과보고서
    haracteristics of circuit 1그림 1 Input-Output Transfer Characteristics CurveV _{CG}(V)v _{O}(mV)Operation ... amplifier표 7 Measurement data to check input-output transfer characteristics of circuit 1input voltage ... Source follower표 1 DC condition of source follower circuitR _{S}V _{D}V _{G}V _{S}I _{D}Operation area5
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    | 리포트 | 7페이지 | 1,000원 | 등록일 2018.12.15
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  • 자료 표지
    [전자회로실험] '17 연산증폭기 기본특성' 예비레포트 (영문)
    the common mode voltage range of Operational amplifier input in the experimental circuit. Changing th ... used cases in analogs circuit.3. Equipment and how to useCircuit partsDC Power SupplyDigital ... and capacitors between its output and input terminals. These feedback components determine the
    Non-Ai HUMAN
    | 리포트 | 12페이지 | 1,500원 | 등록일 2019.03.27 | 수정일 2019.03.29
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  • 자료 표지
    기초회로실험1 Lab 14 D Flip-Flop Report
    * Introduction1. 목적D Flip-Flop circuit을 구성하고 논리식을 보인다.2. 이론 및 도구logic lab unit : 빵판과 여러 기능으로 구성된 유닛 ... 는 0을 나타내며 그만큼의 신호를 input으로 넣어준다.GRD, 5V 전압코드도 있어서, 단락시켜주거나 입력전압을 가할 수 있다.input과 output 짝이 여러 개 있는 칩 ... 으로이를 사용하여 회로를 구성했다.* 7410칩: triple 3-input positive NAND Gate이번에 실험해 본 회로는 Positive Edge Triggered D
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    | 리포트 | 8페이지 | 2,000원 | 등록일 2019.08.01
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  • 판매자 표지 자료 표지
    SRlatch,Dlatch등등 여러가지 latch들
    circuit)에 대해 연구해볼 필요가 있습니다.디지털회로는 2개의 불연속적인 전압을 정보의 표현에 이용하는 전자회로이고, 논리회로를 구현하는 한 방법입니다.디지털은 일반적으로 2개 ... 을 feedback, 한국어로는 되먹임 이라고 합니다.ⅳ)신호의 timing에 따른 순서논리회로①동기식 순서 회로(synchronous sequential circuit)?어떤 시점 ... 에 들어오는 신호들에 의해 회로의 동작을 정의할 수 있는 시스템?클럭 펄스 사용, 보편적 방법②비동기식 순서 회로(asynchronous sequential circuit)?회로의 동작
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    | 리포트 | 42페이지 | 1,000원 | 등록일 2019.03.16 | 수정일 2021.01.05
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  • 자료 표지
    연세대 전기전자 기초실험 chapter. 8 (2017년판) 예렙+결렙
    1. Text1-1. Theory We made Combinational Logic circuit in this experiment. Combinational Logic is ... Logic circuit that form is combined without memory. We made 7-segment LED and ALU by verilog and It ... output value which is selected by user according to input value. Opposite to decoder, Encoder do c
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    | 리포트 | 13페이지 | 1,500원 | 등록일 2018.07.17
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  • 자료 표지
    Bulk hetero junction 고분자 태양전지의 동향
    v ( V oc ) - Short - circuit current density ( J sc ) - Fill factor (FF) Divided by input power ... material’s LUMO.) V oc : Open - circuit voltage J sc : Short - circuit current density HOMO: Highest
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    | 리포트 | 16페이지 | 2,000원 | 등록일 2020.09.16
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  • 자료 표지
    서강대학교 디지털논리회로실험 - 실험 6. Flip-flops and Shift Registers 예비 보고서
    를 이해한다.2. 관련 이론1) 조합 논리회로와 순차 논리회로① 조합 논리회로 (Combinational logic circuit) : 출력이 현재의 입력에 의해서만 결정됨② 순차 ... 논리회로 (Sequential logic circuit) : 출력이 현재의 입력과 현재의 상태에 의해 결정됨2) 래치와 플립플롭 : 1비트의 정보를 저장할 수 있는 회로① 래치 ... -Input NAND gate② 74LS02 : 2-Input NOR gate③ 74LS04 : NOT gate4. 실험 과정 및 예상 결과1) SR latch를 NOR gate를 이용
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    | 리포트 | 10페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24
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