"아날로그설계실습"의 검색결과 입니다.

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아날로그 카운터설계 래치와 플립플롭 결과보고서11 stopwatch 설계 smps

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"아날로그설계실습" 검색결과 241-260 / 888건

[A+]중앙대학교 아날로그및디지털회로설계실습 래치와 플립플롭 과제

문제 1설계 실습 영상의 edge-triggered 플립플롭의 타이밍 차트를 완성하시오. (Hint : Positive edge-triggered)

리포트 | 2페이지 | 1,000원 | 등록일 2021.09.02

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[A+]중앙대학교 아날로그및디지털회로설계실습 신호 발생기 과제

리포트 | 3페이지 | 1,000원 | 등록일 2021.09.02

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아날로그 및 디지털회로설계실습 9 부울대수 및 조합논리회로 예비 리포트

설계실습 9. 부울대수 및 조합논리회로요약: 이번 보고서를 통해 부울대수 및 조합논리회로를 학습했다. 전가산기의 진리표를 작성하고 Karmaugh 맵을 통해 불리언식을 알아보 ... 았다. 이를 ORcad를 통해 2-level회로로 설계했으며 그 후에 XOR gate를 간단화 한 회로를 설계했다. 2Bit 가산기 회로를 설계했다.서론: 전가산기는 3개의 이진수 ... 를 더해서 결과로 합과 자리올림수를 출력으로 내는 기능을 한다. 이런 전가산기에 대해 학습하고 불리언식을 알아본 후 회로를 설계하고 간소화한 회로도 설계하고 이를 이용해 2bit 가산

리포트 | 4페이지 | 1,000원 | 등록일 2021.09.02

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9. 4-bit Adder 회로 설계 예비보고서 - [아날로그및디지털회로설계실습 A+ 인증]

아날로그 및 디지털 회로 설계 실습-실습 9 예비보고서-4-bit Adder 회로 설계소속중앙대학교 전자전기공학부담당 교수님*** 교수님제출일2021.11.11(목)분반, 조 ... Cout 을 출력한다.참고 자료 : 실습 교재 이론부, Digital Design 4 Ed.2. 실습 목적- 조합논리회로의 설계 방법을 이해하고 조합논리회로의 한 예로 가산기 회로 ... 를 설계한다.3. 실습 준비실습 준비물부품저항 330Ω, 1/2W, 5%Inverter 74HC04NAND gate 74HC00NOR gate 74HC02AND gate 74HC

리포트 | 10페이지 | 1,000원 | 등록일 2022.10.30 | 수정일 2023.01.03

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A+ 중앙대 아날로그및디지털회로설계실습(결과)4. 신호 발생기

(보고서 작성에 참고한 문헌을 번호로 나열하며 본문에서 인용된 부분에 이 번호를붙인다.)1. 중앙대학교 전자전기공학부, “아날로그 및 디지털 회로 설계 실습”, pp 44-45 ... 을 변화를 시키고, 다이오드를 추가하며 소자의 값을 조절하여 원하는 주파수와 크기를 설정하여 왜곡을 줄일 수 있다.2. 실험결과4-4. 설계 실습 내용 및 분석4-4-1 설계 ... 다.다이오드를 추가시키자 왜곡이 감소한 안정된 출력이 발생하였다. 발진주파수의 최대치 1.96kHz이다.4-5-2 설계 사양에 따라 설계실습계획서에서 설계한 회로가 실제 구현

리포트 | 4페이지 | 1,000원 | 등록일 2022.09.10

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[A+]중앙대 아날로그및디지털회로설계 실습 예비보고서2 SMPS

1. 실습을 위한 이론적 배경:-SMPS : 일정한 전류 출력 전압을 부하에 공급해주는 직류 안정화 전원이다. DC-DC 컨버터 에 있어서 부품의 기생 요소들에 의하여 부하 변동 ... 으로 방출하게 된다. 스위 칭 주기 TS를 한 주기로 하여 이 동작이 반복되면서 입력전원을 우리가 원하는 출력전력으 로 변환하게 된다.4. 실습 계획서4-1 PWM칩(UC ... 3845)을 이용하여 아래 성능의 PWM 제어 회로를 설계하시오.- 출력전압 : 0 V ~ 10 V (peak to peak )- 스위칭 주파수 f : 12.5 kHz4-2 PWM

리포트 | 11페이지 | 1,000원 | 등록일 2022.09.08 | 수정일 2022.09.14

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[예비] 실습1. 접촉식 초전형 (Pyroelectric) 적외선 센서 (중앙대/아날로그 및 디지털 회로 설계 실습)

를 설계한다. 1-2. 실습 준비물부품적외선 센서 : 1 개RE200B Op-Amp UA741CN : 2 개LED : 1 개커패시터 10nF: 1 개ceramic disk 커패시터 ... 1-1. 실습목적초전형 적외선 센서, LED, Op-Amp 의 원리를 이해하고, 센서가 인체의 움직임을 감지하였을 때 발생하는 전압의 변화를 검출할 수 있는 초전형 센서 회로

리포트 | 4페이지 | 1,000원 | 등록일 2021.03.09

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A+ 중앙대 아날로그및디지털회로설계실습(결과)8. 래치와 플립플롭

filter는 TV, radio 등에서 주파수를 선택하는 tunner에 많이 쓰이는 회로이며....(이 실험의 중요도, 필요성 등을 서술한다.)2. 실험결과8-4. 설계실습 내용 및 ... 실습 8. 래치와 플립플롭(학생이름, 학번, 학수번호, 실험조의 번호, 실험조원의 이름, 실험날짜, 제출날짜)요약 : 전자전기장비에 많이 사용되는 bandpass filter ... 를 R,L,C를 사용하여 설계하고 제작하였다. 설계에 사용된 수식을 PC의 EXCEL을 사용하여 simulation하고 그 결과를 실험치와 비교한결과 2%이하의 오차로 잘 일치하는 것

리포트 | 5페이지 | 1,000원 | 등록일 2022.09.10

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중앙대 아날로그및디지털회로설계실습 예비보고서 8장 래치와 플립플롭

아날로그 및 디지털회로설계 실습 예비보고서[설계실습 8. 래치와 플립플롭]소속담당교수담당조교수업시간학번성명? RS 래치RS 래치 회로도: 교차교합(Cross-coupled)된 두 ... (Oscilloscope): 1대브레드보드 (Bread board): 1개파워서플라이 (Power supply): 1대함수발생기 (Function generator): 1대점퍼선: 다수8-3 설계실습 ... 방정식:Q ^{+} =S+ {bar{R}} Q (Q ^{+}는 다음 순간의 출력Q를 의미한다.)8-1. 실습목적: 순차식 논리회로의 기본 소자인 래치와 플립플롭의 여러 종류에 대한

리포트 | 4페이지 | 1,000원 | 등록일 2023.04.06

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[A+][예비레포트] 중앙대 아날로그 및 디지털 회로 설계실습 9. 4-bit Adder 회로 설계

실습 9. 4-bit Adder 회로 설계실습목적조합논리회로의 설계 방법을 이해하고 조합논리회로의 한 예로 가산기 회로를 설계한다.설계실습계획서2-1 전가산기 설계(A) 전가산기 ... + ACi +BCi(C) 에서 구한 간소화된 불리언 식에 대한 2-level AND-OR(NAND-NAND) 또는 OR-AND(NOR-NOR) 로직 회로를 설계한다.(D) XOR ... gate를 이용하여 보다 간소화된 다단계 조합 논리 회로를 설계한다.(E) 설계한 회로 중 하나를 선택하여 2Bit 가산기 회로를 설계한다.

리포트 | 3페이지 | 1,000원 | 등록일 2022.04.08

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[A+]중앙대 아날로그및디지털회로설계실습 과제 4-bit Adder 회로 설계 (12주차)

아날로그 및 디지털 회로설계실습12주차 4-bit Adder 회로 설계1.- 출력 f의 진리표를 이용한 부울 대수식- 출력 f의 Karnaugh map을 이용하여 간소화한 부

리포트 | 3페이지 | 1,000원 | 등록일 2021.10.09

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중앙대학교 아날로그및디지털회로설계실습 설계실습 1. 접촉식 초전형(Pyroelectric) 적외선 센서 A+ 예비보고서

(Function generator) : 1대 점퍼선 : 다수1-3 설계실습 계획서1-3-1 초전형 적외선 센서(RE200B)와 증폭기 사이에 신호를 전달하는 High-Pass ... 1-1. 실습목적 : 초전형 적외선 센서, LED, Op-Amp의 원리를 이해하고, 센서가 인체의 움직임을 감지하였을 때 발생하는 전압의 변화를 검출할 수 있는 초전형 센서 회로 ... 를 설계한다.* 사용장비 오실로스코프(Oscilloscope) : 1대 브레드보드(Breadboard) : 1개 파워서플라이(Power supply) : 1대 함수발생기

리포트 | 2페이지 | 1,000원 | 등록일 2022.09.15 | 수정일 2022.09.22

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아날로그 및 디지털회로설계실습 10 조합논리 회로의 예 (7-segmentDecoder 회로 설계) 예비 리포트

설계실습 10. 조합논리 회로의 예(7-segmemt/Decoder 회로 설계)요약: 이번 보고서에서는 조합논리회로를 학습했다. 7-segment/Decoder 진리표를 완성 ... 했으며 진리표를 통해 Karnaugh과 간소화 된 형태의 불리언 식을 구했다. 그 후에 Decoder와 7-segment를 이용한 7-segment 구동 회로를 설계했다.서론: 7-s ... 을 구해 7-segment/Decoder회로를 설계하는 실험을 했다.실험결과:7-segment/Decoder 진리표아래 7-segment/Decoder 진리표를 작성한다.입력출력

리포트 | 4페이지 | 1,000원 | 등록일 2021.09.02

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[A+]중앙대학교 아날로그및디지털회로설계실습 7-segment / Decoder 회로 설계 과제

문제 17-Segment LED의 특성을 확인하였을 때 Common Cathode type이라면, 7-Segment LED의 3번핀과 8번핀은 어디에 연결하여야 하는가?-> AnswerCommon-Cathode Type은 LED의 -극끼리 묶어 GND로 연결해주고 +극..

리포트 | 3페이지 | 1,000원 | 등록일 2021.09.02

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[A+]중앙대 아날로그및디지털회로설계실습 과제 동기순서 논리회로 (Stopwatch 설계) (15주차)

아날로그 및 디지털 회로설계실습15주차 동기순서 논리회로 (Stopwatch 설계) 과제05분반 20161163 박성은1.- 16진 동기 카운터 회로도- 10진 동기 카운터 회로

리포트 | 2페이지 | 1,000원 | 등록일 2021.10.09

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[A+][예비레포트] 중앙대 아날로그 및 디지털 회로 설계실습 10. 7-segment / Decoder 회로 설계

실습 10. 7-segment / Decoder 회로 설계실습목적7-segment와 Decoder를 이해하고 관련 회로를 설계한다.설계실습계획서2-1 7-segment ... -Segment 구동 회로 설계Decoder와 7-segment를 이용한 7-segment 구동 회로를 설계한다.

리포트 | 4페이지 | 1,000원 | 등록일 2022.04.08

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[예비보고서]중앙대학교 아날로그및디지털회로설계실습 위상 제어 루프(PLL)

board) : 1개파워서플라이 (Power supply) : 1대함수발생기 (Function generator) : 1대점퍼선 : 다수6-3. 설계실습 계획서6-3-1 위상제어루프 ... 6-1. 실습 목적위상 제어 루프 회로의 이론을 학습하고 간단한 위상 제어 루프 회로를 구성하여 주파수 동기화(Phase Locking) 원리를 이해한다.6-2. 실습 준비물부품

리포트 | 8페이지 | 1,000원 | 등록일 2023.06.23

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A+ 중앙대 아날로그및디지털회로설계실습(결과)5. 전압 제어 발진기

. 참고문헌(보고서 작성에 참고한 문헌을 번호로 나열하며 본문에서 인용된 부분에 이 번호를붙인다.)1. 중앙대학교 전자전기공학부, “아날로그 및 디지털 회로 설계 실습”, pp 46-50 ... 다.2. 실험결과5-4. 설계실습내용 및 분석5-4-1 설계한 전압제어 발진기 회로의 구현그림 5-1의 적분회로를 응용한 전압제어 발진기 회로를 구성하라.(OP amp의 공급전압 ... 보고서(예)의 형식으로 작성하되, 다음 사항을 검토하여 작성하라.5-5-1 본 설계실습에서 무엇을 하였으며 그 결과는 어떤가? 수치를 포함하여 요약한다.본 실습에서는 적분기

리포트 | 4페이지 | 1,000원 | 등록일 2022.09.10

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[A+]중앙대학교 아날로그및디지털회로설계실습 논리함수와 게이트 과제

문제 1NAND 게이트 소자만을 이용하여 XOR 게이트의 등가회로를 구성하시오.문제 24 x 2 인코더를 설계하시오.(Hint : 2개의 OR 게이트를 사용, 4개의 입력 중 한 가지는 사용되지 않으며 3개의 입력만 회로에 사용)

리포트 | 2페이지 | 1,000원 | 등록일 2021.09.02

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A+ 중앙대 아날로그및디지털회로설계실습(결과)6. 위상제어루프(PLL)

요약 :컴퓨터, 오디오, TV 등 통신 분야에서 폭넓게 사용되는 위상 제어 루프를 설계하고 확인하였다. 주파수 동기화의 원리를 알 수 있다. 이전 실험에서 설계한 VCO와 XOR ... 게이트를 이용한 phase detector, loop filter로 위상 제어 루프 회로를 설계하였다. Vref에 5V의 구형파를 넣어주고, VCO의 커패시터 용량을 바꾸어 가

리포트 | 4페이지 | 1,000원 | 등록일 2022.09.10

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