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"논리회로8장" 검색결과 221-240 / 1,102건

  • 디지털 실험 1장(스위칭 회로) 결과 보고서
    실험 1장 스위칭 회로 결과보고서1. 실험목적AND, OR 논리의 진리표를 결정한다.Switch(릴레이)의 직렬, 병렬 연결로 AND, OR 논리를 구성한다.Switching ... 그림 1-8 회로를 구성하고 진리표를 작성 ... ,병렬, AND, OR 등의 논리 회로를 구성할 수 있음을 발견했다. 즉, 스위치 회로만으로 모든 논리 함수를 표현할 수 있고 실현할 수 있음을 예상할 수 있었다.4. 고찰AND
    Non-Ai HUMAN
    | 리포트 | 9페이지 | 3,000원 | 등록일 2019.12.17
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    제11장 조합논리 결과보고서
    제11장 조합논리-결과보고서-실험1 ? 최소화된 논리회로의 구성[목적] 제11장의 첫 실험으로 회로를 구성하는 방법을 상세히 기술한다.- 최소화가 언제나 좋은가?와 의 논리회로 ... 단자를 연결하기 위한 단자를 마련한다.8) 파형발생기와 오실로스코프를 연결하라.실험2 ? 최소화된 논리회로의 동작1) 회로가 정상동작함을 확인하라.- 전원공급기의 ‘OUTPUT’버튼 ... 는 에 비해 최소화 되었다. 하지만, 각 게이트의 내부 지연시간으로 인하여 글리치(해저드)가 발생할 수 있다. 이것을 실험을 통하여 알아본다.1) 의 논리회로를 구성한다.2) 빵판
    Non-Ai HUMAN
    | 리포트 | 6페이지 | 1,500원 | 등록일 2020.02.10
  • 예비보고서(4) 카운터 counter
    실험제목 :Counter- 예비보고서1. 목적이 장에서는 조합논리회로와 순서논리회로에 대한 대표적인 응용회로인 카운터에 관해서 그 동작 특성을 실현한다. 구체적으로, 카운트-업 ... ) 시키고CLK에 클럭 펄스를 하나씩 트리거시키면서Q` _{3} SIMQ _{ 0}의 논리상태를 측정하여 표 1(a)에 기록한다.(2) 비동기식 카운터-다운 카운터 회로 (b ... 하여 표 4(a)에 기록한다.(8) 동기식 십진 카운터 회로 (g)를 구성하고 절차 (1)을 반복하여 표 4(b)를 완성한다.(9) 모듈러스 5 카운터 회로 (h)를 구성하고 절차
    Non-Ai HUMAN
    | 리포트 | 11페이지 | 3,000원 | 등록일 2020.10.14
  • 디지털 실험 9장(멀티플렉서를 이용한 조합논리) 예비보고서
    실험 예비 보고서(9장 멀티플렉서를이용한 조합논리)실험 목적-멀티플렉서를 이용하여 비교기와 패리티 발생기를 설계하고 그 회로를 시험한다.-2XN 입력의 진리표를 수행하기 위해 N ... 하면 아래와 같다.같은 방법으로 8*1 MUX의 진리표와 논리회로를 알아보자. 다음과 같은 표와 그림이 나오게 된다.S2S1S0Y000I0001I1010I2011I3100I4101I ... 의 하나는 진리표로부터 바로 조합 논리 함수를 실현할 수 있는 것이다. 예로써, 실험 7에서는 그림 9-2(a)에 제시된 진리표로부터 오버플로우 에러를 검출하는 회로가 필요
    Non-Ai HUMAN
    | 리포트 | 14페이지 | 3,000원 | 등록일 2019.12.17
  • 디지털 실험 8장(디코더를 이용한 조합논리) 결과 보고서
    실험 8장 디코더를 이용한 조합논리1. 실험목적-디코더를 이용한 다중 출력 조합 논리 회로를 구현한다.2. 실험순서1) 그림 8-6은 부분적으로 완성된 회로이다. 74LS139A ... 는 상태 디코더이고, 부논리 NOR 게이트로 그려진 AND 게이트는 출력 논리를 형성한다. 진리표를 참조하여 회로를 완성한다. 여기서는 1 입력이 어떻게 수행되는지를 결정하는 것 ... ) 회로를 설계하고 진리표의 모든 조합들을 시험한다. 진리표 8-1에서 열거된 수서대로 스위치를 열고 닫는다면, 정확한 신호등 순서를 관찰할 수 있다.State CodeState
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    | 리포트 | 9페이지 | 3,000원 | 등록일 2019.12.17
  • 8주차-실험19 예비 - 카운터 회로
    어서 계수하는 회로이다.(8) 8진 비동기식 up카운터를 D플립플롭을 이용하여 설계하라.⇒ UP Counter란 최댓값이 되기 전까지는 Up으로 카운터가 되고, 마지막에는 Carry ... 플롭의 결과 값이 다음 플립플롭의 CLK로 들어가는 것이기 때문에 비동기식이다.(8) 실험 2의 회로를 변경하여 Mod-8의 회로를 그려라.⇒ Mod-10회로에서는 각각의 클리어 ... 2015년도 제2학기기초회로실험Ⅱ기초회로실험Ⅱ실험19. 카운터 회로담당교수 : 교수님학 부 : 전자공학부학 번 :이 름 :실 험 조 :제 출 일 : 2015. 10. 28실험제목
    Non-Ai HUMAN
    | 리포트 | 14페이지 | 1,500원 | 등록일 2020.10.02 | 수정일 2022.10.16
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    제10장 래치와 플립플롭 예비보고서
    제10장 래치와 플립플롭-예비보고서-1) 실험의 목표- 순차논리회로에 대한 개념을 이해한다.- 래치의 동작원리를 이해한다.- 래치의 동작을 실험을 통해 이해한다.- 플립플롭 ... 의 동작원리를 이해한다.- 플립플롭의 동작을 실험을 통해 이해한다.2) 이론 및 실험- 순차논리회로디지털회로는 크게 조합논리회로(combinational logic)와 순차논리회로(s ... equential logic)로 분류된다.조합논리회로는 현재의 순간의 출력이 현재 순간의 입력에 의해서 결정되는 논리회로이다.순차논리회로는 현재 순간의 출력이 현재 순간의 입력
    Non-Ai HUMAN
    | 리포트 | 15페이지 | 1,500원 | 등록일 2020.02.11
  • 서강대학교 디지털논리회로실험 레포트 5주차
    그림 \* ARABIC 16. STEP7의 회로우리 조는 사진 5와 같이 회로를 구성하였다.사진 SEQ 사진 \* ARABIC 5. 그림 16를 구현한 회로STEP8) 입력(PSW0 ... 에서의 summary 화면STEP11) 그림 19의 full-adder 회로를 구성하였다.그림 SEQ 그림 \* ARABIC 19. Full-adder우리 조는 사진 8과 같이 회로 ... 를 구성하였다.사진 SEQ 사진 \* ARABIC 8. 그림 19의 full-adder를 구현한 회로STEP12) A_input, B_input, Carry_in에 PSW0
    Non-Ai HUMAN
    | 리포트 | 25페이지 | 1,000원 | 등록일 2020.08.12 | 수정일 2020.08.26
  • 판매자 표지 자료 표지
    [평가계획서][평가기준안] 가장 작성하기가 까다롭다는 정보 과목 2학기 평가계획서 및 평가기준안입니다.
    )을 대상으로 한다.2. 영역별 반영비율학기평가방법(반영비율)지필평가(40%)수행평가(60%)계2학기평가영역2회고사논리회로설계실습(엑셀 프로그램)포트폴리오평가시기12.6.~12 ... 한다.다. 인정점 성적처리과정상의 소수점은 소수점 첫째자리에서 반올림하여 정수로 부여한다.5. 수행평가 영역별 세부 평가 기준가. 논리 회로 설계평가명칭논리 회로 설계성취기준정보3211 ... 유무20점(오류 발생 횟수에 따라 ?1점, 최저 10점)논리식과 논리회로 표현· 논리식을 논리회로로, 논리회로논리식으로 표현하는 과정에서 오류 발생 유무20점(오류 발생 횟수
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    | 리포트 | 12페이지 | 3,000원 | 등록일 2020.06.02
  • (디지털실험A+)디코더를 이용한 조합논리_결과보고서
    Experiment-Report(8장 디코더를 이용한 조합논리)1. 실험목적디코더를 이용한 다중 출력 조합 논리 회로를 구현한다.2. 자료 및 관찰디코더 역할을 수행하는 IC ... 의 사진이다.A,B,C를 모두 1로 연결한 회로.(디코더 Y7에 불이 안들어옴)A,B,C를 모두 0으로 연결한 회로.(디코더 Y0에 불이 안들어옴)3. 결과 분석이번 실험은 디코더 ... 가 달리 흐른다. 입력이 3개 이므로 디코더의 출력은 개가 된다. 본 회로는 항상 불이 들어오게끔 해야하므로 Enable을 G1에서 1로 고정을 시켰다. 또한 내부 회로는 NAND
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    | 리포트 | 5페이지 | 1,000원 | 등록일 2020.03.05
  • 전가산기 설계 보고서
    : Verilog 설계 전에 진리표를 이용해서 논리 식을 유도하는 과정이 필요하므로, 설계에 필요한 시간이 오히려 늘어날 수 있다.?[3-8]동작 표현을 이용한 설계pin할당input ... 가산기의 동작을 그대로 표현했다.Verilog를 이용해서 동작을 모델링하며 설계 할 수 있으며, 디지털 회로구현에 논리 연산보다는 수학적인 연산자들이 그대로 사용된다.장점 : 1 ... 전가산기 설계보고서목적 : 전가산기를 Schematic과 Verilog(VDHL)로 다양하게 설계하는 방법에 대해 설명하고, 각각의 차이점과 장단점을 비교하기 위함이다.준비물
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    | 리포트 | 5페이지 | 2,000원 | 등록일 2020.11.20
  • 서울시립대 전자전기설계2(전전설2) 2주차 사전보고서
    , FPGA는 모두 PLD(Programmable Logic Device)인데 이는 소자 제조 후 사용자가 내부 논리회로의 구조를 변경할 수 있는 집적회로이다. 회로가 정의되지 않 ... 2019년 전자전기컴퓨터설계실험22주차 사전보고서학번 : 2015-610019성명 : 윤종민1. PROM, PAL, CPLD, FPGA 차이점과 장단점PROM, PAL, CPLD ... 은 채 출하되기에 사용자가 임의의 회로를 기록해 동작시킬 수 있다. 일반 집적회로로는 대량 제조하는 경우 ASIC를 사용하지만 이는 많은 비용과 시간이 들기에 초기 개발비가 필요없
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    | 리포트 | 4페이지 | 1,500원 | 등록일 2019.10.13
  • 디지털 실험 3장(논리게이트) 결과보고서
    실험 3장 논리게이트 결과보고서1. 실험목적- NAND, NOR, NOT 게이트의 진리표를 실험적으로 결정한다..- 다른 논리 게이트를 만들기 위해 NAND와 NOR 게이트 ... 를 사용한다.2. 실험순서1) 그림 3-8에 제시된 회로는 표 3-1(a)에서 (e)까지 제시된 진리표 중 어느 것과 같다.모든 입력 조합을 조사하여 진리표 3-8을 완성한다. 이것 ... 들 수 있다. 첫째는 0V일때와 동일하게 차단전압 때문에 이론값보다 낮게 나오게 된다. 다음으로 실험2장에서 배운 Fan-in현상을 들 수 있다. 마지막으로 LED, NAND
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    | 리포트 | 3페이지 | 3,000원 | 등록일 2019.12.17
  • 2018학년도 1학년 1학기 컴퓨터의이해 중간과제물
    고 산술논리연산장치는 가, 감, 승, 제와 같은 산술명령을 수행하는 데 필요한 전자회로가 있으며, 또한 두 수의 크기를 비교하고 비교된 결과를 가리키는 논리명령을 수행하는 데 필요 ... 한 전자회로도 가지고 있다.내 데스크톱 PC는 AMD의 라이젠7 서밋릿지 1700을 사용하고 있다.[그림 3] AMD의 라이젠74) 기억장치기억장치는 주기억장치와 이를 보조해 주는 보조 ... 된 명령어에 따라 작업을 지시하는 제어장치 및 산술연산과 논리연산을 수행하는 산술논리연산장치로 구성되어 있다. 제어장치는 컴퓨터 시스템 전체를 지시, 감독하며 조정하는 역할을 하
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    | 방송통신대 | 5페이지 | 3,000원 | 등록일 2019.11.26 | 수정일 2019.12.02
  • [텀프] 아날로그회로설계(op-amp) 텀프로젝트 스마트신발장
    아날로그 회로실험 및 설계 term project스마트 신발장1. 개요2. 사용소자3. 이론가. Op-Amp 비교기 회로나. Op-Amp ADC 회로다. 조도센서라. 서보모터4 ... . 블록도5. 회로도가. 전체 회로도나. 조도 센서회로다. 서보 모터 회로6. 브레드 보드 구현 및 실제 파형7. datasheet8. 결론 및 고찰9. 실험 사진10. 참고자료1 ... . 개요스마트 신발장이란 가정 혹은 학교 등에서 사용하는 신발장에서 악취가 나거나 신발을 놓는데 불편함을 개선하기 위하여 만든 것이다. 아날로그 회로 실험시간에 배운 Op-Amp
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    | 리포트 | 16페이지 | 3,000원 | 등록일 2019.12.30 | 수정일 2020.01.02
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    [전자회로실험] cds센서를 이용한 주차관리 프로젝트 결과보고서
    은 다이오드를 거쳐서 OR논리에 따라 LED에 영향을 준다.두 자리 모두 비어있을 때- 주차장의 두 자리가 모두 비어있을 때는 위의 회로도에서 저항 ‘cds1’과 저항‘cds2’가1 ... 를 사용하여 OR논리를 이용하여 자리가 하나라도 비어있으면 주차할 공간이 남아있다는 표시를 해주는 LED 등을 밝힌다.4. 시스템 상세기술1) Pspice 시뮬레이션 회로도와 해석전체 ... 2019 전자회로실험프로젝트 결과보고서분반 : 반조- 목 차 -1. 주제선정 및 동기2. 프로젝트 목적3. 시스템 개요4. 시스템 상세기술1) Pspice 시뮬레이션 회로
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    | 리포트 | 11페이지 | 1,500원 | 등록일 2019.12.03
  • 기계기사 유압기기(4,5과목)요약
    과 토출량4장, 유압제어벨브1. 유압 회로 내의 압력이 설정 압을 넘으면 유압에 의하여 막이 파열되어 유압유를 탱크로 귀환시키며, 압력 상승을 막아 기기를 보호하는 역할하는 유압 ... 회로에 유량제어밸브를 설치하여 실린더 입구 측의 불필요한 압유를 배출시켜 작동효율을 증진시킨다. 회로연결은병렬로 연결한다.7. 실린더의 용량을 변화시키는 것 - 블리드 오프 회로8 ... 를 가지고, 모든 입력 포트에 입력이 더해진 경우에만 출력포트에 출력이 나타나는 회로 - AND 논리회로10. 실린더의 부하 변동에 상관없이 임의의 위치에 고정시킬 수 있는 회로
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    | 시험자료 | 12페이지 | 3,000원 | 등록일 2020.05.07
  • 디지털 실험 7장(가산기,감산기) 결과보고서
    ) 설계로부터 회로를 구성한다. 진리표 7-3에 나열된 대로, 모든 가능한 입력을 시험한다. 출력은 LED로부터 바로 읽어진다. 논리 1일 때, LED는 ON이 되고 논리 0일 때 ... 실험 6장 비교기1. 실험목적- 가산, 감산 연산을 구현해 본다.- 4비트 2진수를 Excess – 3 코드로 변환하는 변환기를 설계, 구현, 실험한다.- 3 오버 플로우 ... (overflow) 검출로 부호화 수의 가산기 설계를 완성한다.2. 실험순서1) 그림 7-5는 2진수를 Excess-3코드로 변환하는 회로를 부분적으로 완성한 설계이다. 그것은 이론 요약
    Non-Ai HUMAN
    | 리포트 | 6페이지 | 3,000원 | 등록일 2019.12.17
  • 저전력 VLSI 기술
    속도를 확보하여 증폭기의 속도를 감소 시킬 수 있기에 전류소모 감소 회로도가 다소 복잡 Double sampling 클럭의 한주기 동안 두번 샘플링하는 방법 장 단 Double s ... 은 영역이 필요 , 회로 설계가 복잡해짐 이론적으로 받아들여야 하기 때문에 현재는 많이 이용하지 않는 것으로 보임 장 단 단열회로EDA 툴 발전 Synopsys, Cadence ... 소비에 모두 효과적 . 국내 기술은 아직 걸음마 단계 정류기 , DC-DC 변환기 , MPPT 회로 등이 필요함 장 단Energy Harvesting – 종류 Energy
    Non-Ai HUMAN
    | 리포트 | 17페이지 | 1,000원 | 등록일 2020.04.29
  • 정현파 측정
    한신호파형에 대한 회로의 응답특성을 연구하는 데 큰 도움이 된다.오실로스코프이번 실험에서는 오실로스코프를 사용하여 정현파에 관련된 여러 항목을 측정한다. 앞장의 실험에서 알아본 것 ... 측정기능을 사용하지 않는 것으로 한다.함수 발생기함수 발생기에서 발생시킬 수 있는 신호파형은 대개 정현파, 사각파, 삼각파 이다. 또 디지털논리회로를 실험할 때 쓸 수 있도록 펄스 ... 고 POSITION손잡이로 접지위치를 스코프의 ‘한가운데’로 똑같이 맞추어 놓아야 한다.R_1=2.7kOMEGAR_2=6.8kOMEGA 으로 하여 그림 18-3의 회로를 꾸며라. 함수 발생기
    Non-Ai HUMAN
    | 리포트 | 6페이지 | 1,000원 | 등록일 2020.11.11
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2025년 11월 28일 금요일
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