실험1. 부궤환 회로 예비

*윤*

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부궤환 회로 예비

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2. 이 론
1) 연산 증폭기
- 정의 : 연산 증폭기는 두 개의 입력 단자와 한 개의 출력단자를 가지고 있으며, 두 입력단자 전압간의 차이를 증폭하는 증폭기이기 때문에 입력단은 차동증폭기로 되어 사칙연산이 가능한 회로 구성을 할 수 있다. 연산증폭기를 사용하여 미분기 및 적분기를 구현 할 수 있다.
그림1의 연산증폭기의 개별회로에서는 불가능한 전류 미러, 능동부하 등으로 쓰이는 많은 트랜지스터로 이루어진 복잡한 회로이다. 그림 2는 연산증폭기의 도식적 기호를 나타내며 반전, 비반전 및 단측 출력단자를 가지고 있다. 이상적으로 이 기호는 증폭기가 무한대의 전압이득, 무한대의 입력임피던스 및 0의 출력 임피던스를 갖는다는 의미이다. 이상적인 연산증폭기는 완전한 전압증폭기이며 종종 VCVS (voltage-controlled voltage source)라 한다. VCVS는 그림 3처럼 나타내며, 여기서 , 이다.

참고 자료

MALVINO 전자회로 6판 // ALBERT PAUL MALVINO, 김능연, 안점영 역 // Mc-GRAW-HILL
전자회로실험과 설계 // 이행세 저 // 도서출판 그린
http://scitec.jeonju.ac.kr/~jskim/mechaclass/mechaclass1/1%20(4).pd

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