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6-bit 계산기 설계 및 구현2025.05.101. ALUs (Arithmetic Logic Units) 이번 프로젝트의 주제는 ALUs (Arithmetic Logic Units)를 이용한 n-bit 계산기 설계입니다. 6-bit 입력을 구현하고 최대한 많은 연산을 구현하고자 하였습니다. 6비트 덧셈 계산기를 제작하였고, 7 segment와 다양한 기본소자들(and gate, or gate, DIP 스위치 등)을 사용하였습니다. 2. 계산기의 역사와 발전 계산기는 여러 가지 계산을 빠르고 정확하게 하기 위하여 사용하는 기기를 의미합니다. 계산기의 역사는 컴퓨터 역사라고 보면 ...2025.05.10
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컴퓨터 구조 계산기_quartus 설계_20242025.01.161. 컴퓨터 구조 이 과제에서는 간단한 구조의 계산기를 설계하는 것을 목표로 합니다. 기존에는 Schematic editor 설계 기법을 사용했지만, 이번에는 HDL(hardware description language) 기법을 이용하여 알고리즘이나 기능 레벨에서의 설계를 진행하고 gate 레벨의 로직 설계를 수행합니다. ROM이나 Hard-Wired Logic과 같은 개념을 이해하며 설계를 진행합니다. 2. 계산기 설계 계산기를 구현하기 위해 필요한 내부 레지스터(A, B, IR, C)와 외부 입력(SA, SB, SIR, STAR...2025.01.16
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한양대 Half adder & Full adder2025.05.041. 반가산기 (Half adder) 반가산기는 기본적인 덧셈 연산을 하는 장치로, 입력 2개(a,b)와 출력 2개(c,s)로 구성됩니다. 출력 C는 Carry로 상위 비트로 올라가는 자리 올림 수를 의미하고, 출력 S는 Sum으로 두 비트의 합을 나타냅니다. 반가산기는 OR, NOT, AND 등의 게이트를 활용해 회로를 구성할 수 있습니다. 2. 전가산기 (Full adder) 전가산기는 이진수의 한 자릿수를 연산하고, 하위 비트에서 올라오는 자리올림수 입력을 포함하여 출력합니다. 전가산기는 입력 Cin, A, B와 출력 Cout...2025.05.04
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홍익대학교 디지털논리실험및설계 5주차 예비보고서 A+2025.05.041. 전가산기 전가산기는 2개의 입력 비트와 입력 캐리를 받아 합의 출력과 출력 캐리를 발생합니다. 즉, 기본적으로 전가산기는 1비트 크기의 2진수 3개를 입력으로 받아서 그것들의 이진 덧셈 결과를 출력하는 시스템이라고 생각할 수 있습니다. 전가산기의 진리표로부터 합의 출력 (Σ) = (A XOR B) XOR C(in)이고 출력 캐리 (C(out)) = (A AND B) OR {(A XOR B) AND C(in)}이 됩니다. 따라서 [그림 2]의 회로는 전가산기로 동작하게 됩니다. 2. 반가산기 반가산기는 1비트 크기의 2진수 2개...2025.05.04
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홍익대_디지털논리회로실험_5주차 예비보고서_A+2025.01.151. 전가산기 전가산기는 입력 3개를 받아 2개의 결과를 출력한다. 이때 입력에는 자리올림수가 포함되어있다고 생각할 수 있다. 전가산기는 3개의 입력을 이진수로 더해 이진수 결과로 나타내준다. 은 이진수로 합한 결과의 2^1의 자리를 표현한다. 그러므로 입력값 3개 중 2개 이상이 1일 경우에만 = 1이여야한다. 이를 = AB+ (A⊕B으로 구현했다.∑는 이진수로 합한 결과의 2^0의 자리를 표현하므로 입력값 3개 중 1개 또는 3개가 1일 때, 즉 1이 홀수개일 때만 ∑ = 1이여한다. 이를 ∑ = (A⊕B으로 구현했다. 2....2025.01.15
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[특수교육] 수학 교수학습 지도안(세안, 교생실습), 받아올림이 있는 덧셈과 뺄셈, 덧셈2025.05.091. 받아올림(내림)이 있는 덧셈과 뺄셈 이 단원은 학생들의 수준을 고려하여 단순히 연산의 기능을 지도하기보다 학생들이 일상생활에서 충분히 관찰하고 경험하여 익숙해진 요소를 활용하여 덧셈 상황을 인지하는 것에 목적이 있습니다. 연산의 기능을 습득하여 결과를 나타내는 것보다, 생활 속에서 접하게 되는 덧셈 상황을 인지하는 것에 초점을 맞추어 신체적인 활동을 통해 생활 속에서 덧셈 계산이 필요한 상황임을 인식하고, 생활 속에서 쉽게 볼 수 있는 익숙한 구체물을 통해 다양한 방법으로 덧셈 상황을 경험하여, 문제 상황 해결을 위해 협동하여...2025.05.09
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병렬프로그래밍 CUDA 프로그래밍 과제1 - Vector Addition2025.05.061. CPU를 이용한 벡터 덧셈 계산 CPU로 처리해서 벡터 합을 계산하는 코드를 제공하였습니다. 이 코드는 벡터의 크기를 입력받아 각 벡터의 원소들을 더하여 결과를 생성합니다. 시간 측정을 통해 벡터의 크기가 커질수록 연산 시간이 늘어나는 것을 확인할 수 있습니다. 2. GPU를 이용한 벡터 덧셈 계산 GPU로 처리해서 벡터 합을 계산하는 코드를 제공하였습니다. 이 코드는 CPU 코드와 유사하지만 CUDA 함수를 사용하여 GPU에서 병렬 처리를 수행합니다. 시간 측정 결과, 벡터의 크기가 10,000,000 이상일 때부터 GPU ...2025.05.06
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디지털 논리실험 6주차 예비보고서2025.05.061. ALU 74181의 기능 ALU 74181을 이용하여 네 자리 이진수의 덧셈을 구현하는 방법을 설명하였습니다. 74181의 A+B, XOR, A-B-1, AB minus 1 기능을 이용하여 이진수의 덧셈, 비교, 뺄셈 등을 수행할 수 있습니다. 2. 이진수 덧셈 구현 ALU 74181의 A+B 기능을 이용하여 네 자리 이진수의 덧셈을 구현하는 방법을 설명하였습니다. 입력 값이 active low이므로 실제 입력 값을 반대로 넣어야 하며, 출력 값 역시 active low임을 주의해야 합니다. 3. 이진수 비교 구현 ALU 74...2025.05.06
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금오공과대학교 일반물리학실험 벡터의 덧셈 예비보고서+결과보고서2025.05.041. 벡터의 덧셈 이 실험은 한 점에 작용하는 여러 벡터가 평행을 이루게 하여 벡터의 합성과 분해를 공부하는 것을 목적으로 합니다. 실험에서는 두 벡터와 세 벡터의 합성을 실험하고 계산을 통해 결과를 비교하였습니다. 실험 결과와 계산 결과의 오차 원인으로는 합성대와 지지면의 수평 상태, 수준기의 오작동 등이 있었습니다. 1. 벡터의 덧셈 벡터의 덧셈은 선형대수학에서 매우 중요한 개념입니다. 벡터는 크기와 방향을 가진 수학적 객체로, 이를 더하면 새로운 벡터를 얻을 수 있습니다. 벡터의 덧셈은 물리학, 공학, 컴퓨터 과학 등 다양한 ...2025.05.04
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일반물리실험1 벡터의 덧셈 보고서2025.05.051. 벡터의 덧셈 이 실험을 통해 한 점에 작용하는 여러 벡터가 평형을 이루게 하여 벡터의 합성과 분해를 공부할 수 있게 되었고, 임의의 방향과 크기를 갖는 어떠한 벡터도 둘 이상의 벡터들의 합으로 나타낼 수 있다는 것을 알게 되었다. 또한 방향의 오차가 심했는데 이는 각대를 정 반대로 놓는다면 오차가 거의 없을 것이다. 1. 벡터의 덧셈 벡터의 덧셈은 선형대수학의 기본적인 연산 중 하나입니다. 벡터는 크기와 방향을 가진 수학적 객체로, 이를 더하면 새로운 벡터가 생성됩니다. 벡터의 덧셈은 물리학, 공학, 컴퓨터 과학 등 다양한 분...2025.05.05
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