"quartus2 계산기"의 검색결과 입니다.

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7483 2진 가산기 quartus 디지털시계 16bit alu 변압기 32bit cla vhdl 7483 bcd 가산기

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"quartus2 계산기" 검색결과 1-15 / 15건

판매자 표지

2022년 상반기 LG디스플레이 반도체/디스플레이 합격자소서

와 메모리 구현. 어셈블리어를 일부 구현해 ModelSim으로 기본적인 작동 확인2 FPGA와 Arduino를 이용한 "학점계산기"- 3개의 마이크로 컨트롤러 간의 IO 설계 ... . Arduino1로 입력을 받고 FPGA로 연산 후 Arduino2로 출력할 수 있도록 Verilog, C 코드 수정3 DE1-SoC FPGA 두더지 잡기"- Quartus ... +2 HDL, FPGA 설계- 디지털공학실험 B+, 디지털시스템설계 A-, IoT실험 A+, SoC설계 A+3 기타 심화 과목- 멀티미디어융합기술 A+, 마이크로프로세서응용 A

자기소개서 | 3페이지 | 3,000원 | 등록일 2022.11.08

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23년 상반기 한화파워시스템-전기제어 합격자소서

가 가진 역량을 발휘할 수 있을 것이라 판단해 지원했습니다.저는 학부 2,3,4학년 간 브레드보드, PSPICE, ModelSIM, Quartus 등의 설계 프로그램을 다루는 실험 ... 의 적합한 인재인지 말씀해주십시오.저는 학부 2학년 때 D사 주관 ICT 공모전에 참가하여 청각장애인을 위한 화재경보기 제작에 '도전' 했습니다.한 단계 더 나아간 아이디어 제시 ... ) 디지털 회로실험 A0설계도에 따라 Verilog를 이용해 4비트 계산기를 설계하고 검증했습니다. Full adder, Register, ALU 등의 단위블록을 조합하는 과정

자기소개서 | 4페이지 | 3,000원 | 등록일 2023.07.12

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롯데케미칼 합격자소서 (전기직)

design프로젝트로부터 헌신적인 태도의 중요성을 배웠습니다.“서로의 장단점을 보완하여 최고의 성과를 이루다”2인 1조로 Quartus 프로그램과 DE2 board를 이용 ... 하여 카운터와 계산기를 설계하는 프로젝트였습니다. 하지만, 해당 프로그램 대한 역량이 부족하여 프로젝트 진행에 어려움이 있었습니다. 팀원에게 코딩에 어려움을 겪고 있음을 솔직히 말하자 동료 ... 공학 수업을 통해 전력 시스템에 대한 기초 원리를 이해했습니다. 이후, 전력계통공학 수업에서 POWER WORD 프로그램을 이용하여 30모선 계통을 직접 설계하면서 전력 조류 계산

자기소개서 | 3페이지 | 4,000원 | 등록일 2024.03.24

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계산기(Calculator) 설계 (쿼터스 설계)

컴퓨터구조 보고서제목Calculator(계산기) 설계학과전자공학과학번2000000성명홍길동제출일소요시간① Calculator 구조, 정의외부 입력(switch)으로는 SA[4 ... 를 읽어 들인다.4번, 6번을 위한 출력은 T4, T6에서 나온다.가장 왼쪽에 있는 입력은 스위치로서 계산기의 “ = ” 에 해당된다.스위치를 누르게 되면 입력이 J-K플립플롭 ... 가 보수화되어 계산되고 결국 감산을 하게 되며 , T6 타이밍이 생성되지 않으면 B 의 입력이 그대로 통과되므로 가산기의 역할을 하게 된다. 그리고 각 연산의 결과는 MUX로 가게 된다

리포트 | 7페이지 | 2,000원 | 등록일 2015.01.27

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FINAL Project booth multiplier 와 carry Look ahead adder를 이용한 자판기 설계

와 timing을 비교함으로써 효율성을 알아보기로 했습니다.(2) 주제 선정 배경.Adder, multiplier는 각각 계산이나 구조에 따라서 여러 방식이 존재하고, 특성이 각기 다르 ... 한 실용적인 작품을 만들고자 자판기를 선택하게 되었습니다.(3) 구현내용4종류의 동전과 7가지의 상품이 있고 그 상품의 개수를 입력하면 곱하여 한꺼번에 계산이 되고 반환 버튼 ... FINAL Projectbooth multiplier 와 carry Look ahead adder를 이용한 자판기 설계1. 프로젝트 소개(1) 프로젝트 목표수업시간을 통해 배운

리포트 | 22페이지 | 5,000원 | 등록일 2018.04.04

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[디지털논리회로1] Ripple carry adder

# Problem statement본 문제는 Quartus를 이용해 32bit Ripple carry adder(RCA)를 Verilog로 구현하는 것이다. Adder(가산기 ... 며, 종류로는 반가산기와 전가산기가 있다. ripple carry adder를 구현하기 위해 사용한 전가산기(Full-Adder)는 3개의 디지털 입력(비트)을 받고, 2개의 디지털 ... )는 입력에 의해 출력이 결정되는 조합 논리 회로(combinational circuit)로 연산하는 것으로 기억 능력을 갖지 않는다. 말 그대로 2진수의 덧셈을 하는 논리 회로이

리포트 | 3페이지 | 2,000원 | 등록일 2015.03.16

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디지털실험 - 실험 4. 엔코더와 디코더 회로 예비

) Seven-segment 숫자표시기의 사용방법을 익힌다.- 이 론상태 혹은 명령들을 그에 대응하는 2진 정보로 변환하는 회로를 encoder(부호기)라고 하며, 반대로 주어진 2진 ... 나 전자계산기 등이 좋은 예이다. BCD-7 세그먼트 디코더는 BCD 숫자에 대해 4개의 입력과 선분을 선택하는데 사용되는 7개의 출력을 가지고 있으며, 디코더의 7개 출력은 표 4-1 ... ) 7-Segment 표시기로 표시할 수 있는 9개의 서로 다른 문자(숫자)는 무엇인가.- 숫자 : 0,1,2,3,4,5,6,7,8,9 로서 총 10개가 된다.- 문자 : 대문자

리포트 | 6페이지 | 1,500원 | 등록일 2017.04.02

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[디지털논리회로] 프로젝트 - 고속 동작 덧셈기 설계

디지털회로설계프로젝트 #21. 제목- 고속 동작 덧셈기 설계2. 설계 목적- 고속 동작 덧셈기의 설계를 통해 덧셈 과정에 있어서 carry의 역할을 이해하고 carry 처리 방법 ... 는 Complement number system(특히 2‘s complement)이다. SM 방식은 최상위 bit를 수의 부호를 표현하는데 사용하는 방법으로 표현은 간단하지만, 실제로 계산을 해보 ... 면 결과 값이 맞지 않아 계산 후에 보정을 해줘야하는 단점이 있다. Complement number system 중 2’s complement 방식은 간단하게 말하면 최상위 bit

리포트 | 19페이지 | 1,000원 | 등록일 2014.05.06

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7487,7483 을 이용한 4자리 2진 감가산 회로 설계 (진보01기)

-1 기의 동작을 이해한다2) Quartus tool을 이용하여 4자리 2진수의 가감산회로를 설계한다. 3. 설계 순서1) Quartus tool을 이용하여 진-보-0-1 기 ... 1. 명 제- Quartus tool을 이용하여 74H87와 74LS83 IC를 사용하여 4자리 2진수를 가산과 함께 감산 할 수 있는 회로를 설계한다.2. 목 적1) 진-보-0 ... 의 논리회로 설계2) 74H87과 74LS83 IC를 사용하여 4bit 가감산기 설계3) 가ㆍ감산기 Simulation 파형 동작확인4. 동작원리1) 진-보-0-1 기 하나의 논리회로

리포트 | 5페이지 | 2,500원 | 등록일 2011.12.03 | 수정일 2021.04.11

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[VerilogHDL] CLA를 이용한 16bit 산술논리장치(ALU) 설계

디지털설계고속가산기(CLA)를 활용한16bit 산술논리장치(ALU) 설계목 차설계개요개념설계회로구현결과검토■ 설계개요고속가산기를 활용하여 8가지 연산(덧셈, 뺄셈, +1증가, ... -1감소, 보수, 논리곱, 논리합, 전달)을 수행하는 산술논리장치;ALU(Arithmetic Logic Unit)를 제작한다.모든 모듈은 Quartus II를 이용 게이트 레벨 ... 논리합(A or B)Ai OR Bi00111전달(A)Ai00고속가산기(Carry Lookahead Adder, CLA)는 가수와 피가수의 덧셈에 의해 부분합(sum)을 구하는 동신

리포트 | 6페이지 | 3,500원 | 등록일 2015.08.02

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BCD 가산기 (7483, 전가산기 두가지방법) 쿼터스

1. 명 제Quartus tool을 이용하여 전가산기와 8421 가산기(BCD가산기)를 설계하라.2. 목 적1) 전가산기의 가산 원리를 이해하고 논리게이트를 사용하여 설계한다.2 ... ) BCD 가산기의 가산 원리를 이해하고 논리게이트를 사용하여 설계한다.3. 설계 순서1) Quartus tool을 이용하여 전가산기를 설계2) 전가산기 Simulation 파형 ... 동작확인2) 전가산기 회로를 이용하여 8421 가산기 설계3) BCD 가산기 Simulation 파형 동작확인4) 디버깅4. 동작원리1) 전가산기전가산기(Full Adder

리포트 | 14페이지 | 3,000원 | 등록일 2011.12.03 | 수정일 2021.04.11

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삼성전자 DMC 최종합격 자기소개서

하며, 새로운 기술을 배우며 즐기고 있습니다.장점[200자 이내]끈기 있게 노력하고 문제를 해결하는 능력이 있습니다.대학교 2학년 겨울방학 때, (주)히씽크 개발팀에서 근무 했 ... 을 잊지 못해 컴퓨터와 평생을 살아가기로 결심했습니다. 컴퓨터를 더 배우고 싶어 전자계산학과가 있는 고교로 진학을 결정하게 되었습니다. 그 시기에 프로그래밍과 컴퓨터 전반에 대한 지식 ... 을 배울 수 있었습니다. 대학에서는 Quartus, ARM, SIC/XE, JAVA, Oracle, ASP.NET 프로젝트를 수행하면서 하드웨어부터 응용프로그래밍 까지 배웠

자기소개서 | 2페이지 | 5,000원 | 등록일 2009.10.19

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Quartus 툴을 이용하여 verilog로 가감산기.간단한 ALU 구현하기

,Or,Not)OverviewProject DescriptionAdderSubtractor - 가감산기로서 셀렉트 시그널에 의해 출력값을 피드백하여 계산을 가능케도 한 설계입니다.오버 ... 여 얻을 수도 있다. 예를 들어 1010의 2의 보수를 구해 보면 0110 이다. 컴퓨터에서 가산기를 사용하여 뺄셈을 하기 위해 음수의 표현으로 자주 사용된다☞ Overflow ... 입니다.Compilation: Altera Quartus Version 7.2Simulation tool: Quartus Ⅱ simulatorDate : 2007.10.29

리포트 | 18페이지 | 9,000원 | 등록일 2007.12.09

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VHDL을 이용한 Digital clock project 기획안

를 추구하는 흐름에 맞추어 엔지니어로써 능력을 배양하게 된다.2. 본론① 목적- 카운터의 가장 일반적인 응용 제품 중에 하나는 시, 분, 초를 표시하는 디지털시계이다. 카운터 회로 ... 의 전체 블록 도를 보면 시간 표시를 위한 7세그먼트 표시기를 비롯하여 BCD-to-7 세그먼트 디코더, 12시간 표시기 디코더, modulo-N 카운터 등이 필요하다. modulo ... -N 카운터의 종류는 6진 카운터, 10진 카운터, 12진 카운터가 필요하다.- 시간을 계산하기 위해서 시계의 가장 기본적인 단위인 1초를 회로에서 얻을 수 있어야 한다. 크리스탈

리포트 | 3페이지 | 1,000원 | 등록일 2008.04.10

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Nand 연산을 이용한 Xor 게이트 구현과 간단한 Adder 구현

한 XOR GATE설계2. FULL-ADDER설계실험결과□ 실험과정1. Quartus Ⅱ 4.0 프로그램을 실행한다.2. New Project를 만들어, 디렉토리 경로와 프로젝트 ... , 각 가산기는 각각의 자리의 숫자를 의미한다. 따라서 여기서의 carry의 역할은 매우 중요한데, 1+1=0으로 얻어지지만 실제로는 2의 값을 갇는다. 따라서 이를 2진수로 표현 ... ;// input 설정output C;//output 설정wire W1,W2,W3;//중간 전달 매개체를 wire로 설정nand (W1,A,B);nand (W2,A,W1);nand

리포트 | 5페이지 | 1,000원 | 등록일 2009.05.07

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