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전전설2 통신공학실습 전전설3 lc발진기 ssb 실험 전전설

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"서울시립대전전컴" 검색결과 1-20 / 40건

서울시립대학교 통신공학실습 6주차 예비레포트

통신공학실습Preliminary Report6주차 : 믹서 회로 설계 및 제작Ⅱ1. Introduction (실험에 대한 소개)가. Purpose of this Lab저번 실험에서는 쵸퍼회로를 이용하여 샘플링과 반송파 주파수의 파라미터를 이해하고 실제 환경에서 BPF ..

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| 리포트 | 6페이지 | 2,000원 | 등록일 2019.07.29 | 수정일 2019.08.10

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서울시립대학교 통신공학실습 8주차 결과레포트

의 발진주파수를 얻은 발진기로 input을 넣어 2~3주 전에 실험하였던 mixing을 구현을 하였다. message의 파형을 함수발생기를 통하여 넣었고 구현판 발진주파수인 5.7

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| 리포트 | 10페이지 | 2,000원 | 등록일 2019.07.29 | 수정일 2019.08.10

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서울시립대학교 통신공학실습 11주차 예비레포트 파이널

전 오실로스코프 트리거를 통해 신호를 기다린다.4. 스위치 on 시키고 RC회로에 스탭을 입력 한다.5. 오실로스코프의 출력에서 시정수를 고려하여 중요한 포인터의 값을 읽는다.주파 ... 및 커패시터 로 이동하여 DC 전압을 생성한다. 이것은 RF 이득에 공급되어 바이어스를 변경함으로써 이득을 변경한다. 모든 게인 제어는 신호 검출 전에 이루어지지만 신호 검출 후

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| 리포트 | 6페이지 | 2,000원 | 등록일 2019.07.29 | 수정일 2019.08.10

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서울시립대학교 통신공학실습 3주차 결과레포트

하여 변조된 신호를 얻는다. 신호를 전송하기 전에 변조하는 것은 여러가지 이유가 있다. 그 중에는 하나의 전송 매체를 여러 사용자가 공유하도록 하는 것과 (다중 접속), 신호의 특성 ... 하여 메시지 신호를 복조하는 것AM DSB 신호 생성 및 검출을 완료 하였다.f=1500에 fc=1000으로 설정을 하였다. 차수는 4로 큰 차수로 설정을 하지 않았다. 이유는 바로 전 ... os2*pi*fc가 되었다. m(t)는 3개의 sin파형을 줄여서 표현을 하였다. 오른쪽의 사진은 실제 cos2*pi*fc와 product되어서 나온 파형이다. product되기전

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| 리포트 | 7페이지 | 2,000원 | 등록일 2019.07.29 | 수정일 2019.08.10

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서울시립대학교 통신공학실습 4주차 결과레포트

수가 높은 전자기파의 일종이므로 주파수상에서 모든 대역에 존재하는 신호는 색상으로 보면 white가 되기 때문이다. 그 반대로 특정 주파수 대역이 보이는 신호는 color

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| 리포트 | 15페이지 | 2,000원 | 등록일 2019.07.29 | 수정일 2019.08.10

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서울시립대학교 통신공학실습 9주차 예비레포트

통신공학실습Preliminary Report9주차 : oscillator Ⅲ1. Introduction (실험에 대한 소개)가. Purpose of this Labastable 모드에서의 555타이머의 작동원리에 대하여 이해를 하고 실제 555타이머를 이용해서 구형파를..

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| 리포트 | 8페이지 | 2,000원 | 등록일 2019.07.29 | 수정일 2019.08.10

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서울시립대학교 통신공학실습 10주차 예비레포트

에너지를 갖는 빛이 조사되면 전자는 전도대에 끌어올려지고 전자와 후에 남는 정공이 쌍이되어 형성된다. 이렇게 형성된 전자와 정공쌍이 공핍층에서 형성 되었을 경우는 바로 전계에의해

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| 리포트 | 6페이지 | 2,000원 | 등록일 2019.07.29 | 수정일 2019.08.10

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서울시립대학교 통신공학실습 7주차 예비레포트

통신공학실습Preliminary Report7주차 : oscillator1. Introduction (실험에 대한 소개)가. Purpose of this LabOscillator를 이용해서 opamp와 저항과 커패시턴스를 이용하여 sin 파형의 높은 주파수를 만드는 것..

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| 리포트 | 9페이지 | 2,000원 | 등록일 2019.07.29 | 수정일 2019.08.10

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서울시립대학교 통신공학실습 7주차 결과레포트

통신공학실습Result Report7주차 : oscillator1. Introduction (실험에 대한 소개)가. Purpose of this LabOscillator를 이용해서 opamp와 저항과 커패시턴스를 이용하여 sin 파형의 높은 주파수를 만드는 것이다. 윈..

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| 리포트 | 10페이지 | 2,000원 | 등록일 2019.07.29

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서울시립대학교 통신공학실습 8주차 예비레포트

통신공학실습Preliminary Report8주차 : oscillator Ⅱ1. Introduction (실험에 대한 소개)가. Purpose of this Lab윈브릿지 발진기로 R와 C의 조합으로 발진기를 만들었다면 이번에는 Colpitts 발진기를 사용하여 L과 ..

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서울시립대학교 통신공학실습 5주차 예비레포트

통신공학실습Preliminary Report5주차 : 믹서 회로 설계 및 제작Ⅰ1. Introduction (실험에 대한 소개)가. Purpose of this Lab시뮬레이션을 통해서 메시지 신호들을 DSB, SSB의 변조, 복조과정을 통하여 시뮬레이션을 실행하였다...

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| 리포트 | 7페이지 | 2,000원 | 등록일 2019.07.29 | 수정일 2019.08.10

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서울시립대학교 통신공학실습 5주차 결과레포트

for this LabBaseband기저대역이라는 말은 아주 낮은 저주파수를 의미한다. 추가로 통신에서는 데이터를 송신할 때 변조를 하는데 그 변조가 이루어지기 전에 데이터가 갖

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| 리포트 | 8페이지 | 2,000원 | 등록일 2019.07.29 | 수정일 2019.08.10

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서울시립대학교 통신공학실습 1주차 결과레포트

디지털 신호로 바꾸어 전송함에 있어 그 파형을 모두 전송할 필요는 없으며 아날로그 신호의 본래의 특성을 잃어버리지 않는 범위에서 필요한 정보만을 효율적으로 추출하여 전송해야 한다

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| 리포트 | 10페이지 | 2,000원 | 등록일 2019.07.29 | 수정일 2019.08.10

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서울시립대학교 통신공학실습 6주차 결과레포트

증폭이 RLC IF를 설계하여 전에 실험한 동일한 캐리어 주파수와 메시지 주파수를 인가를 하여도 오히려 더 높은 amplitude의 값과 원하는 파형을 얻을 수 있었다. (실제 결과

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| 리포트 | 7페이지 | 2,000원 | 등록일 2019.07.29

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서울시립대학교 통신공학실습 4주차 예비레포트

통신공학실습Preliminary Report4주차 : 믹서 회로 설계 및 제작Ⅰ1. Introduction (실험에 대한 소개)가. Essential Backgrounds for this LabChopper 제어초퍼 제어란 전류의 ON-OFF를 반복하는 것을 통해 직류..

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| 리포트 | 5페이지 | 2,000원 | 등록일 2019.07.29 | 수정일 2019.08.10

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서울시립대학교 통신공학실습 1주차 예비레포트

한 정보만을 효율적으로 추출하여 전송해야 한다. 표본화란 필요한 정보를 취하기 위해 음성 또는 영상과 같은 연속적인 아날로그 신호를 불연속적인 디지털 신호로 바꾸는 과정을 말

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| 리포트 | 6페이지 | 2,000원 | 등록일 2019.07.29 | 수정일 2019.08.10

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시립대 전전설2 [6주차 예비] 레포트

전자전기컴퓨터설계실험 ⅡPre-report6주차: Sequential Logic 11. Introduction (실험에 대한 소개)가. Purpose of this Lab인코더와 디코더의 원리를 이해하고 case문과 if와 else if들의 조건문에 대해서 이해를 하고..

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| 리포트 | 7페이지 | 2,000원 | 등록일 2019.07.29

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시립대 전전설2 [2주차 예비] 레포트

, OR, NOT 등을 사용한 간단한 회로에서는 더욱 하위에서의 자리올림을 처리하는 것이 불가능하므로 가산 회로로서는 불완전하여 이와 같은 회로를 반가산기라고 한다.전가산기전가산기는 반 ... 가산기와 더불어 컴퓨터 구조에 있어서 가장 중요한 요소 중 하나이다. 전가산기는 쉽게 말해서 가수,피가수에 올림수까지 더해져 세 가지 입력값을 가지는 조합회로라고 할 수 있다. 반 ... 가산기와 다른 점이라면 여기서는 올림수가 있기 떄문에 더욱 복잡한 출력값을 가질 수 있다는 점이다. 전가산기는 진리표로 보면 상당히 간단하지만 부울식을 유도하는 과정을 이해하는 것

Non-Ai HUMAN
| 리포트 | 8페이지 | 2,000원 | 등록일 2019.07.29

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시립대 전전설2 [3주차 결과] 레포트

전자전기컴퓨터설계실험 ⅡPost-report3주차: Logic Design using Verilog HDL1. Introduction (실험에 대한 소개)가. Purpose of this Lab이번 실험에서는 Verilog HDL 언어를 사용하여 논리회로를 설계하는 방..

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| 리포트 | 10페이지 | 2,000원 | 등록일 2019.07.29

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시립대 전전설2 [5주차 결과] 레포트

였다. 그전까지는 하나씩 입력을 통해서 코드의 길이가 길어졌다면 이번에는 반복문을 통해서 손쉽게 지속적으로 반복을 할수가 있었다. if문과 cass문중에 선태을 하자면 case문

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| 리포트 | 14페이지 | 2,000원 | 등록일 2019.07.29

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