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verilog 게임 디지털회로실험 실험12 멀티플렉서 전전설2 디지털집적회로 텀프로젝트 and or not 게이트 인코더 디코더

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방송통신대 - 2025 방송통신대 리포트 및 과제물 업데이트, 중간고사/기말고사자료
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"디지털논리회로실험" 검색결과 161-180 / 2,328건

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    실험1 실험(1) 프로젝트 디지털논리회로 도어락 설계
    실험(1)FINAL PROJECT 보고서소 속학 번이 름담당 교수 / 조교제 출 일 자1. PROJECT 개요한 학기동안 디지털논리회로 과목에서 배운 전반적인 이론들을(기본논리 ... 하면 3이되는 순한 B세그먼트에 전원이 들어오게 된다.LOSIG WORK‘S로 회로도 구현4. 고 찰1학기 동안 디지털논리회로 수업에서 습득한 이론으로 실험수업을 하면서 사용 ... 게이트, 카운터 jk플립플롭, d플립플롭 등을 )을 사용하여 실험했던 관련 이론들을 복합적으로 사용하여 수행하는 프로젝트이다.2. 관련이론 및 사용부품(1) 레귤레이터회로도에 5V
    리포트 | 12페이지 | 2,000원 | 등록일 2014.09.21
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    디지털로직실험 8장 논리 회로 간소화
    실험8논리회로 간소화● 실험 목표□ BCD 무효코드 검출기에 대한 진리표 작성.□ 카르노 맵(Karnaugh map)을 이용한 표현식의 간소화.□ 간소화된 표현식을 구현하는 회로 ... 이 되면 A값이 0으로만 입력이 되겠지만, 회로도를 보면 논리회로에 A값이 입력되는 경우가 아예 없다. 즉 B,C,D에 의해 결과 값이 결정되므로 실험을 임하는데에는 아무 문제가 없 ... 구성 밑 테스트.□ 회로 내의 ‘결함’에 대한 영향 예측● 사용 부품7400 NAND게이트LED저항:330Ω 1개, 1.0㏀ 4개4조 DIP스위치 1개● 실험 순서BCD 무효코드
    리포트 | 7페이지 | 3,000원 | 등록일 2013.06.22
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    서강대학교 디지털논리회로실험 텀프로젝트
    - 디지털논리회로실험 최종 보고서 ?Coffee House2013. 12. 17성 명소 속전자공학과학 년학 번지 도 교 수김영록 (인)0. 목차1. 서론2. 본론(1) Block ... 고 싶을 때 이 button을 사용할 수 있도록 하였다. 이제 구체적인 회로에 대한 기능설명은 아래의 본론에서 하도록 하겠다.2.본론(1) 전체 block diagram전체 ... block것은 전체 block diagram으로 만들기 전 회로에서 진행해주었다. 왼쪽의 입력을 받아주는 부분에는 외부 clock을 받아주기 위한 clock을 제외하고 나머지 것들은 모두
    리포트 | 36페이지 | 3,500원 | 등록일 2014.01.02
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    [디지털 논리회로 실험] 17장. MOD-N 카운터 결과레포트
    논리회로실험 A반결과17장MOD ? N 카운터5조이름학번실험일15.06.09제출일15.06.19브레드 보드 전압 : 4.91V실험에 사용된 기기 및 부품 : 오실로스코프, SN ... 이 됨을 알 수 있다.실험 17.3 74163을 이용한 MOD ? 5 카운터(1) IC 74163(4Bit 2진 업 카운터) 및 논리게이트를 이용한 MOD ? 5 카운터 회로의 회로도 ... 74LS163AN, HD74LS04P, 직류전원공급장치,HD74HC08P, HD74LS00P, 디지털 실험장치, 330L 저항실험 17.2 74163을 이용한 MOD ? 3 카운터
    리포트 | 3페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2022.10.13
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    [디지털 논리회로 실험] 7장. 가산기와 감산기 결과레포트
    논리회로실험 A반결과7장가산기와 감산기5조이름학번실험일15.04.07제출일15.04.14전원전압 4.89V실험 7.4 전가산기 회로다음 전가산기 회로를 결선하고, 출력 S와C ... =1, B=1이다.실험 7.8 전감산기 회로다음 전감산기 회로를 결선하고, 출력 D와B _{0}을 측정하여 표를 완성하라.입력출력(D)출력(B _{0})XYB측정값논리값측정값논리값 ... 다.THEREFORE A+B+CI=S+C0A=0,B=1,CI=1 이라면 0+1+1=10이므로 자리올림 BO=1, S=0이다.실험 7.5 반감산기 회로(XOR 사용)다음 반감산기 회로를 결선
    리포트 | 2페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2022.10.13
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    [디지털 논리회로 실험] 15장. 비동기식 카운터 예비레포트
    논리회로실험 A반예비 레포트15장비동기식 카운터5조이름학번실험일15.06.02제출일15.06.021. 이 장의 실험 목적에 대하여 기술하시오.- 비동기식 카운터의 회로구조와 동작 ... 플립플롭에서 Q출력을 설계한 회로이다.그레이코드 카운터그레이코드 카운터란 동시에 하나의 비트만 변하지 않게 코드를 할당해서 디코드시의 스태틱 하자드 (단시간의 스파이크장의 잡음 ... 의 플립플롭으로 이동해 가는 회로가 기본이 된다.링 카운터링 카운터란 특정 초기치를 플립플롭에 적재해서 플립플롭의 비트열을 클럭 펄스마다 이웃의 플립플롭으로 이동해 가는 것이다.존슨
    리포트 | 4페이지 | 1,000원 | 등록일 2016.01.14 | 수정일 2022.10.09
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    [디지털 논리회로 실험] 15장. 비동기식 카운터 결과레포트
    논리회로실험 A반결과 보고서15장비동기식 카운터5조이름결과실험일15.06.02제출일15.06.09측정 전압 ? 4.90V실험에 사용된 기기 및 부품 : 오실로스코프(CRO) 혹은 ... 전압계(DVM 등), 직류전원공급장치(DC Power Supply)디지털 실험 장치(Logic Lab), HD74LS08P, SN74LS76AN, HD74LS76AP실험15.2 ... 모서리마다 출력이 반전함을 알 수 있다.실험15.3 비동기식 10진 업 카운터(1) IC 7476(Dual JK Flop-Flop) 2개를 이용한 비동기식 10진 업 카운터회로
    리포트 | 3페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2022.10.13
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  • 자료 표지
    최신 디지털회로실험 실험5 추가논리게이트
    실험5. 추가 논리 게이트실험목표 :□ 실험을 통하여 OR와 XOR의 진리표 결정.□ 펄스 파형을 이용하여 OR와 XOR 논리게이트 테스트.□ OR와 XOR 게이트를 사용하여 4 ... 비트 2진수의 1의 보수 또는 2의 보수를 실행하는 회로 구성.□ 모의 실험용 결함에 대한 보수(complement) 회로의 고장 진단.데이터 및 관찰내용 :표5-2 표 5-3OR ... 하여 1의 보수와 2의 보수의 결과를 볼수 있었으나 , 회로를 구성하는데 있어서 복잡한 배선의 문제 때문에 결과값을 구하는데 어려움이 있었다.실험을 통하여 1의보수와 2의보수를 직접 눈
    리포트 | 3페이지 | 1,000원 | 등록일 2012.12.02
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    [디지털 논리회로 실험] 12장. 동기식 RS 플립플롭 예비레포트
    논리회로실험 A반예비12장비동기식 RS 플립플롭5조이름학번실험일15.05.12제출일15.05.121. 이 장의 실험 목적에 대하여 기술하시오.- 동기식 플립플롭의 동작원리를 이해 ... 한다.- 동기식 RS 플립플롭의 동작원리와 응용회로에 대해 이해한다.- 동기식 JK 플립플롭의 동작원리와 응용회로에 대해 이해한다.2. 비동기식 플립플롭과 동기식 플립플롭의 특징 ... 01?10셋 상태10?01리셋 상태11?XX불확실 상태- 상승모서리 RS 플립플롭 -위 그림과 표는 상승모서리 RS 플립플롭의 회로도, 심벌 및 진리표이다. 상승모서리 RS 플립
    리포트 | 3페이지 | 1,000원 | 등록일 2016.01.14 | 수정일 2022.10.13
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    [디지털 논리회로 실험] 8장. 보수와 병렬 가, 감산기 결과레포트
    논리회로실험 A반결과8장보수와 병렬 가?감산기5조이름학번실험일15.04.07제출일15.04.14전원전압 4.89V, SN74LS83실험 8.3 2의 보수를 이용한 4비트 2진 가 ... 이 일정한 저항값을 같지 않았기에 측정한 실험마다 모두 다른 결과 값을 갖게 되었다.- 참고문헌 -디지털 논리실험 본 교재 제 8장http://www.engineerclub.in/2014/04/vhdl-code-for-bcd-adder.html(이미지출처) ... _{2}A _{1} -B _{4}B _{3}B _{2}B _{1}이 된다.실험 8.4. BCD 가산기다음과 같이 BCD 가산기 회로를 결선하라. 또한 표에서 2진수 입력 값을 완성
    리포트 | 3페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2022.10.13
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    [디지털 논리회로 실험] 8장. 보수와 병렬 가, 감산기 예비레포트
    논리회로실험 A반예비8장보수와 병렬 가BULLET 감산기8조이름학번실험일15.04.07제출일15.04.070. 이 장의 실험목적에 대하여 기술하시오.- 1의 보수 및 2의 보수 ... 여 이해하고, 회로를 설계하여 동작을 확인한다.2. 보수를 이용한 감산 방법(1의 보수와 2의 보수)에 대하여 기술하시오.- 보수란?디지털 컴퓨터에서 보수는 어떤 기준이 되는 큰 수 ... 에 대하여 알아본다.- 보수에 의한 감산 방법에 대하여 이해한다.- 4비트 병렬 가BULLET 감산기에 대하여 이해하고, 회로를 설계하여 동작을 확인한다.- BCD 가산기에 대하
    리포트 | 4페이지 | 1,000원 | 등록일 2016.01.14 | 수정일 2022.10.13
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  • 판매자 표지 자료 표지
    [디지털 논리회로 실험] 12장. 동기식 RS 플립플롭 결과레포트
    논리회로실험 A반결과12장동기식 RS, JK 플립플롭5조이름학번실험일15.05.12제출일15.05.26실험에 사용된 기기 및 부품 : SN74LS74AN, 직류전원공급장치 ... , 디지털 실험장치, 전압계실험 12.2 7476 IC를 이용한 하강모서리 플립플롭의 동작(1) IC 7476(Dual JK Flip-Flop)을 실험하기 위한 회로도 이다. 회로도 ... ?111010?111101?111110?111101실험 12.3 7476 IC를 이용한 상승모서리 JK 플립플롭 구성(1) IC 7476(Dual JK Flip-Flop)를 이용
    리포트 | 2페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2022.10.13
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    서강대학교 디지털논리회로실험 8주차결과
    디지털논리회로실험실험8. Multiplier Design담당교수 : 김 영 록제 출 일 : 2013. 11. 12.(화)학 과 : 전자공학과성 명 :1. 실험 제목 ... Multiplier Design2. 실험 목적● 4 bit 곱셈기를 설계한다.● 설계한 곱셈기를 구현하여 동작을 확인한다.3. 실험 내용 및 결과분석① 구조설계● Multiplier의 구조 ... 는 Shift register이다. FPGA로 하는 실험이지만 가능한 한 TTL로 구현할 수 있게끔 하기 위하여 74194소자를 사용하였다. Clock과 Control signal
    리포트 | 5페이지 | 2,000원 | 등록일 2014.01.02
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    서강대학교 디지털논리회로실험 7주차결과
    디지털논리회로실험실험7. Finite State Machines담당교수 : 김 영 록제 출 일 : 2013. 11. 05.(화)학 과 : 전자공학과성 명 :1. 실험 제목 ... Finite State Machines2. 실험 목적● Finite State Machine (FSM) 회로를 설계하고 분석할 수 있는 능력을 갖춘다.● Mealy와 Moore State ... 사실을 바탕으로 실험에 사용된 회로가 0-1-0-1을 반복하는 일종의 Clock generator기능을 수행한다고 판단하였다. 마지막 실험인 Asynchronous counter의 다.
    리포트 | 8페이지 | 2,000원 | 등록일 2014.01.02
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    서강대학교 디지털논리회로실험 6주차결과
    디지털논리회로실험실험6.Flip-flops and ShiftRegisters담당교수 : 김 영 록제 출 일 : 2013. 10. 29 (화)학 과 : 전자공학과성 명 ... , JK flip-flop의 동작원리를 이해한다.3) Shift register의 동작원리를 이해한다.2. 실험 결과1. SR latch의 회로를 TTL로 구현하고 입력값을 조작하여 그 ... 을 주는 것이 실험의 기본인데, 디지털 실험 KIT를 사용하여 실험을 하다 보니 이정도 하면 되겠지 하는 안일한 생각이 이번 실험 과정을 매끄럽지 못하게 하였다. 그리고 SR
    리포트 | 5페이지 | 2,000원 | 등록일 2014.01.02
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    서강대학교 디지털논리회로실험 4주차결과
    디지털논리회로실험실험4. Mux, Demux, Comparator담당교수 : 김 영 록제 출 일 : 2013. 10. 08.(화)학 과 : 전자공학과성 명 :1. 실험 제목 ... Multiplexer, Demultiplexer and Comparator2. 실험 목적● Three-state 소자의 동작 원리와 활용 방법을 이해한다.● Multiplexer의 동작 ... 원리를 이해한다.● Exclusive-OR gate의 동작 원리와 비교기 구조를 이해한다.3. 실험 내용 및 결과분석① Tri-state buffer● Tri-state
    리포트 | 9페이지 | 2,000원 | 등록일 2014.01.02
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    서강대학교 디지털논리회로실험 3주차결과
    디지털논리회로실험실험3. Decoders and Encoders담당교수 : 김 영 록제 출 일 : 2013. 10. 01.(화)학 과 : 전자공학과성 명 :1. 실험 제목 ... 의 코드체계를 다른 코드체계로 변환하는 논리회로이다. 위의 회로에서는 n-bit binary code가 사용되는데, n개의 Input에 따른2 ^{n}가지의 output을 내보낼 수 ... Decoders and Encoders2. 실험 목적● 일반적인 binary decoder의 동작 원리를 이해한다.● 7-segment의 동작 원리를 이해한다.● Priority
    리포트 | 8페이지 | 2,000원 | 등록일 2014.01.02
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    서강대학교 디지털논리회로실험 9주차결과
    디지털논리회로실험실험9. Memory elements : ROM/RAM담당교수 : 김 영 록제 출 일 : 2013. 11. 19.(화)학 과 : 전자공학과성 명 :1. 실험 제목 ... . 실험 내용 및 결과분석① Step 1~7● 구현한 회로는 다음과 같다. 여기에서 중요하게 살펴봐야 할 신호는 DIP_SW[3..0]으로 입력해주는 FPGA[3..0]신호이다. 이 ... 하였다. 실제 7-segment에 ROM의 data를 읽어 display하는 실험을 진행하기 위해 구현한 회로는 다음과 같다. LED7-0까지의 data값을 hexa로 바꾸어주는 과정은 앞
    리포트 | 7페이지 | 2,000원 | 등록일 2014.01.02
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    서강대학교 디지털논리회로실험 5주차결과
    1. 실험 제목 Arithmetic comparator, Adder and ALU2. 실험 목적● Arithmetic comparator의 동작원리를 이해한다.● Half ... -adder 및 full-adder의 동작원리를 이해한다.● ALU (74x181) 소자의 기능을 이해한다.3. 실험 내용 및 결과분석① Arithmetic Comparator ... 하는 회로이다. 각 bit은 Logic으로 1 또는 0이기 때문에 세 bit에 대하여 일치하는지 여부를 판단하여야 한다. 이 때 세 bit가 일치해야만 A=B가 된다.XNOR
    리포트 | 9페이지 | 2,000원 | 등록일 2014.01.02
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    [디지털 논리회로 실험] 11장. 비동기식 RS 플립플롭 예비레포트
    논리회로실험 A반예비11장비동기식 RS 플립플롭5조이름학번실험일15.04.28제출일15.04.281. 이 장의 실험 목적에 대하여 기술하시오.- 플립플롭의 동작원리를 이해한다. ... - 비동기식 플립플롭과 동기식 플립플롭의 차이에 대해 이해한다.- 동기식 RS 플립플롭의 동작을 이해한다.2. 플립플롭의 기능에 대하여 기술하시오.디지털 논리회로는 조합논리회로 ... 와 순서논리회로로 크게 구분할 수 있다. 조합논리회로는 출력이 현재 입력 값에 의해서 결정된다. 이것은 조합논리회로의 특성이다. 즉, 회로의 출력은 입력이 인가되는 순서 및 입력이 인가
    리포트 | 3페이지 | 1,000원 | 등록일 2016.01.14 | 수정일 2022.10.09
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2025년 06월 20일 금요일
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