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voltage regulator 실험 홍익대 실험3 전전설2 전전설3 전자회로설계실습 고급전자회로실험 전자공학과 아날로그 오디오 앰프
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"전자회로실험및설계" 검색결과 1,761-1,780 / 4,905건

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    아날로그 및 디지털회로설계실습 실습7(논리함수와 게이트) 결과보고서
    는지 확인해보는 실험이다. NAND, NOR, XOR 회로를 구성해보고 진리표와 실험결과가 맞는지 확인해보았다.2.실험결과7-4. 설계 실습 내용 및 분석7-4-1설계한 논리게이트 ... 으로 생각된다.4.참고문헌1. 중앙대학교 전자전기공학부, “아날로그 및 디지털 회로 설계 실습”, 이론 10 ... 설계실습 7. 논리함수와 게이트요약 : 이번 실험은 논리 게이트 소자를 가지고 다른 논리 게이트 회로를 구성하고 값을 관찰하고 비교하는 실험이다. 먼저 AND, OR, NOT
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    | 리포트 | 8페이지 | 1,000원 | 등록일 2020.09.24
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    전자회로실습 3 결과 - AM 수신기
    전자회로실험Ⅱ 결과보고서소 속전자공학과조주제 5. AM 수신기1. 실험 결과a) 브레드보드 실험 결과⇒ 브레드 보드에 소자를 끼우고, 회로를 구성하여 실험을 하였습니다. 위 ... 었습니다.2. 비고 및 고찰이번 실험은 AM 수신기로서, CC 증폭기의 원리를 이해하고 주어진 규격 및 제한사항을 만족하는 Am 수신기를 설계하고 제작하여 실제로 안테나와 스피커 ... 았습니다.이번 실험에 사용된 수신기는 스트레이트 수신기입니다. 스트레이트 수신기란 안테나로 들어오는 수신 전파를 그대로 증폭, 검파하는 방식을 이용합니다. 이 수신기의 회로는 간단하지
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    | 리포트 | 2페이지 | 2,000원 | 등록일 2020.10.02
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    전기회로설계실습 실습5(Oscilloscope, Function Generator 사용방법) 결과보고서
    다.{} ^{2.}이와 같이 함수 발생기와 오실로스코프는 전자공학에서 기초적이고도 매우 중요한 장비들이며, 이를 다루는 방법을 익히는 것은 전기회로설계실습 뿐만 아니라 앞으로 모든 ... (square), 삼각파(triangular), 톱니파(sawtooth) 등이 있다. 보통 주기적 신호를 만들어 내는데 사용한다. 전자공학 실험에서 실험용 신호가 필요할 경우 유용 ... 실험 및 연구에 필수적이다. 이번 실험은 Function Generator와 Oscilloscope의 사용방법과 동작원리에 대해 이해하기 위한 실험이었다. 아래와 같은 결과를 얻
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    | 리포트 | 3페이지 | 1,000원 | 등록일 2020.09.07 | 수정일 2020.09.15
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    5주차-설계 결과 - Regulator 설계
    전자회로실험Ⅰ교수님조교님설계 프로젝트 1. Regulator 설계 - 결과보고서제출일 : 2016. 04. 01. 금요일실험제목 : Regulator 설계1. 시뮬레이션 ... 파형 (평균치 7.51V)4. 비고 및 고찰이번 설계 프로젝트는 제너다이오드를 이용하여 regulator를 만들고, 출력이 7.5V인 DC전압을 측정할 수 있도록 하는 프로젝트였 ... 습니다. 우선, 피스파이스 시뮬레이션을 이용하여 regulator회로를 커패시터 100uF, 저항 15kOMEGA , 2.2kOMEGA 소자로 구성하여 약 7.5V의 결과 값이 나오
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    | 리포트 | 2페이지 | 1,500원 | 등록일 2020.10.02
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    VHDL 설계 실습 보고서 (전감산기 설계)
    과는 반대로 아래 자리에서 발생하는 빌림수를 고려해야 한다. 또한 결과는 감산한 결과와 위에서 빌림수를 나타내야 한다. 전감산기를 설계하는 과정을 통해 조합논리회로를 VHDL로 설계 ... }} B _{i} + bar{X _{i}} Y _{i}3. 위의 논리식을 기본 게이트를 이용하여 전감산기의 회로도(schematic)를그려라.전감산기의schematic설계1. 전감산 ... VHDL 설계 실습 보고서 VHDL Lab_01일 시학 번이 름제 목전감산기 설계실습 목적전감산기는 한 자리 2진수 뺄셈을 할 때 전가산기에서 더한 결과 캐리가 발생하는 것
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    | 리포트 | 3페이지 | 1,000원 | 등록일 2020.05.29
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    논리회로실험 A+예비보고서 3 Adder & Subtracter
    동작 원리를 이해할 수 있다.2. 실험 이론1) 가산기(Adder)-이진수의 덧셈을 하는 논리 회로이며, 디지털 회로, 조합 회로의 하나이다.-전자계산기가 발명된 당시에는 진공관 ... 1. 실험 목적-Logic gate를 이용하여 가산기(Adder)와 감산기(Subtracter)를 구성할 수 있다.-디지털 시스템의 기본 요소인 가산기와 감산기의 기본 구조 및 ... 에 의해서 구성되었고 현재는 집적 회로로 설계되어 다양한 기능을 가진다.2) 반가산기(Half Adder)-이진수의 덧셈에서 맨 오른쪽 한자리의 연산 기능을 수행하며, 2개의 입력
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    | 리포트 | 7페이지 | 1,000원 | 등록일 2020.10.09
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    (완전 세세한 정리, 끝판왕) 시립대 전전설2 7주차 Lab07 예비 레포트 Sequential Logic 2, 전자전기컴퓨터설계실험2,
    전자전기컴퓨터공학부 설계 및 실험2Pre Lab-07Sequential Logic 2(Finite State Machine)실 험 날 짜학 번이 름목차1. 실험 목적 ... 실험에서도 순차회로에 대해서 학습한다. 그중 FSM인 Moore Machine 과 Mealy Machine을 Verilog HDL언어를 사용하여 설계하고 실험하여 state ... 는 내용들을 잘 숙지하고 실험을 해야 원하는 결과를 얻을 수 있으리라 예상된다.6. 참고 문헌전자전기컴퓨터설계실험2 교안PAGE \* MERGEFORMAT2
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    | 리포트 | 13페이지 | 2,000원 | 등록일 2020.07.27 | 수정일 2020.09.24
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    충북대학교 전자공학부 기초회로실험II 결과보고서 실험 20. 회로의 주파수 응답과 필터
    결과 보고서실험 19. 카운터 회로, 실험 20 회로의 주파수 응답과 필터과목명기초회로실험 II담당교수실험 조학과전자공학과학번이름실험 19. 실험 결과(10) 은 그림 회로 ... 를 클러겡 동기 시켜 확장시킨 회로이다. 입력 X 및 클럭의 신호 구성은 실험 2와 동일하다. 먼저 회로를 리셋 시키고 X=1로 하여 CBA=111 까지 중계수하라. X=0로 하고 감 ... 였다. 10번 실험은 회로도가 너무 복잡해 한 번의 실패 후 다시 구성하여 원하는 값을 얻었고, 11번은 한 번의 설계로 원하는 값을 얻었다. 이번 실험을 통하여 디지털 신호의 증가와 감소
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    | 리포트 | 5페이지 | 2,000원 | 등록일 2020.09.19
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    중앙대학교 전기회로설계실습 예비보고서 실습 4. Thevenin 등가회로 설계
    실험실습 4. Thevenin 등가회로 설계20XXXXXX전자전기공학부XXX(제출기한 : 2019. 10. 02)1. 목적Thevenin 등가회로를 설계, 제작, 측정하여 원본 ... kΩ,가변저항 : 20kΩ, 2W급 2개3. 설계실습 계획그림과 같이R_{ L}(330Ω)이 부하인 브리지회로의 Thevenin 등가회로를 이론 및 실험으로 구하고 비교하려 한다 ... }를 구하는 실험회로를 설계하고 실험절차를 설명하라. 전압계(DMM)의 위치를 명시하라.Load 저항을 제거하고 단자를 open 시킨다. 그 단자 양단의 전압이V _{Th}가 된다
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    | 리포트 | 5페이지 | 1,000원 | 등록일 2020.09.04
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    5주차 결과보고서 - 디지털 시스템 설계 및 실험 결과보고서
    디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 및 실험 결과보고서이름 :학번 :실험제목7-segment실험목표1. 4bit binary 를 8 ... bit BCD code 로 변환하는 컨버터를 라인 디코더를 이용해 설계2. BCD 입력을 7-segment로 출력하는 디지털 회로 설계3. Clock을 이용하여 7-Segment ... 를 순차적으로 표현하는 Controller 구현4. 구현된 결과물을 HBE-COMBO II-DLD 보드에 업로드하여 검증실험결과1. 8bits binary to BCDmodule
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    | 리포트 | 3페이지 | 1,000원 | 등록일 2020.07.29
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    [중앙대학교 ] 전자전기공학부 전기회로설계실습(A+) 결과레포트4
    는 얼마인가? 오차의 이유는 무엇인가?그림 1그림 1과 같이R _{L}이 부하인 브리지회로의 Thevenin 등가회로를 이론 및 실험으로 구하고 비교하려 한다. 그림 1을 간단히 ... 설계실습 4. Thevenin 등가회로 설계2018○○○○ ○○○요약: Thevenin의 정리를 이해하고 이를 이용하여 등가회로(equivalent circut)을 설계 ... 는 실제 구성한 브리지 회로와 실제 구성한 Thevenin 등가회로의 비교이다. 일단 전자의 경우 같은 회로를 구성하였기 때문에 실제로 구성한 회로와 이론적인 회로의 차이를 알기 위해
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    | 리포트 | 7페이지 | 1,000원 | 등록일 2020.09.11 | 수정일 2020.09.12
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    아주대학교 전자회로실험 설계1 C 측정 결과보고서
    하도록 도우며, 이 윤리 헌장을 준수하도록 지원한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학과제출일:과목명: 전자회로실험교수명:분 ... ](실제.1} TIMES 100`=`0.0182%이번 실험은 C를 측정하는 회로를 설계하고 실제 측정함으로써 설계한 회로가 만족하는 설계조건에 들어오는지 측정해보는 실험이었다. 먼저 C ... 설계의 목적인 캐패시터 측정함에 있어 성공적인 회로를 설계했다고 볼 수 있다.6. 고찰< 0.1mu F > < 0.05mu F> < 0.0039mu F>이번 2주 동안의 실험은 C
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    | 리포트 | 8페이지 | 1,500원 | 등록일 2020.06.06
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    6주차-실험16 결과 - RLC회로의 과도응답
    2015년도 제2학기기초회로실험Ⅱ기초회로실험Ⅱ실험16. RLC회로의 과도응답담당교수 : 교수님학 부 : 전자공학부학 번 :이 름 :실 험 조 :제 출 일 : 2015. 10 ... _{0} 이므로``과제동응답1설계 및 고찰자동차 점화장치는 전자기 구동회로를 이용한다. 에서 주어진 RLC구동회로는 6[V]스텝 입력을 가지며, 초기치 v(0)=2[V], i(0 ... . 07실험제목 : RLC회로의 과도응답실험(1) 의 회로 (R=1 [kOMEGA ], C=0.01 [uF], L=10 [mH])를 구성하고 신호발생기로부터 발생된 진폭이 5 [V]이고
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    | 리포트 | 3페이지 | 1,500원 | 등록일 2020.10.02
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    (완전 세세한 정리, 끝판왕) 시립대 전전설2 5주차 Lab05 예비 레포트 Combinational Logic 2, 전자전기컴퓨터설계실험2,
    전자전기컴퓨터공학부 설계 및 실험2Pre La-05Combinational Logic 1실 험 날 짜학 번이 름목차1. 실험 목적 ... , Mux/Demux인 조합회로를 Verilog HDL 언어를 사용하여 설계 및 실험하고자 한다.2. 배경 이론조합논리 회로조합논리 회로는 입력에 의해 출력이 결정되는 회로 ... 할 수 있을 것이라 예상한다.6. 참고 문헌디지털 디자인 교재전자전기컴퓨터설계실험 교안 Hyperlink "https://www.youtube.com/watch?v=giqb5
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    | 리포트 | 19페이지 | 2,000원 | 등록일 2020.07.27 | 수정일 2020.09.24
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    9주차-실험19 결과 - 카운터 회로
    2015년도 제2학기기초회로실험Ⅱ기초회로실험Ⅱ실험19. 카운터 회로담당교수 : 교수님학 부 : 전자공학부학 번 :이 름 :실 험 조 :제 출 일 : 2015. 11. 04실험제목 ... : 카운터 회로실험목적 : (1) 비동기식 카운터의 구조와 동작원리를 이해한다.(2) 동기 계수기의 구조와 동작을 이해한다.(3) 임의의 mod 동기 계수기를 설계하는 방법 ... 을 익힌다.(4) 증계수, 감계수 및 증/감계수의 논리를 이해한다.실험 (짝수 번 실험 시뮬레이션)(1) 의 회로를 구성하고, CLR을 low에서 high로 하고, CLK를 16번 인가
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    | 리포트 | 6페이지 | 1,500원 | 등록일 2020.10.02
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    서강대학교 기초전자공학실험 - 설계 1. 전압 증폭기 제작 결과 보고서
    제목 : (설계1.) 전압 증폭기 제작설계결과1) 설계 회로도2) PSpice simulation 결과3) 실제 설계4) 입력 신호 및 회로상의 소자 변경에 따른 변화 변화 ... 변화결과분석 및 토의이번 실험에서는 OP-Amp를 이용한 전압증폭기 회로를 브레드보드에 구현하고 입력전압에 따른 출력전압을 오실로스코프로 관찰하였다. 6주자 실험교재 그림1-3 ... , p. 147~163.서강대학교 전자공학과, 기초전자공학실험 [6주차], 서강대학교, 2017, p. 2~3.회로도 출처 : 서강대학교 기초전자공학실험 6주차 실험교재 그림 1-3
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    | 리포트 | 5페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24
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    전기회로설계실습 중앙대 4. Thevenin 등가회로 설계
    . Thevenin등가회로 설계전기회로설계실습(35792)1. 실험목적Thevenin 등가회로를 설계, 제작, 측정하여 원본 회로 및 이론값과 비교한다.2. 실습준비물-기본 장비 및 선 ... 저항 (20㏀, 2W급) 2개3. 설계실습 계획서그림과 같이R_{ L}이 부하인 브리지회로의 Thevenin 등가회로를 이론 및 실험으로 구하고 비교하려고 한다.3.1 브리지회로 ... } =0.985㎃3.3⒜Thevenin 등가회로를 실험적으로 구하려고 한다.V _{Th}를 구하는 실험회로를 설계하고 실험절차를 설명하라. 전압계(DMM)의 위치를 명시하라.오른쪽
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    | 리포트 | 5페이지 | 1,000원 | 등록일 2020.05.21
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    전자회로실험 예비보고서(1번 접합다이오드~ 10번 연산증폭기)
    예비보고서 예시전자회로 설계 및 실험 5. BJT 동작 - 대신호/소신호 동작(1)실험 목적(2)실험 이론BJT 증폭 회로의 대신호/소신호 동작다이오드회로에서처럼 BJT를 이용 ... 한 대부분의 아날로그 전기/전자회로들은 고정된 상수값의 바이어스(Bias) 신호에 작은 진폭의 시간에 따라 변하는 신호를 실어서 증폭, 전달하는 역할을 수행한다. 또한 다이오드 증폭 ... 회로와 마찬가지로 BJT 증폭회로의 분석에서도 바이어스 점(Bias point, 또는 동작점(Operation point)로 표현)에 비해 상대적으로 매우 작은 변동
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    | 리포트 | 3페이지 | 5,000원 | 등록일 2014.01.18 | 수정일 2018.07.01
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    설계실습 4. Thevenin등가회로 설계 결과보고서
    설계실습 4. Thevenin등가회로 설계결과 레포트전기회로 설계 및 실습 수요일 9,10,11,12교시조 조원실험날짜 월 일 제출날짜 월 일전자전기공학부요약: 이번 실험 ... 에서는 Thevenin 정리에 대해 알아볼 수 있는 Thevenin등가회로를 설계했다. 브리지 회로를 구성하여 의 전압과 전류값을 구하고 Thevenin등가회로를 실험적으로 구하기 위해 ... 으로 구성되어 있는 등가회로 대체시켜 계산이 간단한 회로를 만드는 정리이다. 이번실험에서는 이런 Thevenin정리를 회로에서 어떻게 활용하는지 알아보는 실험이다.설계실습 결과4.1
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    | 리포트 | 3페이지 | 1,000원 | 등록일 2020.05.07 | 수정일 2020.09.08
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    전자회로실습 2 결과 - 오디오 증폭
    전자회로실험Ⅱ 결과보고서소 속전자공학과조주제 2. 오디오 증폭1. 실험 결과a) 브레드보드 실험 결과⇒ 1kHz, 56mV의 정현파를 입력으로 주고 결과를 측정하였을 때 1kHz ... . 따라서 저주파 파단 주파수를 결정하는 가장 커패시터는 가장 작은 저항을 보는C_E가 됩니다.3. 비고 및 고찰A이번 실험은 오디오 증폭기를 설계하고 성능을 측정 해 보는 실험이 ... 실험실에서 기판과 연결한 스피커에서 큰 소리가 나는 것을 확인할 수 있었습니다.2. 고찰(1) R1, R2 저항값 변화에 따른 Q1 트랜지스터의 바이어스 및 입력저항의 변화에 대하
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    | 리포트 | 3페이지 | 2,000원 | 등록일 2020.10.02
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2025년 11월 22일 토요일
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