"논리회로및설계"의 검색결과 입니다.

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verilog pmos nmos FPGA 게임 실험12 멀티플렉서 4bitfulladder 두더지 잡기 센서입력처리 stopwatch 설계 논리회로 신호등

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"논리회로및설계" 검색결과 1,641-1,660 / 3,115건

전자전기컴퓨터설계실험1 3주차 Prelab Function Generator & Ocsilloscope

에서 높은 범위까지 가변될 수 있어서 회로시스템의 주파수 특성을 분석하는데 좋은 신호제공기가 된다. 디지털회로에서 입력파형으로 요구되는 TTL 및 CMOS 논리 신호도 제공 ... background for this Lab? Function Generator와 Oscilloscope의 구조와 역할 및 DUTFunction generator는 회로, 부품, 장치 등의 특성 ... 는 함수발생기로부터 발생되는 파형을 시각적으로 나타내어 관측을 용이하게 하는 역할을 한다. DUT는 회로 상에서 피관측되는 Device로써 RLC 및 Diode가 여기에 이용

리포트 | 13페이지 | 1,500원 | 등록일 2014.03.11 | 수정일 2014.03.17

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[건설기계 유압제어] 건설기계 전기공압제어 - 제어시스템의 구성, 압축공기, 서비스 유니트, 방향제어밸브, 체크밸브, 스위치와 릴레이, 공압 액츄에이터, 제어회로도

) 윤활기5. 방향제어밸브(1) 개요(2) 구성 및 기능6. 체크밸브 (Check Va|ve)(1) 개요(2) 구조 및기능7. 스위치와 릴레이(1) 개요(2) 기본 논리기능(3 ... ) 릴레이(relay)8. 공압-전기 신호변환기9. 공압 액츄에이터(1) 액츄에이터의 종류(2) 전기 액츄에어터의 기능10. 제어회로도(1) 개요(2) 작동 및 구성1. 전기 공압제어 ... ④ 구동부 및 최종제어부-실린더, 모터, 방향제어밸브제어계 및 신호처리도2) 회로를 구성할 경우에 시스템의 구성은 신호흐름과 일치하게 정렬해야 한다 .3) 그림 5-1 에서와 같이

리포트 | 19페이지 | 2,000원 | 등록일 2014.04.17

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동기식 카운터(결과)

하여라.비동기식 카운터는 동기식 카운터에 비해 회로구성은 간단하지만 지연시간이 발생하게 된다. 모든 클럭이 동시에 걸리는 것이 아니라 출력값이다음 회로에 계속 영향을 미치기 때문이 ... 다. 반면 동기식 카운터는 회로구성은 비동기식보다는 복잡하지만 모든 소자에 같은 클럭이 걸리므로 지연시간이 일어나지 않는다.(4) 7476 소자에서 CLR과 PR 단자의 역할은 무엇 ... 인가?CLR가 논리 1 레벨(PR 0 레벨)이면 출력도 논리 1 레벨로 설정된다.PR이 논리 1 레벨(CLR 1 레벨)이면 출력이 논리 0 레벨로 설정된다.(5) 진리표에서 X 표시

리포트 | 6페이지 | 2,000원 | 등록일 2012.10.11

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[서울대학교 회로이론 실험보고서] Node voltage analysis, mesh current analysis의 회로 분석 - resistive circuit의 분석 방법

의 출력 회선 중 그 숫자에 해당되는 번호에만 1을 내보내고 나머지는 모두 0을 내보내는 논리 회로. ② 어떤 규칙에 따라 부호화된 신호를 받아 그것을 대응하는 다른 부호로 된 신호 ... 는데, voltage buffer를 사용한 회로에서는 전압이 전압계의 저항에 관계없이 6V 가 걸린다.3. 논리 회로의 예 (가 모두 1 일 때 )논리 회로의 진리표 ... 가 흐르지 않고 전압이 걸리지 않게 된다.4. 실험 결과 및 토의실험 1. 각각의 노드와 루프의 전압, 전류를 측정하라.multi sim으로 돌려본 회로에서의 전압, 전류실험에서 측정

리포트 | 7페이지 | 1,500원 | 등록일 2013.02.17

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전자전기컴퓨터설계실험1 4주차 Postlab Function Generator & Oscilloscope & RLCDiode

까지 가변될 수 있어서 회로시스템의 주파수 특성을 분석하는데 좋은 신호제공기가 된다. 디지털회로에서 입력파형으로 요구되는 TTL 및 CMOS 논리 신호도 제공되므로 디지털회로 분석 ... this Lab? Function Generator와 Oscilloscope의 구조와 역할 및 DUTFunction generator는 회로, 부품, 장치 등의 특성을 검사하기 위해 ... 로부터 발생되는 파형을 시각적으로 나타내어 관측을 용이하게 하는 역할을 한다. DUT는 회로 상에서 피관측되는 Device로써 RLC 및 Diode가 여기에 이용된다.함수발생기

리포트 | 22페이지 | 1,500원 | 등록일 2014.03.11 | 수정일 2014.03.17

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레지스터 실험(예비)

실습교재http://junyy.tistory.com/37http://dirtybrain97.blog.me/30024317955? 실험 설계 및 방법(1) 실험 1 : 4비트 우측 ... 하고, 전체의 플립플롭이 reset되었는지 확인한다. CP를 순차적으로 인가해 가면서 지시된 점의 전압을 측정하여 표 12-3에 기입하고, 동작특성은 그림 12-7에 기록한다.① 논리회로 ... 을 확인한다. 전원을 OFF하고다음 순서대로 실험을 진행한다.② 논리회로 실험장치 또는 브레드보드에 IC를 부착하고, 단선을 사용하여5번 핀에 Vcc(+5[V]) 전원을 연결

리포트 | 6페이지 | 2,000원 | 등록일 2012.10.11

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논리회로실험10. 다멀티플렉서

논리회로실험 결과 보고서실험. 디멀티플렉서를 이용한 조합 논리회로▶ 실험 데이터 및 관찰▶ 실험결과 정리.디 멀티플렉서는 멀티플렉서와 반대로 하나의 출력선으로 들어오는 데이터 ... MY, SR이 불이들어온다. 나머지도 마찬가지이다.이실험을통해 DMUX가 선택입력에의해 출력값을 결정할 수 있고 결정된 출력값을 논리회로로 연결하면 여러 조합회로를 구성 할 수 있 ... 이 0일 때 불이 들어오므로 DMUX출력이 0인 값을 찾아 회로를 연결한다. 여기서 DMUX는 LOW출력으로 사용 되었기 때문에 신호등의 회로를 OR게이트 대신 NAND게이트를 사용

리포트 | 3페이지 | 1,000원 | 등록일 2012.09.08

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카운터 및 쉬프트레지스터 응용설계 예비제안서

설계 예비 제안서 Counter 응용 회로 설계1. 설계 목적2. 관련 이론3. 회로도4. 소요 부품5. 역할 분담 및 제작 일정목 차설계 목적count 및 shift ... 스위치 저항 등등제작 일정관련 자료 수집관련 이론 연구회로도 제작부품 구입회로 결선회로 Test 및 문제점 분석보고서 작성결과 PPT 발표역할 분담자료 수집부품 구입회로도 작성보고서 작성작품 제작결과 측정 및 분석감사합니다감사합니다{nameOfApplication=Show} ... register 및 게이트를 이용한 제작 푸시 스위치를 이용하여 1회 누름 시 10초간 동작 동작중에도 버튼 누르면 시간 누적관련 이론-7419210진 카운터 소자 Count up + c

리포트 | 11페이지 | 2,000원 | 등록일 2010.05.26

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[VHDL] 전감산기의 설계

와 위에서 빌림수를 나타내야 한다. 전감산기를 설계하는 과정을 통해 조합논리회로를 VHDL로 설계하는 방법을 공부한다. 또한 이 실습을 통해 if~end if 구문을 배울 수 있 ... 했다. 8가지의 입력은 앞에서 나온 진리표와 같은 순서이며, 각 경우에 진리표의 Di 및 B와 동일한 값이 출력되므로 전감산기가 제대로 설계된 것을 확인할 수 있다.2 ... . VHDL로 설계한 전감산기를 컴파일, 시뮬레이션하고 시뮬레이션 결과를 진리표와 비교한 후 아래에 보여라.Schematic 설계의 시뮬레이션과 같은 방식으로 시뮬레이션 하였다.Xi,Yi

리포트 | 6페이지 | 1,000원 | 등록일 2012.12.13

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실험4 예비보고서

측에 어떤 신호가 있는가를 탐지해서 표시해 주는 집적 회로 또는 논리소자로 구성된 회로를 통틀어 복호기라고 할 수 있다. N개의 입력에 대하여 출력은 2N개까지 있을 수 있 ... 다.② 회로구성 및 시뮬레이션 - 가장 간단한 2-to-4 Line만 해봄AB출 력00OUT101OUT210OUT311OUT4《Truth Table》★ 이 회로의 시뮬레이션 결과를 통해 ... 회로도의 Tri-state buffer와 inverter를 결선하여 2x1 Mux를 설계해 보시오.입 력출 력SD0D1OUT

리포트 | 10페이지 | 1,000원 | 등록일 2013.01.01

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[논실]예비11, 200820126, 안효중, 정주익, 4조

FPGA가 무엇인지 알아보고, 지금까지 했던 논리회로 실험을 FPGA를 이용해 구현하여 실제 동작을 확인하여 본다.[2] 주요 이론① VHDL을 이용한 FPGA 설계FPGA는 논리 ... ymbol을 이용하여 원하는 프로그램을 작성해서 FPGA 보드를 통해 브레드보드와의 연결로 회로를 구성한다. 이를 통해 지금까지 했던 논리회로 실험을 좀 더 고급화된 회로설계 기법 ... 윤리 헌장을 준수하도록 지원한다.위 IEEE 윤리헌장 정신에 입각하여 report를 작성하였음을 서약합니다.학 부: 전자공학부제출일: 2011.12.7과목명: 논리회로실험교수명

리포트 | 3페이지 | 1,000원 | 등록일 2012.02.29

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논리회로2

논리회로목차 수의 체계 부호의 코드화 기본 논리 회로 부울식의 간략화 조합 논리회로 순차 논리회로 설계1. 수의 체계 2 진수 (Binary Number) 디지털 시스템 : 2 ... 회로 구성 ]4. 부울식의 간략화 부울식의 간략화 부울대수의 기본법칙 및 정리에 의한 간략화 : 결합법칙 적용 : 정리 7 적용 : 간략화 된 식 간략화된 논리 회로4. 부울식 ... ) 자판기나 간판 , 계산기 등의 조건적 , 논리적 사고가 필요할 때 사용되어지는 논리회로 대표적 실용사례7. 설계 7 세그먼트 (seven segment)7-segment 설계7

리포트 | 73페이지 | 3,000원 | 등록일 2011.07.31

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디지털공학설계1조 - 최종발표보고서 1

디지털 공학 설계지난 발표 요약 과제 개요 재 결정된 회로도 회로도 분석 OR캐드로 그린 회로도 결론 및 고찰'엠프 회로도'를 이용해서 회로도를 분석하고자 하였지만 전자회로 ... 적 요소가 많다는 의견을 듣고, 조원들과 다시 토의함 전자회로적 논리요소보단 수업시간에 배워왔던 게이트가 많은 회로도로 대체하자는 의견을 수렴하여 회로도 변경논리 게이트의 입력 값 ... 다. 더 나아가 회로도를 보고 분석 할 수 있는 능력을 기른다.수업시간 이론으로 배웠던 지식을 바탕으로 실제 회로도에서 논리 게이트가 어떻게 작용하는 지를 이해할 수 있다. OR캐드

리포트 | 15페이지 | 1,000원 | 등록일 2012.03.29

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[Flowrian] 데이터 정렬 회로의 Verilog 설계 및 시뮬레이션 검증

시뮬레이션 검증- 데이터 정렬 회로 : 구조수준 설계 및 시뮬레이션 검증Verilog 언어를 이용하여 디지털 논리회로의 구조 설계를 배우려는 분에게 도움이 된다. ... 4개의 8비트 정수를 정렬하는 본 문서의 회로는 5개의 모듈로 구성된다.- 8 비트 멀티플렉서 : RT 수준 Verilog 설계 및 시뮬레이션 검증- 1 비트 비교기 ... : Primitive Logic Gate로 구조수준 설계 및 시뮬레이션 검증- 8 비트 비교기 : 구조수준 설계 및 시뮬레이션 검증- 최소/최대값 탐지 회로 : 구조수준 설계 및

리포트 | 23페이지 | 2,000원 | 등록일 2011.09.12

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05가산기 예비

가산기1. 목적가. 반가산기와 전가산기의 원리를 이해한다.나. 반가산기와 전가산기의 설계를 통해 조합논리회로의 설계방법을 공부한다.2. 이론가. 반가산기 (Half Adder)1 ... 를 사용하여 전가산기 회로를 구성해보고 진리표를 통해 동작을 확인하 라.ABCiCSLLLLLLHLHHLLHHHHLHLLLHLHHLHLHLHHHH4. 실험 기기 및 부품74x ... 이 논리식을 회로로 표현하면 그림 6-1(a)와 같이 되고, 그림 6-1(b)는 이 반가산기의 기호를 나타내고 있다.(b)기호(a)회로도[그림 6-1] 반가산기 회로나. 전가산기

리포트 | 4페이지 | 1,000원 | 등록일 2012.11.06

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아주대학교 논리회로실험 실험7 예비보고서

된 비트에 대한 모든 출력을 가지고 있어, 다른 회로에서 사용할 수 있다. 이러한 시프트 레지스터는 직렬-병렬 변환을 수행하기 위하여 사용될 수 있다.역으로 병렬-입력, 직렬-출력 ... -병렬 변환은 ‘데이터를 처리하는’ 응용이지만 시프트 레지스터는 ‘데이터를 처리하지 않는’응용에도 사용할 수 있다. 시프트 레지스터를 조합 논리와 조합하여 순환 형태의 상태도를 가진 ... 상태 기계를 만들 수 있다. 이러한 회로를 시프트 레지스터 카운터(shift-register counter)라 부른다. 시프트 레지스터카운터가 이진 카운터와 달리 이진 순서로 증감

리포트 | 7페이지 | 1,000원 | 등록일 2014.02.28 | 수정일 2014.03.02

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plc 이론

를 문서화. - 제어반 내부의 온도 점검 ( 특히 하계시 )유지, 보수PLC 설계 Step1. 그래픽 로더 프로그램 실행 2. 프로그램 편집 및 수정 3. PLC를 프로그램 모드로 w} ... PLC : Programmable Logic Controller※ 릴레이 제어반의 문제점 - 실 배선이 필요하여 회로구성이 복잡함 - 릴레이 접점의 접촉 신뢰성이 취약함 - 제어 ... )  Modicon, Allen-Bradley 등 개발PLC 가격의 하향화에 따라 산업전반에 걸쳐 사용되고 있음1. 프로그램 작성 및 변경이 용이하여 현장에서도 쉽게 동작 시퀀스를 작성, 변경

리포트 | 28페이지 | 2,000원 | 등록일 2014.08.21 | 수정일 2014.09.19

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디지털 시스템 실험

며 논리식은이다.입력출력ABC0010101001106. XOR게이트XOR게이트는 논리 회로의 조합으로 만들 수 있지만, 많은 응용회로에서 중요하게 사용되므로 이들 게이트는 자신의 유일 ... 과목명디지털 시스템 실험제출일시2011.09.14분 반1담당교수전 공전자정보공학이 름제 목기본 논리 게이트학습목표·기본 논리 게이트인 AND, OR, NOT, BUFFER 게이트 ... 를 알아본다.·기본 게이트의 확장으로 NAND, NOR, XOR, XNOR 게이트를 알아본다.·MAX-PLUS2프로그램을 이용하여 게이트의 특성 및 타이밍도를 나타낸다.실 험 내

리포트 | 5페이지 | 1,000원 | 등록일 2012.07.18

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아주대 논회실 실험5 예비보고서.hwp

도 하며, n비트의 2진수를 받아서2 ^{n}개의 10진수 또는 다른 부호체계로 바꿔주는 논리회로를 말한다. 일반적으로 디코더는 n개의 입력선과 최대2 ^{n}개의 출력선을 가지 ... 으면 low 없으면 high를 넣어준다.4. 실험과정 및 예상 결과1) 첫 번째 실험 Decorder.다음처럼 회로를 구상하고, 얻게 될 TruthTable을 구해보면, 다음과 같을 것이 ... 은 active low를 나타내는데, NAND게이트가 빠르므로 보통 오른쪽 회로처럼 구현을 한다.2) Encoder(부호기)10선/4선 (10진수/BCD) 인코더의 진리표10진수BCD

리포트 | 4페이지 | 1,000원 | 등록일 2014.03.10 | 수정일 2014.03.21

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디지털실험 - Positive edge triggered master-slave D flip flop 설계 결과레포트

◈ Positive edge triggered master-slave D flip flop-설계결과-2조 2008065321권태영1. 설계 조건, 목적 및 과정- Positive ... .Positive edge triggered master-slave D flip flop의 Digital 회로도를 구현.(진리표 및 time analysis 작성)3.TTL chip ... 을 이용한 회로도를 설계한다.4. 구성된 회로도가 진리표 대로 작동이 되는지 입력에 따른 결과값을 예상하여 본다.5. 실험을 통해 동작 결과를 검증해 본다.6. 실험 결과를 바탕

리포트 | 5페이지 | 1,000원 | 등록일 2012.03.09

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