"논리회로실습"의 검색결과 입니다.

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성결대 논리회로 아날로그 전전설2 래치와 플립플롭 4bit adder 결과 FPGA 사칙연산 디지털 설계 4bit adder 회로 설계 논리게이트

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"논리회로실습" 검색결과 681-700 / 1,033건

불 대수와 드모르간 실험 레포트

실험결과보고서- 실험의 목적 및 실습 내용·논리회로를 구성하여 실험적으로 불 대수의 여러 법칙을 증명한다.·2가지 입력 변수를 갖는 회로의 진리표를 완성하고 수학적으로 등가인지 ... · 7400 IC핀 1개· 점퍼선1. 7402 IC 핀 배치도를 참조하여 NOR 게이트 4개중 2개를 선정하여 아래 회로를 구성한다. 7402의 7번 핀은 접지하고, 14번 핀은 ... 개의 비교/분석불대수와 드모르간 법칙을 이용하여 회로도의 입출력 관계를 정리한 결과로 이끌어낸 진리표와 실험결과를 토대로 이끌어낸 진리표가 동일함을 확인할 수 있었다.실험 결과

리포트 | 11페이지 | 2,000원 | 등록일 2014.06.27

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정신간호학 조현병 케이스 case study

Case Study(사례 연구)과 목 명정신간호학실습Ⅰ주 제조현병(schizophrenia)실습 기관병 동기수(실습기간)학 번성 명Ⅰ. 서론 ... 자체의 도파민 수용체들을 가지고 있지만, 그것은 뇌의 다른 회로들에서 도파민을 조절한다. 또한, 도파민은 청소년기 후반에 뇌에서 높은 수준으로 존재하며, 그때 조현병이 대개 처음 ... 이나 행동이 망상체계의 내용에 잘 부합되나 내용은 고정되고 체계화되어 일관성있는 주제로 구성된다.조현병 대상자의 망상보다 매우 체계적이며 논리적인 특징이 있고 대상자는 대인관계

리포트 | 20페이지 | 2,500원 | 등록일 2015.06.19

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논리회로실험 - 제 5장 ALU 코드를 KIT에 올리는 실험 결과보고서

과 목 : 논리회로설계과 제 명 : 결과보고서 5담당교수 : 김종태학 과 : 전기전자공학부학 년 : 3학 번 :이 름 :제 출 일 : 2013 / 5 / 81 ... 다.값을 출력하는 방법 중 하나인 7 segment가 나타나는 부분이다.(2)어떻게 이 회로를 구성할 것인가1) VHDL 코드를 구성하는 기본 설정(1)설계 사항2)-실습시간 ... 이론으로가 아니라 실제로 이 회로가 돌아가는지를 확인해보는 실험이다.2. Design(1)어떠한 회로를 설계할 것인가 1)1)ALU-4bit State(상태) 별 동작-ALU

리포트 | 17페이지 | 1,000원 | 등록일 2014.08.15

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Lab#5]플립플롭 래치 IC 실습

, 성명 : 신 호 영 학번 : 200810211 제출마감: 2011. 5. 20(금)[Lab.#5]Flip Flop, 4-bit Latch 실습[1]학습목표a)순차 논리회로의 개념 ... -type FFb)각 IC의 논리회로도, 핀 배치와 특성 등을 이해하고 실습에 활용하도록 이해하자TTL 74LS74, 74LS75, 74LS76① TTL 74LS74 : Dual D ... SetResetHoldSetHoldReset실습 결과 : 7400게이트를 이용하여 만든 플립플롭 회로로 각 Pulse Input을 Set, Reset, Hold의 3가지논리의 Output

리포트 | 17페이지 | 1,000원 | 등록일 2011.06.02

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자동제어실험2 (결과레포트) - PLC - 전기를 이용한 실험

(Lamp Control)기본회로스위치 작동스위치를 누르면 전기가 통해서 램프에 불이들어온다.(2) 2.5.2. 논리제어 ( Pilot Control )기본회로스위치 작동스위치 1과 ... 가 들어가기 때문에 조금더 회로가 복잡해졌다. 논리제어의 경우 그냥 단순히 전기회로와 원리가 같아서 이해가 쉬웠지만 솔레노이드 벨브와 릴레이가 나오기 시작하면서 조금 복잡해지기 시작 ... 유지회로기본회로1스위치 ST가 닫히면 K1이 닫혀서 Y1밸브가 동작한다.2Y1밸브가 동작하면 실린더가 전진하고 센서로 S2를 읽는다.3S2를 읽으면 스위치 s2브레이크가 동작해서 s

리포트 | 8페이지 | 1,500원 | 등록일 2012.11.28

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[7주차] FSM

과 목 : 논리회로설계실험과 제 명 : FSM 설계담당교수 : 정일섭 교수님학 과 : 전자전기공학과학 년 : 3학년이 름 :제 출 일 :논리회로설계실험 - 4차 실습 과제7조 ... , 상태에 의해서 출력값이 결정된다면 Moore Machine이 된다. 회로의 구조를 보게 되면 현재상태와 다음상태를 결정하는 조합논리회로와 상태를 저장할 수 있는 flip-flop ... Moore machine?위의 회로도는 Mealy Machine의 경우를 표현하고 있다. Next_State를 결정하는 조합논리회로에 의해서 next_state가 결정이 되고 그렇게

리포트 | 9페이지 | 2,000원 | 등록일 2012.06.30

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RS와D플립플롭실험(예비)

: 논리회로의 간략화[3주] 실험5: 가산기, 감산기 회로 실험[4주] 실험6: RS와 D플립플록 실험[5주] 실험7: JK와 T플립플록 실험[6주] 실험8: 동기식 카운터[7주 ... 와 동작원리를 이해한다.? 실험관련 이론디지털 논리회로는 조합논리회로와 순서논리회로로 크게 나눌 수 있다. 조합논리회로는 출력이 현재 입력등의 조합에 의해서만 결정되는 논리회로이고 ... , 순서논리회로는 출력이 현재의 입력들의 조합뿐만 아니라 현재의 출력상태에 의해서도 결정되는 논리회로이다. 2가지 논리회로의 가장 큰 차이점은 현재의 출력상태가 논리회로의 출력

리포트 | 11페이지 | 2,000원 | 등록일 2012.10.11 | 수정일 2013.11.18

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보고서작성법 (실무위주의 보고서를 작성하는 방법)

뇌의 기능 사고력 향상시키려면 재미있다 , 좋다 평가를 받아야 한다 무엇인가를 좋아하는 힘을 기르는 것 fun뇌의 연상회로 단기기억 반복 강렬한 장기기억 95% 무의식 예 연인 ... 에는 관점을 다시 볼 수 있는 스킬이 있다고 해 / how 진짜 ? 세미나에 참여해서 실습하고 교육받고 나면 세상의 관점도 다르게 볼 수 있는 힘이 생긴데 ~~ 신기하지 ? if ... 다 작성법 숙달 프리젠테이션 능력 향상 O 월 O 일 : 기획력 O 월 O 일 : 보고서 작성법 O 월 O 일 : 프리젠테이션 실습 15 명 - 기획력 능력에 대한 상사의 기대

리포트 | 77페이지 | 3,500원 | 등록일 2015.07.16 | 수정일 2015.07.20

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정신간호학 실습 과제 (정신분열병, 정신분열증)

과 목 : 노인간호학담당교수 : 최영순 교수님학 과 : 간호학과 4-B반학 번 : 20621111이 름 : 채 지 은제 출 일 : 2010. 10. 29정신간호실습case s ... 을 삐죽이을 취하지 않는데 이 때 환자가 식사까지 거부하면 사망하게 된다.일반적으로 긴장증상, 혼미와 흥분 모두 유체회로 운동장애처럼 수면 중에는 사라진다. 과거에 급성 섬망이라 하 ... , 무논리증 또는 무욕증 등의 음성증상B. 사회적, 직업적 기능부전- 발병 이후 상당기간 동안 직업이나 대인관계, 또는 자기 관리와 같은 하나 또는 그 이상의 주요 생활 영역의 기능

리포트 | 18페이지 | 1,000원 | 등록일 2017.12.29 | 수정일 2021.03.20

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[VHDL] 전감산기의 설계

와 위에서 빌림수를 나타내야 한다. 전감산기를 설계하는 과정을 통해 조합논리회로를 VHDL로 설계하는 방법을 공부한다. 또한 이 실습을 통해 if~end if 구문을 배울 수 있 ... 실습 목적전감산기의 한 자리 2진수 뺄셈을 할 때 전가산기에서 더한 결과 캐리가 발생하는 것과는반대로 아래 자리에서 발생하는 빌림수를 고려해야 한다. 또한 결과는 감산한 결과

리포트 | 6페이지 | 1,000원 | 등록일 2012.12.13

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논리회로의 간략화(예비,결과)

? 실험 제목 : 논리회로의 간략화? 실험 일자 : 2011년 9월 6일 화요일? 실험 목적- 부울대수 및 카르노도를 이용하여 논리회로를 간략화한다.- 실험을 통해 부울대수 ... 와 카르노도의 정확성을 검증한다.? 실험관련 이론- 부울대수의 정리부울 대수의 기본 정리와 법칙들은 논리식을 계산하고 논리회로를 간략화시키는 데 사용된다. 또한 복잡한 논리식들도 부울 ... 대수식을 이용하여유도된 것이기 때문에 논리회로의 해석에 대단히 중요하다. 부울대수는교환법칙, 결합법칙, 분배법칙 등의 기본 법칙들은 통산적인 대수학에서의 법칙들과 거의 같다.- 참고

리포트 | 13페이지 | 2,000원 | 등록일 2012.10.11 | 수정일 2013.11.18

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가산기와디코더

디지털공학 및 실습평가가산기와 디코더 회로2012 . 10 . 12일1. 실험제목 : 가산기와 디코더 회로2. 실험목적 :-가산기의 구성방법과 동작원리를 이해하고 병렬가산기 ... 하다.1) 반가산기2진 가산의 기본 연산을 수행하는 논리회로로써 2개의 입력 A, B를 가산 하여 캐리(C)와 합(SUM)를 출력한다.ABCS0*************10그림은 반가산 ... 개의 출력단자중 하나의 출력단자에 HIGH(또는 LOW)를 출력하는 논리회로이다. N비트의 입력은 각각 0또는 1의 값을 가지므로 2N개의 입력조합 또는 코드가 가능하다. 입력코드

리포트 | 10페이지 | 1,000원 | 등록일 2012.12.04

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타이머와 PWM 예비보고서

실험(4)예비보고서(7장 타이머와 PWM)1. 목 적Pulse를 이해하고 Pulse Width Modulation의 주기를 이용한 타이머와 카운터를 제작하고 LED밝기조절 실습 ... 를 모두 설정하여 사용하는 경우, PB7의 비트 값에 따라 OC1C와 OC2의 출력 신호를 논리적으로 변조하여 AND하거나 OR 시킨 신호를 출력한다. 타이머/카운터 설정은 다음 ... 잡음 제거 회로)):입력 캡쳐 단자(ICPn : Input Capture Pin)로 입력되는 캡쳐 신호를 위한 잡음 제거 회로(noisecanceler)의 동작 여부를 결정, 1

리포트 | 17페이지 | 1,000원 | 등록일 2015.11.09

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VHDL을 이용한 순차회로 설계

Introduction 10주차 실습이었던 VHDL을 이용한 순차회로 설계는 3가지 쉬프트, circular shift, logicla shift, arithmetic shift ... 를 작동하게 하는 회로였다. 이 3가지의 쉬프트를 구분하기 위해 mode와 direction을 변수로 두고 각각의 조합으로 총 6가지를 설계하였다. 쉬프트의 종류에 대해 알아보 ... -Flop과 비슷하고, Asynchronous reset은 클락과 상관이 없으므로 Latch와 비슷하다. 이번 실습에서는 이 Asynchronous reset(비동기)를 사용

리포트 | 16페이지 | 2,000원 | 등록일 2014.11.04 | 수정일 2022.11.04

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레지스터 실험(결과)

을 사용하여 연결하였지 때문에 다 연결했을 경우에는 엄청 복잡해 보인다. 칩이 4개 있었다면 아마 사진보다는 좀 더 직관적인 회로 구성이 가능할 것이다.이번에 실습한 실험 1과 실험 ... 를 이용한 카운터 회로를 구성하고 이론적으로 계산한 다음 실험한 결과와 일치하는지 확인하고, 타이밍도와 비교하여라.(2) 실험에서 JK-FF 7476을 이용한 카운터 회로를 구성하고 이론 ... 이 동시에 일어난다. 따라서 좌우로 이동하는 것 같지는 않다. 하지만 모두 시프트 레지스터로 불린다.(6) 레지스터의 구성 회로에서 다음 중 어느 회로를 널리 사용

리포트 | 5페이지 | 2,000원 | 등록일 2012.10.11

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7-segment 구동실습 보고서

었다. 예비보고서를 통해 예습했던 사항이라 쉽게 받아들일 수 있었다. 그리고 브레드판에직접 논리회로를 구성하여 작동시켜 보는 실습을 수행했다. 그냥 논리회로만을 봤을 때는 금방만들 수 ... 시간에 직접 설명을 들어서 인지 실험을 하는도중이나 지금이나 논리식을 만들고, 논리회로를 구성하는 것을 잘 이해할 수 있었다.3. 참고문헌디지털 논리회로 : 이론, 실습, 시뮬레이션 / 임석구 / 한빛미디어 / 2009 ... 익힌 불대수와 카르노맵을 활용하여 스위치 2개와 논리소자들을 이용하는 7-Segment를 0~3까지 제어하는 회로를 만들어 보고, 3개의 스위치로 0~7까지 제어할 수 있는 논리

리포트 | 5페이지 | 1,000원 | 등록일 2011.01.24

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[9주차] DIGITAL CLOCK

과 목 : 논리회로설계실험과 제 명 : Digital Clock 설계담당교수 : 정일섭 교수님학 과 : 전자전기공학과학 년 : 3학년이 름 :제 출 일 :논리회로설계실험 ... - Digital Clock7조 ( 유광위 / 박석호 )0. PurposeFPGA회로 설계 검증용 장비인 RoV-Lab을 이용하여, 기본적인 DIGITAL CLOCK을 구현한다. 이 ... 한다.1. Back Ground. RoV-Lab 3000그림 . Rov-Lab 3000LoV-Lab 3000은 회로 구현 및 실제 동작 테스트에 이르는 전과정에 필요한 Kit와 각

리포트 | 13페이지 | 2,000원 | 등록일 2012.06.30

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설계실습 10. 4-bit Adder 회로 설계

11. 12설계실습 10. 4-bit Adder 회로 설계아날로그 및 디지털 회로1목 차1부울 대수2디지털 시스템34-bit Adder (74LS83)4설계실습 계획2부울 대수부 ... 와 해석에 응용3디지털 시스템부울 대수의 사용디지털 시스템에서의 전압레벨 표현 5V :2진 숫자(binary digit) 2V 1, 0으로 표현 0.8V 0V 부울 대수는 논리회로 ... 의 입력 및 출력의 상관관계를 표현하는 방법. 입력의 논리 레벨에 따라 출력 결정10Undefined44-bit Adder (74LS83)4-bit Adder (74LS83)설계실습

리포트 | 13페이지 | 1,000원 | 등록일 2010.11.12

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설계실습 8. 논리함수와 게이트 결과

은 결과를 출력하는 논리회로를 설계해보았고 그 결과 같은 결과가 나타남을 알 수 있었다.(2) 설계사양에 따라 설계실습계획서에서 설계한 회로가 실제 구현되었을 때에도 설계사양을 만족 ... 이유는 무엇인지 기술하라.- 설계 실습이 잘 되었다. 이번 실험은 논리회로를 구성하여 그 출력을 확인하는 것으로 특별히 영향을 끼치는 외부 요인이 거의 없어 잘 되었다.(4) 무엇을 느꼈는가? 이 설계 실습을 동하여 무엇을 배웠는가? ... 설계실습 8. 논리함수와 게이트1. 설계실습 내용 및 분석(1) Low(0) 값, High(1) 값, Vcc를 각각 0V, 5V, 5V로 설정한다. AND, OR, NOT 게이트

리포트 | 3페이지 | 1,500원 | 등록일 2010.11.12

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설계실습 10. 4-bit Adder 회로 설계 결과

었다고 생각하는가? 잘 되었다면 그 근거는 무엇이며 잘 안되었다면 그 이유는 무엇인지 기술하라.- 설계 실습이 잘 되었다. 이번 실험은 특별한 어려움 없이 한 번에 논리회로를 구성 ... 설계실습 10. 4-bit Adder 회로 설계1. 설계실습 내용 및 분석(1) 설계실습 계획서 (3)에서 그린 2-단계 전가산기 회로를 토글 스위치와 LED를 추가하여 설계 및 ... .63V4.63V4.63V00.18V2.57V4.42V4.42V4.42V2.53V2.55V(2) 설계실습 계획서 (4)에서 그린 XOR gate를 이용한 다단계 전가산기 회로

리포트 | 2페이지 | 1,500원 | 등록일 2010.11.12

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