"회로도"의 검색결과 입니다.

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atmega128 작품 저항,전압,전류 op amp 설계 전자주사위 전자회로설계실습 모듈형 요약 클리퍼 클램퍼 예비3 mosfet

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회로도 독후감 - 회로도 관련 독후감 1건 제공

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"회로도" 검색결과 6,201-6,220 / 26,972건

인하대 기초실험2 오프셋 측정 결과보고서

하여 대체하였다. 아래는 대체된 저항으로 구성된 회로이다.위의 회로도를 구성하고 회로에 교류입력은 전혀 하지않고 op-amp의 동작을 위한 직류전압만을 +-15V씩 op-amp입력단자 ... 로 대체하였다. 조교님이 이 저항을 사용하기로 하면서, 실험값이 제대로 나오지 않을 수 있다고 하셨는데 , 실제로 제대로 측정이 되지않았고 그 내용은 아래에 있다.먼저 왼쪽 회로도인 ... 보정저항을 달지 않았을 경우에, off-set으로 2.43mV의 값이 측정되었다. 오른쪽 회로도인 4.7K + 4.7K옴을 달았을 때 off-set이 1.5mV로 측정되어 off

리포트 | 4페이지 | 3,000원 | 등록일 2020.07.07

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전기회로설계실습 실험2 예비보고서

+5VDMM3.5 공통기준점에 대해 Output 1은 5V, Output 2는 ?10V가 되는 회로에 이 전압을 측정하기 위한 DMM을 추가한 회로를 설계하여 회로도를 제출하라. 단 ... 회로도에 기준점을 표시하라.기준점+--10V+-+5VDMMOutput 1Output 2++--Output 1 : 5VOutput 2 : -10VDMM3.6 DC Power ... 설계실습 2. 전원의 출력저항, DMM의 입력저항 측정회로 설계1. 목적 : 건전지의 출력저항과 DMM의 입력저항을 측정하는 회로를 설계, 제작, 측정하고 DC Power

리포트 | 3페이지 | 1,000원 | 등록일 2020.09.07 | 수정일 2020.09.15

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[중앙대학교 ] 전자전기공학부 전기회로설계실습(A+) 결과레포트3

해서는 1kΩ, 3kΩ의 저항을 각각 하나씩 사용해야 한다. 아래 회로도와 같이 회로를 설계하면 1kΩ 저항에는 3V의 전압이 출력되고, 3mA의 전류가 흐른다. 이를 Bread ... 가 많아지면서 저항의 오차들이 쌓이면서 예상 이론값과 8.667%라는 비교적 큰 오차율을 보였기에 다른 조원의 회로도로 다시 한 번 실습을 진행했다.2) 두 번째로 실습한 회로의 회로 ... 도는 그림 8과 같다.그림 8같은 방식으로 회로를 구성하고 분압기의 출력전압을 측정한 결과는 아래와 같다.사용하는 저항의 저항값 측정부하저항의 출력전압이론값(kΩ)측정값(kΩ)오차

리포트 | 8페이지 | 1,000원 | 등록일 2020.09.11 | 수정일 2020.09.14

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정류회로

과제 3연습과제 1의 회로도에서 다이오드 4개를 브리지모듈 MDA2500로 교체하여 브리지모듈을 이용한 단상전파정류회로를 관찰하였다.연습과제 1에서 그림 1의 Input ... 저항 100그림 8의 Output 그래프연습과제 4인 그림 4 회로도에서 저항 값을 낮추며 부하 저항이 10kΩ일 때까지는 일정한 모양이다가 1kΩ일 때 조금씩 바뀌면서 100Ω일 ... 의 Output 그래프추가과제 1의 연장선으로서 커패시터 값을 500uF, 100uF로 바꾸고 각각의 커패시터 값을 넣은 회로도에서 부하 저항 값을 낮추며 추가과제 1과 같이 유지되는 모양

리포트 | 11페이지 | 1,000원 | 등록일 2020.03.20 | 수정일 2020.03.25

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[중앙대학교 ] 전자전기공학부 전기회로설계실습(A+) 예비레포트10

하여 대략적으로 그려라.R=4㏀이므로 회로도는 그림 3과 같다.그림 3α(감쇠상수)=R/2L=4000/2×10×10-3 =2×105ω{}_{o}(공진주파수)={1} over {sqrt ... 설계실습 10. RLC 회로의 과도응답 및 정상상태응답2018○○○○ ○○○3. 설계실습 계획서3.1 RLC 직렬회로에서 R=500Ω. L=10mH, C=0.01㎌인 경우에 ω ... times`10 ^{4}ω{}_{d}(진동주파수)=(ω` _{o}2-α2)0.5=9624.58※병렬회로일 경우 α=1/2RC3.2 앞의 회로에서 입력이 사각파(0 to 1V, 1

리포트 | 5페이지 | 1,000원 | 등록일 2020.09.11

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[전자계산기구조]F(A,B,C) = ∑(2,4,6,7)의 진리표를 작성하고 , A,B 그리고 B,C를 각각 선택선으로 했을대 4x1 멀티플렉서 블록도를 설계하여 도시하시오

전자계산기 구조F(A,B,C) = ∑(2,4,6,7)의 진리표를 작성하고 , A,B 그리고 B,C를 각각 선택선으로 했을대 4x1 멀티플렉서 블록도를 설계하여 도시하시오1 ... 는 논리 회로를 말합니다. 멀티플렉서는 그림 1과 같이 입력 단과 출력단 이외에 어떠한 입력단을 출력으로 내보낼지 결정해주는 control input 핀이 따로 있습니다. Control ... input 핀에 원하는 신호를 내보내면 원하는 입력이 출력으로 내보내지는 논리 회로입니다.멀티플렉서는 DEMUX라고 줄여 부르기도 하며, 한 개의 입력을 어느 출력단에 내보낼지

리포트 | 4페이지 | 10,000원 | 등록일 2020.07.07 | 수정일 2021.05.11

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[중앙대 아날로그및디지털회로설계실습] 설계실습8 (래치와 플립플롭) 결과보고서

에서 작성한 상태도와 일치함을 확인 할 수 있다.다음으로 PSPICE를 사용하여 RS latch 회로를 구현하여 동작시켜본 결과는 다음과 같다.(CLK = 1 일 때)CLK=1, S ... 와 RS flip-flop 회로를 구성해보고 입력에 따른 출력을 확인해봤다. RS latch를 NAND gate(74HC00)을 이용해 구성했고 정상 동작함을 확인했다. RS ... SupplyFunction generatorBread Board1. 서론RS latch와 RS flip-flop 회로를 구성하여 동작해봄으로써 동작조건과 입력에 따른 출력을 확인했다.2

리포트 | 4페이지 | 1,000원 | 등록일 2020.08.11 | 수정일 2021.04.24

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[중앙대학교 ] 전자전기공학부 전기회로설계실습(A+) 예비레포트4

_{L}에 흐르는 전류는983.2mu A=0.983mA이다.그림 33.2(a)V _{Th}와R _{Th}를 이론적으로 구하고 Thevenin 등가회로를 설계하여 회로도를 제출하라.그림 ... 설계실습 4. Thevenin등가회로 설계2018○○○○ ○○○3. 설계실습 계획서그림 1 그림 1과 같이R _{L}이 부하인 브리지회로의 Thevenin 등가회로를 이론 및 ... 실험으로 구하고 비교하려 한다.그림 2그림 1을 간단히 나타내면 그림 2와 같다.3.1 브리지회로에서R _{L}에 걸리는 전압과R _{L}에 흐르는 전류는 얼마인가?그림 3과 같이

리포트 | 5페이지 | 1,000원 | 등록일 2020.09.11

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서강대학교 디지털논리회로실험 레포트 4주차

을 구현한 회로도STEP10) DIP_SW2를 HIGH로 하고 DIP_SW0, DIP_SW1의 조작을 통해 표4의 출력의 좌측 column을 완성하였다. 즉, DIP_SW0, DIP ... 에서 demux는 D2_4E를 사용하였다.그림 SEQ 그림 \* ARABIC 17. STEP18의 회로도사진 SEQ 사진 \* ARABIC 11. STEP 18을 설계한 회로도우선 ... 다. 그림 23은 analog multiplexer의 회로도이다.그림 SEQ 그림 \* ARABIC 23. Analog multiplexer(4) 그림 20은 XOR를 사용

리포트 | 24페이지 | 1,000원 | 등록일 2020.08.12 | 수정일 2020.08.26

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아주대학교 기초전기실험 AC 5, 6, 7, 8 예비보고서

, 주파수 비를 알 수 있다.3. 실험 과정 및 예상 결과오실로스코프 채널 1에는 회로에 인가하는 전압 E를 놓고 각을 0도로 맞춘다.채널 2에는 위상차를 보고자 하는 전압V ... 11주차 예비보고서전자공학도의 윤리 강령 (IEEE Code of Ethics)(출처: http://www.ieee.org)나는 전자공학도로서, 전자공학이 전 세계 인류의 삶 ... Response of the Series R-L Network1. 실험 목적교류전원의 R-L 직렬 회로에서 주파수 변화에 따른 각 저항, 인덕터 소자의 특성을 보고 이해하는 능력

리포트 | 5페이지 | 1,000원 | 등록일 2020.09.20 | 수정일 2020.09.22

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전기회로설계실습 중앙대 4. Thevenin 등가회로 설계

_{Th}와R _{Th}를 이론적으로 구하고 Thevenin 등가회로를 설계하여 회로도를 제출하라.V _{Th}를 구하기 위해서 a와 b단자의 전압을 각각 구하면,V _{a ... + {3300 TIMES1200} over {3300+1200} =1.093㏀ 따라서, Thevenin 등가회로를 그리면 오른쪽의 그림과 같은 회로도를 얻을 수 있다.⒝R _{L ... . Thevenin등가회로 설계전기회로설계실습(35792)1. 실험목적Thevenin 등가회로를 설계, 제작, 측정하여 원본 회로 및 이론값과 비교한다.2. 실습준비물-기본 장비 및 선

리포트 | 5페이지 | 1,000원 | 등록일 2020.05.21

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V. 제어기술 요약정리 및 예상문제

의 변동에 의해 잔류편차가 발행하기 때문에 높은 정밀도를 요구하는 제어(5) 비례+적분+미분동작(PID동작)- 외란에 의해 편차가 발생할 때 초기에 그 편차가 발생하는 속도에 대응 ... ,NFB): 전기회로를 개폐할 수 있으며, 단락보호와 과부하 목적으로 사용된다. 단락이나 과부하시 자동적으로 트립되어 회로를 자동으로 차단하며 트립의 원인을제거한 후 다시 손잡이를 올리 ... 회로(1) 자기 유지 회로: 푸쉬버튼 등의 순간동작으로 만들어진 입력신호가 계전기에 가해지면(전자접촉기 또는 전자계전기) 입력신호가 제거 되어도계전기의 동작을 계속적으로 지켜주

시험자료 | 3페이지 | 1,500원 | 등록일 2020.04.28

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전기회로설계실습 2학년 실습 결과보고서 / 12. 전기회로설계실습 - 수동소자의 고주파특성측정방법의 설계

커패시터의 고주파 특성 측정(0) 소자값10 kΩ 저항: R= 9.921 kΩ커패시턴스: C = 108 nF(1) PSPICE 회로도 및 Breadboard 회로(2 ... kΩ(1) PSPICE 회로도 및 Breadboard 회로(2) Transfer function의 크기 및 위상차 측정a. 측정표b. 전달함수 그래프c. 위상 변화약 10 kHz약 ... 을 실험하기 위해, 직렬 RC회로에서 커패시터 양단 전압 파형의 주파수 특성을 관찰하였다. 이 경우 약 4.6 MHz부터 인덕터의 특성이 관찰됐고, 전체적인 주파수 특성이 커패시터

리포트 | 7페이지 | 1,500원 | 등록일 2020.09.18 | 수정일 2020.10.22

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전자회로실험 실험6 AM송신기 결과보고서

한다.b) 이론적인 이득을 계산하고 시뮬레이션 값과 비교한다.= 그림 3.5와 같은 CE증폭기 회로도를 구성 한 후, 1kHz 정현파를 인가 한 뒤 출력파형을 측정한 결과입니다. 위 ... 의 콜피츠 발진기의 회로도를 구성 한 후, 출력단의 발진주파수를 측정하기 위해 전압 파형을 측정 한 결과입니다. 출력의 발진 주파수를 측정 한 결과가 아래의 표에 정리 되어있습니다.발진 ... , Q2의 콜렉터 출력, Q1의 입력 파형을 측정한다.= 그림 3.7의 AM 송신기 회로도를 구성한 후, 트랜지스터 Q2의 입, 출력 파형과 Q1의 입력 파형을 측정한 결과입니다

리포트 | 5페이지 | 1,500원 | 등록일 2013.04.25

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서강대학교 디지털논리회로실험 레포트 7주차

. STEP5의 회로우리는 사진 2와 같이 회로를 구성하였다.사진 SEQ 사진 \* ARABIC 2. 그림 16의 회로도STEP 6) DIP_SW0을 HIGH로 set한 상태 ... \* ARABIC 26. 설계해야 하는 system사진 SEQ 사진 \* ARABIC 8. SM1을 설계한 회로도사진 SEQ 사진 \* ARABIC 9. SM1을 symbol로 표현한 모습위 ... 와 같이 사진 8과 사진 9는 sm1을 나타낸다.사진 SEQ 사진 \* ARABIC 10. Irdec을 설계한 회로도사진 SEQ 사진 \* ARABIC 11. 사진 10의 s

리포트 | 26페이지 | 1,000원 | 등록일 2020.08.12 | 수정일 2020.08.26

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판매자 표지

제10장 래치와 플립플롭 예비보고서

게이트형 래치의 블록도를 합치면, 와같이 게이트형 SR래치의 내부블록도가 되고, 그 기능표는 와 같다.게이트형 SR래치의 내부회로도는 의 SR래치 블록도 자리에 의 NOR게이트로구성 ... 된 회로도를 넣으면, 가 된다. 또한 SR래치의 블록도 자리에 의 NAND게이트로 구성된 회로도를 넣으면 가 된다.그림 10-32. 게이트형 SR래치그림 10-33. 게이트형 SR ... 래치의 기능표Q{bar{Q}}(a) NOR게이트로 구성된 게이트형SR래치의 회로도(b) NAND게이트로 구성된 게이트형SR래치의 회로도그림 10-34. 게이트형 SR래치그림 10

리포트 | 15페이지 | 1,500원 | 등록일 2020.02.11

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아주대학교 기초전기실험 AC 12, 13 예비보고서

14주차 예비보고서전자공학도의 윤리 강령 (IEEE Code of Ethics)(출처: http://www.ieee.org)나는 전자공학도로서, 전자공학이 전 세계 인류의 삶 ... ’s Theorem and Maximum Power Transfer1. 실험 목적교류 회로에서 최대 전력 전달 조건을 임피던스와 관련하여 실험을 통해 확인해본다.2. 실험 이론테브 ... 난 정리)여러 개의 소자로 구성된 복잡한 회로를 하나의 등가전압원, 이와 직렬연결된 하나의 등가 임피던스로 표현할 수 있다는 것이 테브난의 정리이다.이는 이미 DC전압원을 사용

리포트 | 5페이지 | 1,000원 | 등록일 2020.09.20 | 수정일 2020.09.22

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서강대학교 전자회로실험 - 실험 5. 기본 OP 앰프 응용회로 및 비선형 OP 앰프 회로 결과 보고서

임피던스 회로에 대해 실험한다.(예비) Pspice를 이용한 회로도를 제시하고, 아래 에 결과값을 입력하세요.회로를 구성 한 뒤 실험하고 결과값을 표에 기입하세요. (입력 전압 ... 의 내부 저항 등으로 인한 오차인 것 같다.[실험 3] 전류-전압 변환기교재에 있는 그림 18-6 회로에 대해 실험한다.(예비) Pspice를 이용한 회로도를 제시하고, 아래 에 결과값 ... ) Pspice를 이용한 회로도를 제시하고, 아래 에 결과값을 입력하세요.반전 입력비반전 입력회로를 구성 한 뒤 실험하고 결과값을 표에 기입하세요.측정 실험 결과를 Pspice

리포트 | 16페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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중앙대 전기회로설계실습 2.전원의출력저항,DMM의입력저항측정회로설계 결과보고서

의 실험계획 3.1이 잘 되었다고 생각하는가? 그렇지 않다면 본인이 무엇을 잘 못 생각하였는지 기술하라.대체적으로 예비보고서에서 미리 계획한 회로도는 내부저항 측정에 있어 효율적인 ... 회로도라고 생각이 든다. Pushbutton switch를 추가하여 설계한 것이 제일 중요했던 것 같다.(c) Pushbutton switch가 없다면 어떤 현상이 일어날 것인가 ... 전지의 내부저항은 2.5327Ω로 측정되었다. 이 값은 큰 값의 저항을 이용하는 현실적인 회로에서는 고려하지 않아도 되는 작은 수치였다.최대전류를 변경하여 전압과 전류를 측정

리포트 | 5페이지 | 1,000원 | 등록일 2020.09.09

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마이크 믹서 엠프 설계 보고서

전체 Mixing Amp 회로도또한 이에 대한 Pspice Simulation을 진행하였다. 이에 대한 내용은 보고서 마지막 부분에 부록으로 넣겠다. 결과적으로 가변저항의 역할 ... 에 다 생긴 문제였다.그리하여 다시 원래 주어진 회로도로 돌아왔고 분석하던 도중, Feedback 회로에서 앞서 2-3에서 설명한 내용과 같은 오류를 발견하였다. 그리하여 원하는 증폭 ... 하였으나, 안정적인 출력을 가지는 스피커 회로도 설계해볼 수 있을 것이다. 앞서 언급했듯이 스피커는 단자 저항이 크다는 점을 고려하여 스피커 자체에 적당한 크기의 입력 신호를 주는 회로

리포트 | 14페이지 | 1,500원 | 등록일 2013.05.07

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