"포트게이트"의 검색결과 입니다.

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방화벽 전전설2 FPGA 게임 OSI 7계층 vhdl 밸브 컴활 2급 필기 UTP, FTP, STP 포물체 운동 고찰 컴보활

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"포트게이트" 검색결과 261-280 / 801건

VHDL 카운터 설계 및 시뮬레이션

라 한다.(1) SR-F/F (Set/Reset-Flip/Flop)SR-F/F은 NAND 게이트 두 개로 이루어져 있다. 두 개의 입력 S와 R이 있고, 두 개의 출력 Q와 /Q가 있 ... 가 0일 때 Q가 1이고 Reset이 0일 때 /Q가 1이 나온다.NAND 게이트를 사용하였으므로 한 입력이 0이면 다른 입력과 상관없이 출력은 항상 1이 나온다.입력 조건: Set ... /CLEAR는 0일 때 /Q'의 값과 /Q의 값이 1이다. 즉, Q의 값은 0이다./PRESET과 /CLEAR의 값이 둘 다 1일 경우 Q의 값을 나머주 두 포트에 의해 값이 결정

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| 리포트 | 18페이지 | 2,000원 | 등록일 2017.11.26 | 수정일 2018.08.27

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Network의 이해

과 녹색 교차 ) 이기종간 연결 허브의 포트는 PC 의 포트와 다르게 포트내에서 송신과 수신부가 이미 꼬여 있으므로 크로스 케이블을 사용할 필요가 없다 Direct/Cross ... 되었을 때 자동으로 DHCP 서버는 IP 주소 , 게이트 웨이와 DNS 서버와 같은 클라이언트의 네트워크 설정을 보내줍니다 DHCP (Dynamic Host Configuration

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| 리포트 | 30페이지 | 3,000원 | 등록일 2016.07.04

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[대충] 예비 VHDL 설명 및 문법

-하드웨어 블록의 이름과 입출력 포트 선언②아키텍쳐 몸체 선언-하드웨어 내부를 표현한다.③프로세서문④순차문?자료 흐름적 기법의 내부적 동작표현-병행신호할당문 : 프로세서문에서 지정 ... 였기에 생략하겠습니다.4. 실험코딩에서 action일 때 동작적 모델링 기법, actiondata일 때 자료 흐름적 기법.①NOT 게이트 실습library ieee;use ieee

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| 리포트 | 3페이지 | 1,000원 | 등록일 2015.01.17

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논리회로실험 - 제 1장 기본 논리 게이트 (AND, OR, NOT) 결과 보고서

다. XOR gate의 진리표와 기호는 다음과 같다.(2)어떻게 이 회로를 구성할 것인가1) VHDL 코드를 구성하는 기본 설정(1)기본 설정AND, OR, XOR 게이트를 한 ... , c_xor(2)설계 과정패키지 std_logic_1164를 사용하기 위해 IEEE라이브러리를 설정하고 std_logic_1164를 불러온다. 그리고 entity를 설정한다.포트 ... 가지의 경우의 수가 나온다.) 나머지 3개의 출력게이트가 어떻게 작동하는지 확인해본다.2) architecture 코드library ieee;use ieee.std_logic

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| 리포트 | 8페이지 | 1,000원 | 등록일 2014.08.15

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공기조화 설비 사례조사 레포트

갖추지 못했다는 것이다.이러한 문제점을 오버행을 통해서 건물에 받는 햇빛의 양을 최소화 시켜줌으로서 에너지를 효율적으로 활용할 수 있게 되었다.또한 이스트 게이트 쇼핑몰은 흰개미 ... 고 각 금고의 끝에 있는 배기 포트를 통과해 벽독 덕트 시스템을 통해서 중앙 수직 스택의 굴뚝으로 빠져 나가게 된다.아치형 천장과 콘크리트 구조의 보이드한 공간을 통해서 샌드위치

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| 리포트 | 27페이지 | 3,000원 | 등록일 2019.06.05 | 수정일 2021.03.21

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HW2 인터넷 공학 기초

netstat는 라우팅 테이블이나 네트워크 상황 또는 사용하는 포트 등을 확인할 때 주로 사용되는 명령어이다.< 상태 필드 >1) LISTEN : 현재 열려있는 포트로써 누군가의 접속을 항상 ... 기다리고 있는 포트2) ESTABLISHED : 현재 정상적으로 연결이 된 포트로써 사용하고 있다는 의미3) TIME_WAIT : 접속 후 사용이 종료되었으나 지정된 시간 ... 만큼 다른 명령이나 신호를 기다리고있다는 의미4) FIN_WAIT 1 : 포트가 닫혔으며 연결이 종료되기를 기다리는 상태5) FIN_WAIT 2 : 연결이 완전히 닫힌 상태6) SYN

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| 리포트 | 10페이지 | 2,000원 | 등록일 2013.11.19

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인터넷의 이해 대구대 OSI 7계층과 TCP/IP를 비교하여 설명, DNS설명 과제

, TLS응용간의 질서 제어통신 세션을 구성하는 계층으로, 포트연결이라고도 할 수 있다. 통신장치 간의 상호작용을 설정하고 유지하며 동기화 한다. 사용자간의 포트연결(세션)이 유효 ... 한지 확인하고 설정4계층Transport전송 계층프로토콜 : TCP,UDP,ARP장비 : 게이트웨이전체 메시지를 발신지 대 목적지(종단 대 종단)간 제어와 에러를 관리한다.패킷

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| 시험자료 | 8페이지 | 1,500원 | 등록일 2018.03.26

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VHDL을 이용한 논리 게이트 실습

VHDL 및 실습ReportQuartusⅡ를 이용한 기본 논리게이트 실습제출일2013년 3월 18일제출기한2013년 3월 18일담당교수최 종 성 교수님학과전 자 공 학 과학번 ... 2009144029이름우 경 제1. 실습명 : QuartusⅡ를 이용한 기본논리게이트(And,Or,Nand,Nor,Not,Xor,Xnor)의 설계 및 실습2. 실습목표 :(1 ... ) QuartusⅡ로 기본논리게이트 설계를 Schematic과 VHDL로 해보고 비교해본다.(2) 기본논리게이트의 반복설계로 QuartusⅡ를 숙달한다.3. 이론 :(1) 기본논리게이트

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| 리포트 | 28페이지 | 1,000원 | 등록일 2014.05.31 | 수정일 2014.06.02

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보안시스템

기본적인 솔루션이 된다.- 방법 : 첫째, 접근제어(방화벽을 대상으로 보호하고자 하는 네트워크의 외부와 내부에 존재하는 시스템들의 IP와 포트단위로 이루어진 룰셋을 사용하여 보호 ... 문제가 모두 해결되지 않는다. 방화벽을 설치함으로써 네트워크의 부하가 가중될 수 밖에 없다. 네트워크 트래픽이 게이트웨이로 집중된다는 단점을 감수해야 한다. 또한 방화벽 관리자

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| 리포트 | 5페이지 | 5,000원 | 등록일 2017.05.31

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네트워크 7계층 자료

네트워크계층 라우 터 데이터그램 IPv6 주소체계 라우팅 알고리즘 라우팅 프로토 콜 캐스트방식라우터 OSI 7 Layer 3 라우터의 구조 스위치 구조 입력포트 출 력 포트 라우팅 ... 프로세서 OSI 7 Layer 네트워크계층 라우 터 데이터그램 IPv6 주소체계 라우팅 알고리즘 라우팅 프로토 콜 캐스트방식라우터 OSI 7 Layer 3 입력 포트 라인종단 데이터 ... 링크 처리 ( 캡 슐화 ) 검색 (lookup) 포워딩 큐잉 입력 포트 내부 라인종단 : 라우터로 들어오는 입력 물리 링크의 종단으로 물리 계층기능 데이터 링크 처리 : 들어오

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| 리포트 | 37페이지 | 3,000원 | 등록일 2014.11.26

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FPGA를 이용한 디지털 시스템 설계(인하대) MUX, Decoder, Comparator 보고서

와 같다.포트 연결방법은 순서에 의한 연결방법을 사용하였다. - 4-to-1 MUX를 테스트하기 위한 코드module tb_mux_4to1();reg in0, in1, in2 ... Binary decoder의 진리표와 논리회로를 나타내면 다음과 같다.출력회로는 출력bit와 동일한 개수의 AND게이트를 사용하여 각 minterm함수를 구현함으로써 만들 수 있 ... 에서와 같이 always문을 사용하여 조건들을 반복하도록 하였다.전체적인 코드는 아래와 같다. (포트연결방법은 이름에 의한 연결방법 사용). - 2-to-4 Binary Decoder

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| 리포트 | 18페이지 | 2,000원 | 등록일 2014.11.26 | 수정일 2015.09.30

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[e-비즈니스 공통] OSI 7 Layer 모델의 각 프로토콜 계층의 명칭을 기술하고, 그 역할에 대하여 간략히 설명하시오

을 사용하며 주된 장비는 게이트웨이이다.5) 세션 계층의 역할통신 세션을 구성, 포트 연결이라고 한다. 통신장치간의 상호작용을 설정하고 유지하며 동기화 한다. 사용자간의 포트연결이 유효

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| 방송통신대 | 11페이지 | 3,000원 | 등록일 2015.03.20

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판매자 표지

디지털 논리회로 VHDL 코딩 과제 4bit full adder 설계

의 architecture는 MUXMETHOD라고 명명하였다.우리가 처음 알고 있었던 XOR를 사용한 방법과 다른 점은 XOR게이트를 사용했을 때는 입력과 출력 포트의 변수들만 이용 ... 다.처음에는 단순히 XOR를 AND와 OR로 구성할 수 있기에, 쉬운 문제라고 생각하였다.하지만 2개의 XOR를 AND와 OR로 바꾸려니 너무 많은 게이트가 사용되었고, 보기에도 복잡 ... XOR게이트를 사용하지 않은 1bit full adder가 구현되었다. - MUX를 사용한 1bit full adderlibrary ieee;use ieee.std_logic

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| 리포트 | 16페이지 | 2,000원 | 등록일 2014.10.13 | 수정일 2015.12.07

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FPGA 디지털 시스템 설계 : 16bit Full adder 설계

를 boolean 덧셈하는데, 결과 값과 carry in과 carry out을 합하여 모두 5개의 포트가 있어야 한다. 1bit full adder를 표로 나타내면 다음과 같다.abc ... _in'+abc_in=c_in(a十b)+ab이고, sum은 sum=a'b'c_in+a'bc_in'+ab'c_in'+abc_in=a十b十c_in이다. c_out의 OR 게이트는 XOR ... 게이트로 대체해도 결과가 동일한데, 실제로 칩을 제작할 때에는 사용하는 게이트 종류가 적을수록 좋기 때문에 c_out=c_in(a十b)十ab로 사용하였다.16bit full

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| 리포트 | 3페이지 | 1,000원 | 등록일 2012.06.18

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air track

.⑥ 포토게이트 #을 스마트타이머(Smart Timer)의 포트에 꽂는다. 포토게이트#는 스마트타이머에 연결하지 않는다.⑦ 스마트 타이머를 켜서 빨간색 “Select ... 포토게이트 사이를 자유롭게 미끄러져 통과할 수 있게 한다.⑦ 포토게이트 #을 스마트타이머(Smart Timer)의 포트에 꽂고,포토게이트 #는 스마트 타이머에 연결하지 않 ... 한다.- 뉴턴의 제2법칙(F=ma)을 이용하여 지구의 중력장이 물체에 가하는 힘을측정한다.- 에어트랙용 글라이더 2개를 충돌시켜 운동량보존을 입증한다.2. 실험준비물보조 포토게이트

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| 리포트 | 7페이지 | 1,000원 | 등록일 2012.12.08

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전자공학실험1 예비(8장)

드레인 : 출력단자소스 : 입력, 출력 포트에 공통 단자: 신호원의 등가회로신호전압은를 통해 게이트로 결합: 결합 커패시터, 차단 커패시터전압 분할기과는 게이트 직류 전압을 고정 ... 원를 ‘0’ , 저항→ 테스트 전원를 인가 :3. 공통 드레인 증폭기게이트 : 입력단자소스 : 출력단자드레인 : 입력과 출력포트에 공통단자공통 드레인 증폭기 또는 드레인 접지 증폭 ... 적으로 간단히 설정한다.입력신호 → 게이트에 인가, 출력신호 → 드레인에서 얻음, 소스단자 → 입·출력 공통게이트 소스 순시 전압 :드레인 순시 전류 :비선형 왜곡을 줄이기 위한 신호

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| 리포트 | 10페이지 | 1,000원 | 등록일 2012.04.08

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[중력가속도측정][중력][가속도]중력가속도측정과 측정실험도구, 중력가속도측정과 등가속도운동, 중력가속도측정과 단진자, 중력가속도측정과 케타진자, 중력가속도측정과 에너지보존 분석

) 자유낙하운동과 빗면에서의 물체의 운동Ⅱ. 중력가속도측정과 등가속도운동1. 실험 목적2. 실험 이론3. 실험 장치 및 기구4. 실험 방법1) 포토게이트 사용방법2) 중력가속 ... 에 2kB의 플래시 메모리가 내장되어 있는 원칩마이크로컨트롤러이다. 외부에서 크리스털과 리셋회로만 연결해주면 된다.측정된 시간은 시리얼 포트를 통하여 PC쪽으로 전송되는데 PC ... 의 COM 포트와 연결하려면 전압레벨을 RS-232레벨로 맞추기 위해 MAX232C라는 부품이 필요하다.2) 5V 만들기24볼트 입력 전원은 전자석에 직접 연결되며 5볼트는 7805라는

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| 리포트 | 9페이지 | 5,000원 | 등록일 2013.03.30

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VHDL을 이용한 digital watch 설계

둔다. 그렇게 1초생성기, 2x1Mux, 12진카운터, 60진카운터, FND 부분이랑 2x1Mux가 계층구조로 설계되어있어서 그하위디자인인 And, Or, Not게이트파일도 추가 ... 한 모습이다.ⓒcomponent (하위디자인의 Entity이름과 같게한다) isport(...) --포트 명도 같게 설정해주도록한다.end component;Mux를 탑디자인으로한 ... . component는 하위디자인을 탑디자인에서 쓰기위해 선언하는것이다U1 : and2 -- 탑디자인에서의 이름 : 정의된 component이름port map(포트=>연결될곳, -

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| 리포트 | 19페이지 | 2,000원 | 등록일 2014.05.31 | 수정일 2014.06.02

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와이어샤크 패킷 및 해킹툴

대로 나타내는데 마치 패킷이 네트워크상의 케이블을 지나다니는 것처럼 보인다.UDP Flooder란?상대방의 IP 포트를 입력하여 엄청난 양의 트래픽을 보내는 것결과물은 위의 사진을 보 ... port : 목적지 포트 필드- Destination port : 발신지 포트 필드- Length : 길이필드- Checksum : 체크섬 필드위에 화면은 해킹툴을 이용 ... ,ARP Spooping란?공격자가 자신의 랜 카드 주소(MAC)를 특정 PC의 IP와 연결하여 자신이 속한 네트워크에서 게이트웨이로 위장함으로써 해당 네트워크 대역의 모든 시스템

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| 리포트 | 9페이지 | 1,000원 | 등록일 2012.06.23

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컴퓨터와 정보사회 하드디스크에관한 모든것

기만 하면 별도의 전원공급장치 없이 작동가능하다. 일부 USB포트에서는 전력공급이 부족하여 제대로 작동하지 않거나 고장나는 경우가 있다.● 1.8인치 : 소형 노트북하드로 널리 사용 ... 에도 많이 사용됐으나 요즘은 PMP도 플래시메모리를 사용하게 되었다. 단, 2.5인치에 비해 전력소모량이 적으므로 2.5인치 하드디스크에 비해 포트를 가리는 특성은 없다. iPod ... .0G : SATA2에서는 하드디스크의 최고 전송 속도를 훨씬 뛰어넘는 전송 속도를 가졌기 때문에 SATA포트에 여러 개의 드라이브를 연결하는 포트 멀티 플라이어에 사용되는 방식이

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| 리포트 | 10페이지 | 1,500원 | 등록일 2014.11.25

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