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"PSPICE 회로도" 검색결과 241-260 / 1,770건

  • A+ 전자회로설계실습_Common Emitter Amplifier의 주파수 특성
    kHz, 20 mVpp 사인파를 입력하였을 때의 출력파형을 PSPICE로 Simulation하여 제출하라. 모든 node의 전압과 branch의 전류가 나타난 회로도와 이때의 출력 ... 수 특성 및 커패시터들의 영향을 측정, 평가한다.설계실습 계획서이전 실험의 2차 설계 결과회로(Ri 추가)에 대하여 모든 커패시터의 용량을 10 uF으로 하고 CE증폭기에 100 ... 파형을 PSPICE로 Simulation하여 제출하라. 출력전압의 최대값(Vmax), 최소값(Vmin)은 얼마인가? Vmax/|Vmin| 를 %로 구하라.|Vmin|=160mV
    리포트 | 7페이지 | 1,000원 | 등록일 2024.08.21
  • 판매자 표지 자료 표지
    [분반 1등], [A+], 중앙대학교 전기회로설계실습 2. 전원의 출력저항, DMM의 입력저항 측정회로 설계 예비보고서
    -10 V가 되는 회로에 이 전압을측정하기 위한 DMM을 추가한 회로pspice로 설계하여 회로도를 제출하라. 단회로도에 기준점을 표시하라.위의 그림에서 DMM의 (+) 단자 ... 보다 5 V 높게 되는회로에 이 전압을 측정하기 위해 DMM을 추가한 회로pspice로 설계하여 제출하라.3.5공통기준점에 대해 output 1은 5 V, output 2는 ... 지만, 측정 값은 0에 가까운 작은 값이 나올 것이다. 여러 자료를 검토해 본 결과 약 0.05~0.1Ω 정도 일 것으로 예상한다.(b) 건전지(6 V)의 내부저항을 측정하는 회로
    Non-Ai HUMAN
    | 리포트 | 4페이지 | 1,000원 | 등록일 2022.09.25
  • 판매자 표지 자료 표지
    전자공학실험 17장 능동 부하가 있는 공통 소오스 증폭기 A+ 예비보고서
    하여 전압 분배를 해 준 PSpice회로와 이를 이용하여 측정한 전압이다. (여기서v_g1,v_d1=v_d2,v_g2=v_g3=v_d3는 측정 파형에서 small signal이 ... =0.375[V/V]가 되고 M2, M3도 위의 값을 이용하여 게이트-전압 이득을 계산하면 된다.ㄴvin의 파형ㄴv_out의 파형위의 시뮬레이션 결과는 이전의 회로에서 vin ... (active load)가 있는 공통 소오스 증폭기(common source amplifier) 회로’를 구성하고, 이를 바탕으로 공통 소오스 증폭기의 전압 이득을 구하고자 한다
    리포트 | 13페이지 | 2,000원 | 등록일 2024.04.09 | 수정일 2024.11.15
  • 판매자 표지 자료 표지
    [A+] 전자회로설계실습 6차 예비보고서
    가 나타난 회로도와 이때의 출력파형을 PSPICE로 Simulation하여 제출하라. 출력전압의 최댓값(Vmax), 최솟값(|Vmin|)은 얼마인가? Vmax/|Vmin|를 %로 구하라 ... node의 전압과 branch의 전류가 나타난 회로도와 이때의 출력파형을 PSPICE로 Simulation하여 제출하라. 반올림하여 유효숫자 세 개로 다음 표를 작성하라 ... 은 저항 Ri를 연결한 회로에 대하여 Vmax/|Vmin|가 95%이상이 되도록 저항을 PSPICE로 구한다. 이 저항과 function generator 출력저항 50 Ω
    리포트 | 5페이지 | 1,000원 | 등록일 2023.06.21
  • 판매자 표지 자료 표지
    (22년) 중앙대학교 전자전기공학부 전자회로설계실습 예비보고서 8. MOSFET Current Mirror 설계
    ) IO=IREF=10mA인 Cascode 전류원을 OrCAD로 설계하여 회로도를 제출한다. (RL=500Ω으로 설계)(C) PSPICE를 이용하여 시뮬레이션하고, 시뮬레이션 값 ... 은 drain에서의 전압이 커진다는 것이고, drain에서의 전압이 VCC를 넘지 않는 선까지 RL값을 줄여도 괜찮다.(D) IO=IREF=10mA인 전류원을 OrCAD로 설계하여 회로도 ... 2개저항 1kΩ 4개설계실습 계획서3.1 단일 Current Mirror 설계그림 1의 회로와 같이 Current Source에서 , 로는 2N7000(Fairchild)을 이용
    리포트 | 4페이지 | 1,000원 | 등록일 2023.02.12
  • 판매자 표지 자료 표지
    MOSFET의 특성측정 예비보고서
    .6=0.134(A/V) 이다.3.2 MOSFET 회로도 구성 및 시뮬레이션 (OrCAD PSPICE)(A) OrCAD를 이용하여 그림 1의 회로도를 설계하여라.(2N7000/FAI ... 이용,R _{G} =1M ohm 으로 설정)(B) PSPICE를 이용하여i _{D} -v _{GS}특성곡선을 시뮬레이션 하여라.(V _{DS}=5V를 이용하여 측정)참고 ... .421(mA/V) 이다.(E) PSPICE를 이용하여i _{D} -v _{DS} 특성곡선을 제출하여라.참고: [Current Marker : Drain단 위치, 시뮬레이션 세팅
    리포트 | 3페이지 | 1,000원 | 등록일 2023.01.21
  • 연산 증폭기 응용 실험
    , 전압 이득을 구하시오.(a)R_1 = 10 k OMEGA,R_2 = 20 k OMEGA실험회로 2의 Pspice 회로도입력-출력 파형(초록:입력, 빨강:출력)(b)R_1 = 10 ... 이득을 구하시오.실험회로 3의 Pspice 회로도입력-출력 파형(초록:입력, 빨강:출력)- 입력과 출력 사이의 전달함수이상적인 연산증폭기일 때, 전압이득이 무한대이다. 따라서 입력 ... 이득 주파수를 구하시오.실험회로 5의 Pspice 회로도log스케일 일 때의 전압이득 보드선도입-출력의 보드선도- 입력과 출력 사이의 전달함수이상적인 연산증폭기라고 가정
    Non-Ai HUMAN
    | 리포트 | 14페이지 | 1,500원 | 등록일 2021.10.01
  • 8. 래치와 플립플롭 결과보고서 [2021년도 아날로그 및 디지털 회로 설계 실습 A+ 자료]
    아날로그 및 디지털 회로 설계 실습-실습 8 결과보고서-래치와 플립플롭학과 :담당 교수님 :제출일 :조 :학번 / 이름 :8-4. 설계실습 내용 및 분석8-4-1 PSPICE ... 를 활용한 RS 래치 구현 및 동작(A) PSPICE를 사용하여 그림 9-1의 회로를 구현 및 동작시키고, 결과값이 아래 실험의 결과값과 같은지 비교한다.8-4-2 Bread ... Board를 활용한 RS 래치 구현 및 동작(A) 그림 8-1의 회로를 TTL 7400을 사용하여 구성하고, 만들어진 래치에 입력값을 넣어서 관찰될 수 있는 상태도를 그리고 예비보고서
    Non-Ai HUMAN
    | 리포트 | 5페이지 | 1,000원 | 등록일 2022.09.07
  • 중앙대 전자전기공학부 전자회로설계실습 예비보고서(실험1)
    이 100 mV이었다.(A) 센서의 Thevenin 등가회로를 구하는 과정을 기술하고 센서의 Thevenin 등가회로PSPICE로 그려서 제출한다.입력임피던스(= 1 MΩ ... . 시뮬레이션 결과는 목표 출력전압과 일치한다.(C) 설계한 회로의 이득의 주파수 특성을 PSPICE를 이용하여 simulation하고 그 결과를 제출한다. (힌트: PSpice ... 는 회로를 설계하고, 회로와 출력파형을 PSPICE로 simulation하여 제출하시오 (단, 조건을 만족하는 회로는 유일하지 않음).실험 절차※ 다른 지시가 없다면 측정값은 유효숫자
    Non-Ai HUMAN
    | 리포트 | 12페이지 | 1,500원 | 등록일 2021.08.18
  • 판매자 표지 자료 표지
    중앙대학교 전자회로설계실습 예비보고서2
    /V), 1000 (V/V) 인 Inverting Amplifier를 설계하고 회로도를 제출한다.이상적인 Op Amp라면 inverting amp의 closed loop gain값 ... )의 1kHz 구형파를 인가했을 때 4Vpp의 삼각파를 출력하는 이상적인 적분기를 설계하고 PSPICE를 이용하여 회로, 입력전압과 출력전압의 파형을 제출한다.먼저 1kHz를 이용 ... 예비 보고서설계실습 2. Op Amp의 특성측정 방법 및 Integrator 설계1. 목적OP Amp의 offset 전압과 slew rate를 측정하는 회로, 적분기를 설계
    리포트 | 12페이지 | 2,000원 | 등록일 2024.03.10
  • [전자회로설계실습]실습1(Op Amp를 이용한 다양한 Amplifier 설계)예비보고서
    와 출력파형을 PSPICE로 simulation하여 제출하시오. (단, 조건을 만족하는 회로는 유일하지 않음)V1은 입력파형과 위상은 같고, 크기는 10배 증폭되었고, V2는 위상 ... 전자회로설계실습설계실습1. Op Amp를 이용한 다양한 Amplifier 설계예비보고서제출자 성명:제출자 학번:1. 목적출력저항이 큰 센서의 출력신호를 증폭하는 Inverting ... 을 역시 오실로스코프로 측정하였더니 peak to peak 전압이 100mV이었다.센서의 Thevenin 등가회로를 구하는 과정을 기술하고 센서의 Thevenin 등가회로
    Non-Ai HUMAN
    | 리포트 | 10페이지 | 1,000원 | 등록일 2022.04.11
  • 판매자 표지 자료 표지
    A+ 2022 중앙대학교 전자회로설계실습 예비보고서 10 Oscillator 설계
    설계실습 10. Oscillator 설계과 목 : 전자회로설계실습학 번 :조/이름:3.1 OrCAD PSPICE를 사용한 Oscillator의 설계(A)L _{+} =-L _{ ... 1의 신호 발생기를 OrCAD를 이용하여 설계하고 설계도를 제출하라. 사용한 수식 및 수치를 자세히 적어서 제출한다.그림 1 Oscillator (신호 발생기) 회로도R _{1 ... -6} )`ln {1+ beta } over {1- beta } 이다.따라서R=968.340`[rm ohm ] 이다.(B) PSPICE를 이용하여 위에서 설계한 oscillator
    리포트 | 7페이지 | 1,000원 | 등록일 2023.02.25
  • 판매자 표지 자료 표지
    중앙대 전자회로 설계 실습 예비보고서 2_Op Amp의 특성측정 방법 및 Integrator 설계
    Voltage 측정방법 설계(A) 이상적인 Op Amp를 사용하여 100㎐에서 Gain이 100(V/V), 1000(V/V)인 Inverting Amplifier를 설계하고 회로도를 제출 ... 설계(A) 입력저항이 530Ω이며, 4(-2V~2V)의 1㎑ 구형파를 인가했을 때 4의 삼각파를 출력하는 이상적인 적분기를 설계하고 PSPICE를 이용하여 회로, 입력전압과 출력전압 ... 회로실제 Case에서 Op-Amp의 Offset Voltage 값은 평균적으로 1mV 정도의 값이 나온다. 헌데 단순히 Open Loop Gain만을 이용해서 Offset
    리포트 | 8페이지 | 2,000원 | 등록일 2024.03.05 | 수정일 2024.03.11
  • 판매자 표지 자료 표지
    [기초전자실험 with pspice] 13 커패시터 예비보고서 <작성자 학점 A+>
    용량이 증가할수록 은 증가할 것이다.참고 문헌홍순관, 기초전자실험 with PSpice, 한빛아카데미, 2016Ch.13 커패시터 실험자료, 기초전자회로실험Pspice.com ... 에 금속을 입힌 다음, 이를 원통형으로 감아 만든다. 가격이 저렴하지만 정밀도가 낮다.커패시터 몸체에 용량을 직접 기록하기 어려운 경우, ‘103K’와 같은 숫자코드를 사용한다.‘103 ... 때까지 걸리는 시간이다. 위 회로에서 시정수는 LED 저항값과 C1의 곱으로 주어진다. 따라서, 위 회로에 LED와 직렬로 저항을 추가하면 시정수가 늘어나 LED의 점등 시간
    리포트 | 8페이지 | 1,500원 | 등록일 2023.01.28
  • 판매자 표지 자료 표지
    설계실습 9. 피드백 증폭기 (Feedback Amplifier) 예비레포트
    시키고 전원 전압원을 12V에서 10V로 낮추었을 때 LED에 흐르는 전류가 바뀌는지 확인하고 이유를 설명하라.전류가 3.2(b)에 비해 절반이 된다.이 회로도에서 LED에 흐르 ... 설계실습 9. 피드백 증폭기 (Feedback Amplifier)예비 레포트전자전기공학부3 설계실습 계획서3.1 Series-Shunt 피드백 회로 설계(A) 그림 1 회로(교재 ... 참고)를 simulation하기 위한 PSpice schematic을 그린다. 전원 전압원은 12V로 고정하고 입력저항 및 부하저항을 1kΩ, 피드백 저항은 =2가 되도록 , 값
    Non-Ai HUMAN
    | 리포트 | 8페이지 | 1,000원 | 등록일 2021.03.09 | 수정일 2021.03.12
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    A+ 2022 중앙대학교 전자회로설계실습 예비보고서 6 Common Emitter Amplifier 설계
    에 100 kHz, 20 mVpp 사인파를 입력하였을 때의 출력파형을 PSPICE로 Simulation하여 제출하라. 모든 node의 전압과 branch의 전류가 나타난 회로도와 이때 ... voltage gain은 작아지나 amplifier gain은 변하지 않는다. (2차 설계 완료) 모든 node의 전압과 branch의 전류가 나타난 회로도와 이때의 출력파형을 PSPICE ... 설계실습 6. Common Emitter Amplifier 설계과 목 : 전자회로설계실습학 번 :조/이름:3.1 Emitter 저항을 삽입한 Common Emitter
    리포트 | 7페이지 | 1,000원 | 등록일 2023.02.25
  • 중앙대 전자회로설계실습 (예비) 8. MOSFET Current Mirror 설계 A+
    커질 것이다.(D) IO = IREF = 10 mA인 전류원을 OrCAD로 설계하여 회로도를 제출한다. (RL=500 Ω으로 설계)(E) PSPICE를 이용하여 시뮬레이션 하 ... 와 M4의 VGS는 동일하다=2.41VVGS를 만족시키기 위한 R1값:= 10V, ,518(B) IO = IREF = 10 mA인 Cascode 전류원을 OrCAD로 설계하여 회로도 ... 전자회로설계실습 예비보고서(8. MOSFET Current Mirror 설계)제출일 :3. 설계실습 계획서3.1 단일 Current Mirror 설계그림 1 Current
    Non-Ai HUMAN
    | 리포트 | 6페이지 | 2,500원 | 등록일 2022.04.09
  • 판매자 표지 자료 표지
    (22년) 중앙대학교 전자전기공학부 전자회로설계실습 예비보고서 6. Common Emitter Amplifer 설계
    과 branch의 전류가 나타난 회로도와 이때의 출력파형을 PSPICE로 Simulation하여 제출하라. 출력전압의 최댓값(), 최솟값()은 얼마인가? 를 %로 구하라. 선형증폭기 ... voltage gain은 작아지나 amplifier gain은 변하지 않는다. (2차 설계 완료) 모든 node의 전압과 branch의 전류가 나타난 회로도와 이때의 출력파형을 PSPICE ... Amplifier 설계위 회로와 같이 emitter 저항을 사용한 Common Emitter Amplifier에서 =50Ω, = 5kΩ, =12V인 경우, =100인 NPN BJT를 사용하여 이
    리포트 | 9페이지 | 1,500원 | 등록일 2023.02.12
  • 판매자 표지 자료 표지
    중앙대학교 전자회로설계실습 예비보고서8
    로 설계하여 회로도를 제출한다. (=500Ω)(E) PSPICE를 이용하여 시뮬레이션하고, 시뮬레이션 값을 다음 표에 작성하라. (Bias Point로 설정하고 시뮬레이션 ... ) = = 10mA 인 Cascode 전류원을 OrCAD로 설계하여 회로도를 제출한다. (=500Ω)(C) PSPICE를 이용하여 시뮬레이션하고, 시뮬레이션 값을 다음 표에 작성하라 ... 단일 Current Mirror 설계*모든 계산결과는 반올림하여 유효숫자 세 자리까지만 사용한다.그림 1의 회로와 같이 Current Source에서 , 로는 2N7000
    리포트 | 7페이지 | 2,000원 | 등록일 2024.03.10
  • 판매자 표지 자료 표지
    설계실습 6. Common Emitter Amplifier 예비레포트
    , 20 mVpp 사인파를 입력하였을 때의 출력파형을 PSPICE로 Simulation하여 제출하라. 모든 node의 전압과 branch의 전류가 나타난 회로도와 이떄의 출력파형 ... voltage gain은 작아지나 amplifier gain은 변하지 않는다. (2차 설계 완료) 모든 node의 전압과 branch의 전류가 나타난 회로도와 이때의 출력파형 ... Amplifier 설계*모든 계산결과는 반올림하여 유효숫자 세 자리 까지만 사용한다.위 회로와 같이 emitter저항을 사용한 Common Emitter Amplifier에서 =50Ω, =5kΩ
    Non-Ai HUMAN
    | 리포트 | 8페이지 | 1,000원 | 등록일 2021.03.09 | 수정일 2021.03.12
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2025년 11월 27일 목요일
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