"논리회로결과"의 검색결과 입니다.

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메모리 회로 결과 전전설2 74125 ic 산술논리연산회로 ripple carry counter FPGA 사칙연산 BCD to 7 세그먼트 두더지 잡기 아날로그

"논리회로결과" 검색결과 201-220 / 5,399건

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논리회로설계실험 반가산기전가산기설계 결과보고서

논리회로설계 실험 결과보고서 #2실험 2. 조합 회로 설계-전가산기실험목표전가산기의 동작을 이해하고 진리표를 작성해 본다. 작성한 진리표를 바탕으로 최소화된 논리식을 사용하여 전 ... 가산기 회로를 동작적 모델링, 자료 흐름 모델링, 그리고 구조적 모델링 방식으로 코드를 작성해 본다. 또한 Schematic design을 이용하여 전가산기의 논리회로를 구성 ... 해 본다. 최종적으로 테스트 벤치 코드를 작성하여 시뮬레이션을 통해 전가산기 코드가 정상적으로 작동하는지 확인해 본다.실험 결과 전가산기 회로를 동작적 모델링, 자료 흐름 모델링

리포트 | 6페이지 | 1,500원 | 등록일 2018.01.10

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기본 논리게이트(AND, OR, NOT 게이트) 회로실험 결과 레포트

기본 논리 게이트디지털 공학 실험1. 실습내용 : 기본 논리 게이트2. 실습날짜 :3. 실 습 조 :4. 실습개요ⅰ. 논리회로의 기본이 되는 NOT, AND, OR 게이트의 논리 ... 기호와 기본 동작을 이해ⅱ. 실험을 통해 기본 논리 게이트의 동작 특성(진리표)을 확인ⅲ. 시뮬레이션을 통해 기본 논리 게이트의 동작특성을 확인5. 실험내용 (과정 및 결과 ... *************1101000101011001111실험결과A와 B로 구성되있는 AND게이트에서 A,B의 출력을 다른 핀의 트렌지스터의 입력으로 연결하였을 경우 3입력 AND 게이트 회로

리포트 | 8페이지 | 1,000원 | 등록일 2016.03.29

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논리회로실험 12주차 결과보고서

100의 값을 받아 논리연산장치인 AND가 작동하여 000111의 값을 출력하였다.[ 실험 2-2 ]1. Quartus Ⅱ에서 ALU의 회로를 작성하고 Modelsim의 결과 ... ]1. Quartus Ⅱ에서 ALU의 회로를 작성하고 Modelsim의 결과 파형을 확인한다.? ALU의 Modelsim을 이용한 wave구현다음의 파형을 결과표로 나타내면 다음 ... 결 과 보 고 서12주차ALU분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.001. 실험과정[ 실험 1 ]1. Quartus Ⅱ에서 ALU의 회로를 작성

리포트 | 7페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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논리회로실험 7주차 결과보고서

하고 switch로 입력 값을 변화하며 LED의 변화를 살펴보면 다음과 같은 결과 값을 얻을 수 있다.[ 실험 3 ]1. 7-segment LED의 회로를 구현하기 위해 Quartus Ⅱ ... ]1. 4x2 encoder의 회로를 구현하기 위해 Quartus Ⅱ를 이용하여 구현하고, Modelsim 값과 DE2-115에서의 동작을 확인한다.? 4x2 encoder ... 의 Modelsim을 이용한 결과 파형 확인inputoutputi3i2i1i0d1d000*************010100011? I[3]=0, I[2]=0, I[1]=0, I[0]=1에 대

리포트 | 8페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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논리회로실험 8주차 결과보고서

결 과 보 고 서8주차Latch / Flip Flop분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.001. 실험과정[ 실험 1 ]1.D latch의 회로 ... 면 입력 d가 저장되어 출력 q로 그대로 전달된다. (en=0일 때 입력된 d값은 출력 q로 전달되지 않는다.)? D latch의 Modelsim을 이용한 결과 파형 확인( 초록색 ... 결과를 나타내는 사진이다. enable=1이고, 입력 d=1을 받아 q=1(led red)을 출력했으므로, d의 값을 그대로 q로 전달하여 출력함을 알 수 있다.? enable=1

리포트 | 5페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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논리회로실험 15주차 결과보고서

, Decoder, 7-Segment - LED driver 등 그동안 실험에서 배운 블록을 이용하여 회로 블록을 설계하여 본다.- 기본적인 디지털 로직 블록을 이용하여 복잡한 로직회로 ... 를 설계하고 Modelsim과 FPGA 보드를 이용하여 회로를 검증하는 방법을 이해한다.? Quartus Ⅱ에서 Schematic을 작성한다.(13주차 종합설계프로젝트 ... 눈으로 변화를 감지 못할 정도로 빠르게 움직여 마치 모든 7-segment-LED가 모두 켜져 있는 결과가 나오므로 Wave로 파형을 분석하고자 할 때에는 이 블록을 필요로 하지

리포트 | 5페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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논리회로실험 2주차 결과보고서

.008 v0 V5 V4.004 v5 V0 V4.003 v5 V5 V4.002 v실험고찰1. 실험과정 3, 4, 5 표의 결과 값(v)을 논리 값으로 바꾸시오[표 10] 3개의 Not ... .991 v과정 3[그림 3] Breadboard[표 6] 3개의 Not Gate 결과 값inputoutputAXYZ0 V4.98 v0.06 v4.96 v5 V0.03 v5.002 ... v0.03 v과정 4[그림 5] NAND 와 NOT Breadboard[표 7] NAND 와 NOT 결과 값inputoutputBAFZ0 V0 V4.96v0.01v0 V5 V4

리포트 | 6페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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논리회로실험 15주차 결과보고서

이 1Hz 동작을 하는 구동 회로가 되고, 버튼을 위로 올리면 3Hz 동작을 하는 구동 회로가 된다.)3. KEY3번 버튼을 눌렀을 때는 보드가 어떤 동작을 하는지 작성하시오.KEY3 ... 다.만약, 50MHz clock으로 동작하는 FPGA에서 clock divider 없이 합성하면 변화가 빨라 마치 모든 세그먼트가 다 켜져 있는 결과를 얻게 된다. (Wave

리포트 | 5페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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서강대학교 디지털논리회로실험 - 실험 5. Arithmetic comparator, Adder and ALU 결과 보고서

디지털논리회로실험결과 보고서[5주차]실험 5. Arithmetic comparator, Adder and ALU1. 실험 개요1) Arithmetic comparator를 기본 ... +AgtB}이다. A=011일 때의 시뮬레이션 결과는 [그림 2]와 같다.[그림 1][그림 2]실제 구현 회로는 [그림 3]과 같다. a2~a0는 DIP_SW[2] ~ DIP_SW[0 ... 하였다. 시뮬레이션 결과는 [그림 5]와 같다.[그림 4][그림 5]실제 구현 회로는 [그림 6]과 같다. 이때, c0, x0, y0의 값은 각각 DIP_SW[0], DIP_SW[1], DIP

리포트 | 8페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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논리회로실험 6주차 결과보고서

=> sw[16]=sw[17]=1[ ?번 경우 ]Multiplxer는 여러 입력선 중에서 하나를 선택하여 해당 입력선의 2진 정보를 출력선에 연결하는 조합논리회로이다.i0[1]=0 ... 실험에서는 처음으로 2비트 값을 사용했기 때문에 굵은 선으로 인풋과 MUX 2x1 block를 연결하여 주었다.? 2X1 multiplexer의 Modelsim을 이용한 결과 파형 ... 째도 enable신호가 1이고 입력 값이 있지만, 결과 값을 분석해 볼 때, i0와 i1모두에 값이 입력되어야만 출력 값이 나온다는 것을 알 수 있다. (2x1 multiplxer이

리포트 | 8페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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논리회로실험 9주차 결과보고서

. Register의 회로를 구현하기 위해 Quartus Ⅱ를 이용하여 구현하고, Modelsim 값과 DE2-115에서의 동작을 확인한다.? Register의 Quartus Ⅱ ... Schematic을 이용한 구현N비트의 Register는 Flip Flop n개로 구성되며, 2진 정보 n비트를 저장할 수 있다.? Register의 Modelsim을 이용한 결과 파형 ... 된다. 그러므로 불이 들어오지 않는다.[ 실험 3 ]1. Ring Counter의 회로를 구현하기 위해 Quartus Ⅱ를 이용하여 구현하고, Modelsim 값과 DE2-115에서의 동작

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논리회로실험 4주차 결과보고서

= AB` + A`B`C , S = B`( A+C ) 라는 두 개의 부울식을 Quartus Ⅱ Schematic을 이용하여 구현하고 두 식 F와 S의 결과 값이 서로 일치 ... 이 들어갔고, 그에 따라 X=AB`, Y=A`B`C 그리고 이 두 식을 더한 F=B`( A+C )에 대한 출력 값이 나오게 되었다.[표 2] 과정 1-1 결과 값 ... INPUTOUPUTABCXYF00*************000011000100101101101110000111000Modelsim을 이용하여 다음과 같은 결과를 얻을 수 있다. 8경우의 input

리포트 | 7페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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논리회로실험 5주차 결과보고서

F와 S의 결과 값이 서로 일치하는지 Modelsim과 Quartus Ⅱ를 이용하여 증명하였었다.이번 실험에서는 F = AB` + A`B`C , S = B`( A+C ) 라는 두 ... 개의 부울식을 Quartus Ⅱ Verilog HDL을 이용하여 구현하고, 두 식 F와 S의 결과 값이 서로 일치 하는지 Modelsim과 Quartus Ⅱ를 이용하여 증명하는 것 ... 을 실험 목적으로 한다.? F = AB` + A`B`C와 S = B`( A+C )에 대해 Verilog HDL을 만들고 Modelsim을 이용해서 결과 파형을 작성한다.모든

리포트 | 6페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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논리회로실험 11주차 결과보고서

에서 업 카운터의 회로를 작성하고 Modelsim의 결과 파형을 확인한다.? 업 카운터의 Modelsim을 이용한 wave구현.? cnt는 0일 때 동작하지 않고, 1일 때만 동작 ... -0010...순으로 카운터가 작동한다.[ 실험 2 ]2-1. Quartus Ⅱ에서 업/다운 카운터의 회로를 작성하고 Modelsim의 결과 파형을 확인한다.? 업/다운 카운터 ... -0001-0010-0011...이러한 순으로 정해진 순서의 상태를 반복한다.1-2. Quartus Ⅱ에서 업 카운터의 회로를 작성하고 DE2-115에서 동작을 확인한다.? 업

리포트 | 6페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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08 논리회로설계실험 결과보고서(카운터)

논리회로설계 실험 결과보고서 #8실험 8. 카운터 설계1. 실험 목표VHDL을 이용하여 카운터를 설계한다.설계한 카운터를 이용하여 RoV-Lab3000의 led와 7segment ... 가 정해진 동작을 수행하도록 한다.2. 실험 결과실험 1. 8비트 비동기식 업카운터 설계(1) 설계 내용1) 소스 코드2) 핀할당3) 7segment 표시결과4) 결과 분석이번 ... 실험을 하기 전 작성했던 예비보고서에서 설계했던 존슨카운터를 응용하여 설계하였다.실험의 목표는 클락 주파수가 2Hz인 회로이다. 이를 위해 첫 번째 process 문에서 클락

리포트 | 5페이지 | 2,000원 | 등록일 2014.09.27 | 수정일 2016.03.26

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09 논리회로설계실험 결과보고서(fsm)

논리회로설계 실험 결과보고서 #9실험 9. FSM1. 실험 목표무어머신의 개념을 이용해 주어진 동작에 맞게 작동하는 자판기를 설계한다.2. 실험 결과실험 1. 무어머신을 이용 ... -1S5S3---1 자판기 상태표(2) 설계 내용1) 소스 코드자판기 동작 코드debouncing 코드3) 스케메틱 설계4) 결과상태 S1상태 S1 -> S3 (50원 추가)상태 S ... 1 (50원 추가)3) 결과 분석자판기 본체 코드는 2가지 process 로 구성되어있다. 첫 번째 프로세스 문에서는 스위치 입력 X에 따라 STATE_C 가 다음 상태를 가지

리포트 | 7페이지 | 2,000원 | 등록일 2014.09.27 | 수정일 2016.03.26

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07 논리회로설계실험 결과보고서(RoV)

논리회로설계 실험 결과보고서 #7실험 7. RoV Lab7000 사용법1. 실험 목표RoV-Lab7000이 목표에 맞게 동작하도록 VHDL을 이용하여 설계한다.led와 7 s ... egment로 원하는 결과를 나타내게 한다. RoV-Lab70002. 실험 결과실험 1. 스위치 사용하여 led켜기(1) 스위치-led 진리표 및 핀할당SWled ... ) 소스 코드2) 결과3) 결과 분석장치에 부착된 스위치를 통해 led를 점등시키기 위해 vhdl을 이용해 설계하였다. case 문을 이용하여 스위치를 뜻하는 입력 SW 값에 따라

리포트 | 8페이지 | 2,000원 | 등록일 2014.09.27 | 수정일 2016.03.26

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[디지털 논리회로 실험] 9장. 인코더와 디코더 결과레포트

논리회로실험 A반결과9장인코더와 디코더5조이름학번실험일15.04.07제출일15.04.14전원전압 4.89VHD74LS04P , HD74LS08P , HD74LS32P , SN74 ... 하고 출력을 관찰하라.실험 9.2 2X4 디코더(1)_논리게이트를 이용하여 2X4 디코더의 회로도를 나타내었다. 회로도에 IC 핀번호를 입력하라.(2)_다음과 같이 입력 값을 인가 ... -디지털 논리회로 본 교재 제 9장 참조 ,http://mkple.com/CL4Id [인코더, 디코더]http://miniskirtzia.blog.me/220058600220(7-세그먼트)

리포트 | 2페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2022.10.13

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[디지털 논리회로 실험] 16장. 동기식 카운터 결과레포트

논리회로실험 A반결과 보고서16장동기식 카운터5조이름학번실험일15.06.02제출일15.06.09측정 전압 ? 4.90V실험에 사용된 기기 및 부품 : 오실로스코프(CRO) 혹은 ... 동기식 다운 카운터(1) IC 7476(Dual JK Flop-Flop)2개를 이용한 동기식 다운 카운터회로의 회로도이다. 회로도에 IC 핀 번호를 작성하여라.(2)Q _{D},Q ... 74163 동기식 4Bit 2진 업 카운터(1) IC 74163을 이용한 동기식 업 카운터 회로의 회로도이다. 회로도에 IC 핀 번호를 작성하라.(2) 다음과 같은 입력 값을 인가

리포트 | 3페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2022.10.09

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[아날로그및디지털회로설계실습A+] 논리함수와 게이트 결과 레포트 입니다

아날로그 및 디지털 설계 실습8# 논리함수와 게이트결과 레포트설계실습 8. 논리함수와 게이트1. 목적 : 여러 종류의 게이트의 기능을 측정을 통하여 실험적으로 이해한다.2. 실습 ... 에 여러 개의 AND 게이트와 OR 게이트를 직렬로 연결하는 실험을 할 때, 각 Quad 게이트에서 하나의 게이트를 사용하였고, 그 결과 Quad 게이트를 여러 개 붙여서 회로 ... . 74LS00칩의 다른 NAND 게이트에 대해서도 같은 결과를 얻을 수 있었는가를 확인하시오.2.7V 까지를 high(논리값 1)이라고 인식함으로 2.7V 때의 인가된동력 전압

리포트 | 6페이지 | 1,000원 | 등록일 2017.10.06

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