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발광 소자의 특성 및 논리회로 실험 결과보고서2025.11.181. 7 세그먼트 디스플레이 및 논리회로 7 세그먼트 디스플레이는 숫자와 문자를 표시하는 발광 소자로, 논리회로를 통해 제어됩니다. 본 실험에서는 진리표에 따라 각 세그먼트 단자에 입력되는 신호를 분석하고, PSIM과 Proteus 8 시뮬레이션 도구를 사용하여 회로를 구현했습니다. 0001(숫자 1), 0111(숫자 7), 1011(문자 C), 1110(문자 H) 등 다양한 입력 조합에 따른 출력 결과를 확인했습니다. 2. 카르노 맵과 부울 함수 최소화 카르노 맵은 논리함수를 간소화하는 도구로, 진리표의 입력변수 조합에 따른 함수...2025.11.18
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논리게이트 회로실험 예비보고서not,and,or2025.05.081. 논리게이트 논리게이트는 전자 회로에서 사용되는 기본적인 논리 연산 장치입니다. 이 실험에서는 NOT, AND, OR 게이트의 동작 원리와 특성을 이해하고 실험을 통해 확인하는 것이 목적입니다. 논리게이트는 디지털 회로 설계에 필수적인 요소이며, 컴퓨터 및 전자 기기의 핵심 구성 요소로 사용됩니다. 1. 논리게이트 논리게이트는 디지털 회로 설계에서 매우 중요한 기본 구성 요소입니다. 논리게이트는 AND, OR, NOT, XOR 등의 기본적인 논리 연산을 수행하여 복잡한 디지털 회로를 구현할 수 있게 해줍니다. 이를 통해 컴퓨터,...2025.05.08
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TTL 논리 회로 설계 및 구현 실험2025.11.161. TTL 및 CMOS 디지털 로직 TTL(Transistor-Transistor Logic)과 CMOS(Complementary Metal-Oxide-Semiconductor)의 입출력 전압 및 전류 특성을 비교 분석했다. TTL은 Low Level 0~0.8V, High Level 2V~전원전압으로 인식하며, CMOS는 전원전압에 따라 달라진다. TTL의 입출력 전류는 μA~mA 범위이고, CMOS는 입력핀에 거의 전류가 흐르지 않는 특징이 있다. 팬아웃(Fan-out)은 출력단에서 구동할 수 있는 최대 입력 수를 나타내며, ...2025.11.16
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디지털 논리회로 실험 및 설계 4주차 예비보고서2025.04.281. 멀티플렉서와 부호기(encoder)의 차이 부호기는 4개의 입력값 중에 1이 단 1개만 있어야하는 반면에 멀티플렉서는 1의 입력 개수의 제한이 없다. 부호기는 출력값이 입력값()에 대한 그 비트값()이지만, 멀티플렉서는 그 비트값()의 입력값()이 출력값()이다. 2. 4-to-1 Multiplexer 74153, 2-to-1 Multiplexer 74157, 1-of-4 Decocder 74139, 3-INPUT AND 게이트 7411의 datasheet 4-to-1 Multiplexer 74153은 16번pin에는 VCC를...2025.04.28
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컴퓨터구조 - 메모리 맵, 논리회로, 부울대수2025.04.281. 메모리 맵 컴퓨터 구조에서 메모리 맵은 메모리 주소 공간을 나타내는 개념입니다. 이를 통해 RAM 또는 ROM과 같은 메모리 장치의 주소를 표현할 수 있습니다. 메모리 맵은 주소 버스를 통해 표현되며, 이를 이용하여 메모리 장치에 접근할 수 있습니다. 2. 논리회로 논리회로는 논리 게이트를 사용하여 입력 신호를 처리하고 출력을 생성하는 전자 회로입니다. 이를 통해 2입력 논리식, 논리 게이트, 부울 대수 등을 표현할 수 있습니다. 논리회로는 컴퓨터 구조의 기본 구성 요소 중 하나입니다. 3. 부울 대수 부울 대수는 참/거짓 값...2025.04.28
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아날로그 및 디지털회로 설계 실습 실습7_논리함수와 게이트_결과보고서2025.01.211. 논리게이트 논리회로는 모든 전자회로의 기초라고 할 수 있다. 따라서 논리게이트들을 조합하여 다른 논리게이트를 만들거나, 하나의 논리게이트로 다른 논리게이트들을 표현하는 설계능력과 리게이트의 동작 특성을 올바르게 이해하는 것이 매우 중요하다. 2. NAND, NOR, XOR 게이트 AND, OR, NOT 게이트를 사용하여 NAND, NOR, XOR 게이트의 진리표와 등가회로를 작성하고 두 입력의 모든 경우에 대해 출력 전압의 값을 측정하였다. 3. NAND 게이트 등가회로 NAND 게이트만 사용하여 AND, OR, NOT 게이트...2025.01.21
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[논리회로설계실험] Mux, Demux (dataflow/gatelevel modeling) (성균관대)2025.01.211. MUX MUX는 멀티플렉서라고도 하며 다수의 정보 장치를 소수의 채널이나 선을 통하여 전송하는 것을 의미한다. MUX는 여러 입력선 중에서 하나를 선택하여 출력선에 연결하는 '조합 논리 회로'로 선택선의 값에 따라 한 입력선을 선택한다. 일반적으로 입력선이 n개 있을 때 선택선은 log2n개가 필요하다. 2. DEMUX DEMUX는 디멀티플렉서라고도 하며 하나의 입력선을 여러 개의 출력선 중 하나에 연결하는 '조합 논리 회로'이다. 선택선의 값에 따라 하나의 출력선이 활성화되고 나머지 출력선은 비활성화된다. 일반적으로 출력선이...2025.01.21
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논리회로설계실험 3주차 Adder 설계2025.05.151. 1-bit Full Adder 이번 실습에서는 1-bit full adder를 dataflow modeling과 gate-level modeling 두 가지 방법으로 직접 구현해 보았습니다. truth table과 Karnaugh map을 이용해 구한 Boolean expression을 바탕으로 구현하였으며, 이를 통해 adder의 작동 방식을 더 깊이 이해할 수 있었습니다. 2. 4-bit Full Adder 1-bit full adder를 이용하여 4-bit full adder를 구현하였습니다. 4개의 1-bit full ...2025.05.15
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[논리회로실험] 실험7. Shift Register 결과보고서2025.05.081. Shift Register 이번 실험에서는 Shift Right Register와 순환 레지스터를 직접 구현해보고 결과를 통해 truth table을 작성하고 시프트 레지스터의 특성을 알아보았습니다. 실험 1의 경우 6 bit shift right register를 구현했고, 실험 2의 경우 단일 IC칩을 사용하여 5bit 시프트 레지스터를 구현했습니다. 실험 3에서는 circulating shift register를 구현하였고, 실험 2와 결과 값은 별 차이가 없지만 QA, QB가 on이 되는 시점부터 다시 shifting ...2025.05.08
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디지털집적회로설계 실습: 기본 논리게이트 시뮬레이션2025.11.151. INVERTER (인버터) 인버터는 입력 신호를 반전시키는 기본 논리게이트이다. 실습에서 pulse 파형의 입력 신호를 사용하여 시뮬레이션을 수행했으며, 결과 그래프에서 입력과 출력 신호가 정반대의 값을 가지는 것을 확인하여 제대로 구현되었음을 검증했다. 2. NAND 게이트 NAND 게이트는 두 입력 신호가 모두 1일 때만 출력이 0이 되고, 나머지 모든 경우에 출력이 1이 되는 논리게이트이다. 실습에서 INA, INB 입력에 대한 OUT 출력을 분석하여 NAND 게이트의 동작 원리를 파형 그래프로 확인했다. 3. AND 게...2025.11.15
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