"전공실2"의 검색결과 입니다.

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"전공실2" 검색결과 1-20 / 918건

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Logic 연산과 gates 결과보고서 A+ 레포트

∘ 오차 및 토의- 1과 0으로 이루어진 연산이라 큰 오차가 발생하지 않는다. NAND나 NOR gate의 입력을 한군데 연결하였을 때 NOT gate가 되는 것처럼 전혀 다른 연산자로 변환될 수 있다는 것과 특정 gate만을 사용하여 잘 조합하면 다른 gate를 만들..

리포트 | 6페이지 | 2,000원 | 등록일 2023.11.15

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실험4 JK flip-flop 결과보고서 A+ 레포트

이 실험에서 파형발생기의 문제로 인해 0V, +5V 사각파를 정확히 만들기 힘들었고 파형의 모양도 비율이 맞게 조 정하기 힘들었다. 하지만 예상한 결과값과 같이 2배와 4배 ... 을 입력하고 CLK의 변화에 따른 L2와 L3의 변화를 살펴보았다. 첫 번째는 오실로 스코프의 CH.1에는 CLK를 CH.2에는 L2, 두 번째는 오실로스코프의 CH.1에는 CLK ... 를 CH.2에는 L3를 연결하여 입력 신호와 출력신호를 비교 해 본 결과 Master에서 나온 신호 L2와 Slave에서 나온 신호 L3가 주기의 차이가 있음을 확인할 수 있었다.

리포트 | 3페이지 | 2,000원 | 등록일 2023.11.15

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실험8 Decoder와 Encoder 결과보고서 A+ 레포트

7447(BCD-to-7 segment decoder)의 input 즉, 7번에 A, 1번에 B, 2번에 C, 6번에 D를 각각 연결하고 그 때의 출력을 살펴보았더니 위의 진리표

리포트 | 4페이지 | 2,000원 | 등록일 2023.11.15

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실험11 Digital-to-Analog converter (DAC) 결과보고서 A+ 레포트

은 시간이 지날수록 떨어지게 된다. 또 한 입력에 16진계수기를 직접 구성하여 달았는데, 이 때 8kΩ을 A에, 4kΩ을 B에, 2kΩ을, C에 1kΩ을 D에 연결한 뒤 출력을 살펴본 결과 위의 사진처럼 출력이 계단 형태로 나오는 것을 확인할 수 있었다.

리포트 | 2페이지 | 2,000원 | 등록일 2023.11.15

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실험3 RS-Latch 및 D-Latch 결과보고서 A+ 레포트

면 입력한 회로의 값(D)과 출력되는 회로의(Q) 값이 같고 Enable의 입력 값이 0이면 입력 값(D)에 상관없이 Enable이 0이 되기 전의 값으로 고정되는 회로이다. 이 실험

리포트 | 4페이지 | 2,000원 | 등록일 2023.11.15

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Logic gates-TTL gates와 드모르간의 법칙 결과보고서 A+ 레포트

과 Ch.2에 같은 입력을 연결하였는데 scope화면에 서로 다른 출력신호가 나타났던 것으로 보아 케이블 내부의 문제인 것 같았다. 여러 번의 실험으로 출력 신호가 생각한 것과 비슷

리포트 | 5페이지 | 2,000원 | 등록일 2023.11.15

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실험10 연산 증폭기 (Operational Amplifier) 결과보고서 A+ 레포트

두 번째 실험은 op amp로 summing amp를 만들어 summing amp의 입력과 출력의 관계를 살펴보는 실험이었다. 이론적으로는 입력 A와 B 두 개의 입력을 넣게 되면 출력은 -  /  로 증폭된 둘의 출력의 합이 출력으로 나오게 된다. 실제 실험..

리포트 | 3페이지 | 2,000원 | 등록일 2023.11.15

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Shift Registers 결과보고서 A+ 레포트

1.1 IC 7474 두 개를 사용하여 그림 1과 같은 회로를 꾸민다.1.2 먼저 모든 switch를 "0"으로 하여 모든 FF의 출력을 "0"으로 한다. 1.3 switch ... 1을 "1"로 하고 switch 2도 "1"로 하고 나서 switch 3을 "0"⟶"1"⟶ "0"로 바꾸어 가며 출력을 살펴 본다. 표 1을 완성하고 이를 이용하여 그림 2 ... 의 timing diagram을 그린다. 1.4 switch 2를 "0"으로 하고 switch 3을 "0"⟶"1"⟶"0"로 바꾸어 가며 출력을 살펴본다. 또 switch 2를 "0

리포트 | 2페이지 | 2,000원 | 등록일 2023.11.15

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실험6 이진 계수기 (Binanry Counter) 결과보고서 A+ 레포트

마지막 실험은 TTL IC 7476 dual JK FF 2개와 TTL IC 7408을 사용하여 위의 그림과 같은 동기형 계수기를 만 들었다. 먼저 Switch 1 ... 에 CLK 신호를 Switch 2에는 CLR을 연결하였고, 나머지 J와 K, preset 등 에는 위의 회로 와 같이 연결하였다. 그 뒤 Switch 2를 +5V로 하고 Switch 1 ... 다. 또한 오실로스코프를 통해 Switch 1을 통해 들어온 CLK 신호와 각각의 출력 신호 L1, L2, L3, L4를 비교하였더니 위의 사진과 같이 나타났다.

리포트 | 6페이지 | 2,000원 | 등록일 2023.11.15

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검증개선조치결과보고서(어류및연체류HACCP)

업체로고검증 개선 조치결과 보고서결재담당자HACCP 팀장담당자담당자작성일자2022. 11. 10개선조치내용개선 전1.가공실 원료반입 양문 틈새벌어짐.2.배수로 청소불량.3.가공실 ... 손 소독기 작동불량4.파렛트,자키 위생상태 불량.5.창고정리상태 불량.개선 후1.원료반임 문 벌어진틈새 보수.2.배수로 청소 매일 작업종료후 실시.3.가공실 손 소독기 분사구멍 세척,소독하여 정상작동시킴.4.파렛트,자키,세척 소독실시.

서식 | 1페이지 | 1,000원 | 등록일 2023.03.20 | 수정일 2023.03.22

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실험5 Shift Registers 결과보고서 A+ 레포트

은 Switch 1에는 CL을, Switch 2에는 D를, Switch 3에는 CLK를 연결한 뒤, 모든 Switch를 0 으로 하여 FF의 출력을 0 으로 하고 Switch 1을 1 ... 로 하고 Switch 2도 1로 한 뒤, CLK 신호인 Switch 3을 0 -> 1 -> 0 으로 바 꾸어가며 출력을 살펴보고 Switch 2를 0으로 한 뒤, CLK 신호인

리포트 | 3페이지 | 2,000원 | 등록일 2023.11.15

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실험2 Logic gates-TTL gates와 드모르간의 법칙 결과보고서 A+ 레포트

, falling time 및 propagation delay를 측정한다.2. 결과 및 분석 (모든 실험에서 빵판의 빨간줄은 5V, 파란색은 ground에 연결

리포트 | 5페이지 | 2,000원 | 등록일 2023.11.15

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실험7 십진 계수기 (BCD counter) 결과보고서 A+ 레포트

마지막 실험은 TTL IC 7490을 사용하여 counter의 응용을 실험해보는 것이었다. 먼저 기본적인 세팅은 입력에 10kHz의 신호를 연결하고 pin 1에 CLK 신호를, 나머지는 위의 사진과 같이 세팅하였다. 위의 사진과 같이 세팅하 였을 때의 pin 12의 ..

리포트 | 4페이지 | 2,000원 | 등록일 2023.11.15

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이진 계수기 (Binanry Counter) 결과보고서 A+ 레포트

∘ 오차 및 토의- 이번 실험에서 이진 계수기의 작동 원리와 그 특성에 대하여 실험하였다. Count up과 Count Down은 서로 반대의 출력을 보였다. Count up과 동기형 계수기는 결과는 같다. 그러나 1번실험에서 직전 FF의 출력이 다음 FF의 CLK로 ..

리포트 | 4페이지 | 2,000원 | 등록일 2023.11.15

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실험9 덧셈 회로 (ADDER) 결과보고서 A+ 레포트

실험 4는 실험 3의 회로의 B1, B2, B3, B4에 TTL IC 7486 XOR gate를 연결하여 위의 사진처럼 뺄셈회로를 만 들었다. 이론적으로 뺄셈회로는 A ... 에서 B(n-1)과 C를 뺀다고 생각할 때 B는 윗자리에서 가져오는 수이고 D는 빼고 남은 수이다. 따라서 뺀 값이 1이면 이면 B는 0 D는 1,뺀 값이 0 이면 B는 0 D도 0, 뺀 값이 -1이면 B는 1 D도 1, 뺀 값이 -2이면 B는 1 D는 0이 되어야한다.

리포트 | 3페이지 | 2,000원 | 등록일 2023.11.15

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JK flip-flop 결과보고서 A+ 레포트

실험값이 자주 바뀌고 변수도 많아 혼동이 있었다. 실험 3에서 A=0으로 놓았을 때 출력이 L2=0, L3=0이었고 s=1 일 때 L2=0, L3=0이 출력되었다.

리포트 | 3페이지 | 2,000원 | 등록일 2023.11.15

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RS-Latch 및 D-Latch 결과보고서 A+ 레포트

∘ 오차 및 토의- 이번 실험에서 RS latch 및 D latch의 동작과 그 특성에 대하여 실험하였다. 4번 실험까지는 특별한 어려움이 없었지만 마지막 실험에서 회로를 구성하는데 약간의 문제가 있었다. 5번 실험에서 CLK가 1⟶0으로 갈 때는 신호를 전달하지 않아..

리포트 | 3페이지 | 2,000원 | 등록일 2023.11.15

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연산 증폭기 (Operational Amplifier) 결과보고서 A+ 레포트

Schmidt trigger - 기준에 비해 아주 작은 전위차만 있어도 출력이 나오는 것을 확인 할 수 있었다.결과 값이 이론 값과 완전히 일치 하지 않는 것에대해 도서저항 멀티미터 자체가 지니고 있는 측정 오류등 의 이유에 의해 오차가 발생한 것 같다.

리포트 | 3페이지 | 2,000원 | 등록일 2023.11.15

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십진 계수기 (BCD counter) 결과보고서 A+ 레포트

, 0이 들어가므로 1이 출력된다. 따라서 CLEAR에 신호가 들어가고 계수기는 0000이 출력된다. 2진 계수기와 5진 계수기가 들어있는 TTL IC 7490을 이용하여 10진 계수기를 만드는 방법도 살펴보았다.

리포트 | 4페이지 | 2,000원 | 등록일 2023.11.15

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24년 국내.외 오피스 시장 현황

) 오피스 공실률 , 임대료 현황 ▶ 2020 년 2 월 도쿄 오피스 시장 황금기 → 공실률 1.49% 역대 최저점 , 임대료 2.3 만엔 역대 최고치 2020 년 2 월 공실 ... 오피스 공급량 과잉 → 年 평균 87,900 평 공급 ■ 2023 년 서울 전체 오피스 공실률 역대 최저 3.7% → CBD 3.3%, GBD 2.4%, YBD 3.0% ■ 21 ... ■ 국내 . 외 오피스 현황 ㅣ 글로벌 오피스 공실률 현황 및 전망 [ 출처 : CBRE Research, Cushman, KPMG/ 단위 : %] ■ 국 . 내외 오피스 공실

리포트 | 12페이지 | 3,000원 | 등록일 2024.03.29

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