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전자회로실험 전자회로설계실습 다단 증폭기 과제 고급전자회로실험 oscillator 설계 능동 2차 Lpf 결과 클리퍼 클램퍼 공통이미터
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"시뮬레이션파형" 검색결과 1,781-1,800 / 3,209건

  • 자료 표지
    실험1 부궤환회로(예비)
    4.5V (Vpp = 9V) 를 입력한 뒤 시뮬레이션을 했을 때, 왜곡없이 입력파형과 같은 위상으로 증폭된 출력파형이 나와 비반전 연산증폭기의 정상적인 작동을 확인하였다.Vin = 4.5V, Rf = 10k ... . OP Amp 의 출력 임피던스(Ro) 는 ‘0’이다.4. 대역폭 (Bandwidth) 이 무한대(∞)이다.5. 0의 값을 가지는 Output Offset3. 실험 시뮬레이션< 1 ... . 반전연산증폭기 PSPICE 시뮬레이션 >: 임의의 입력전압 값(15V)으로 시뮬레이션을 하였을 때 그 결과로 위상이 180도 바뀌어 출력이 되었다, 따라서 위회로는 반전연산증폭기
    Non-Ai HUMAN
    | 리포트 | 7페이지 | 1,000원 | 등록일 2013.06.20
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  • 자료 표지
    실험9 결과보고서
    의 출력을 측정하였다. 측정 값은 5V를 갖는 사각파를 출력하였다.3) 주파수 발생기를 이용하여 계단 파형(1KHz)이 나오는지 관찰하고 파형을 그려라.파형을 관찰해 보면 서로 다른 ... 진폭을 가지는 계단 파형이 출력됨을 확인 할 수 있다. 회로를 분석해보면 7490을 통해서 출력되는 EXCEES-3코드의 10개의 값들이 그 뒤에 달려진 저항들에 의해서 각각 서로 ... 된 것이다. 이러한 회로의 해석을 통해서 우리는 디지털 신호를 아날로그 신호로 변화시키는 과정을 알아보는 실험이었다.4) 저항Rf를 2.7KΩ으로 바꾸고 출력 파형을 그려라.저항을 2
    Non-Ai HUMAN
    | 리포트 | 6페이지 | 1,000원 | 등록일 2013.01.01
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  • 자료 표지
    Verilog HDL 문법 자료 (A+받은 자료 입니다)
    (a+b) A b ?:Verilog 논리회로 표현 시뮬레이션 Testbench를 이용해 검증한다. • 회로에 실제 입력 대신 시뮬레이션 파형 입력 • 최상위 계층의 module ... 로 선언한다 • Testbench 파일은 외부와 입출력을 하지 않는다Verilog 논리회로 표현 시뮬레이션 예)NOT게이트게이트 레벨 표현 module inv_1(A, Y ... 시뮬레이션을 한다. 시뮬레이션을 하기 위해선 테스트벤치 파일을 같이 프로젝트에 추가 해주어야 한다.{nameOfApplication=Show}
    Non-Ai HUMAN
    | 리포트 | 34페이지 | 3,000원 | 등록일 2015.06.22 | 수정일 2015.06.23
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  • 자료 표지
    비례적분미분제어기를 이용한 폐루프 제어시스템 레포트
    } +1.1 TIMES 10 ^{6} s+10 ^{8}}3) 실험회로에서R _{2}의 저항을 100kΩ에 고정하고R _{d}의 저항을 0으로 조정한다. 이 경우 출력파형을 관측하시 ... - 상승시간 : 220us 정상상태편차 : 0● Matlab- 상승시간 : 210us 정상상태편차 : 0- 실험값과 시뮬레이션값이 동일하다.R _{d}=1.5k● 실험(R _{d}=1 ... 시간 : 155us 정상상태편차 : 0- Pspice값만 최대 오버슈트값을 보이고 있다.6) 컨덴서C _{d}를 0.01uF에서 0.1uF까지 증가시키면서 출력파형을 관측하시오
    Non-Ai HUMAN
    | 리포트 | 16페이지 | 2,000원 | 등록일 2015.01.06
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  • 자료 표지
    주파수응답(Frequency Response) BJT,FET 회로
    게 하는바람에 파형만 찍었다. 도저히 사진만보고서는 값을알수가 없어서 피스파이스로 똑같은 회로를 꾸미고 주파수를 바꿔가면서 결과값을 측정해서 엑셀을 이용해서 그래프로 그린결과 실제 ... 피스파이스 시뮬레이션결과와 비슷한 결과를 얻을수 있었다. BW는 출력의 최대크기의 0.707배인일때의 주파수를 찾아보면 High 차단주파수는 약 40.698MEG 임을 알 수 있 ... 을 알 수 있다.각 주파수별로 오실로스코프 파형은 다음과같다.측정값100hz1khz10k100k10MEG3.2 BJT(CB)의 증폭회로52.9배 증폭결과 [SPEC. Av>50
    Non-Ai HUMAN
    | 리포트 | 11페이지 | 1,000원 | 등록일 2013.02.12
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  • 자료 표지
    [통신 시스템] 매틀랩을 이용한 PLL 설계 보고서
    의 차이 값을 구하는 부분에서 이용됩니다. 이전까지 쓰던 입력파형이었던을 쓰지 않고, 대신에씁니다. 왜 입력파형을 delay를 주는가에 대해서 살펴보겠습니다.의 파형으로서 S(t)와 r ... 에서 파형이 많이 튀게 되므로 PLL을 디자인할 때 이 부분을 주의하여야 합니다. PLL을 디자인 할 때 알아두어야 할 세 가지 용어가 있는데 Free running, Capture ... 으로 만들어서 시뮬레이션을 해보려고 합니다.3. Matlab code(PLL)1. 위상 검출기(Phase detector)그림 ) phase detector%phase
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    | 리포트 | 11페이지 | 3,500원 | 등록일 2013.07.11 | 수정일 2013.11.10
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  • 자료 표지
    전자회로실험 예비10 연산 증폭기 기본 실험
    로 증가시키면서 출력의 크기 및 파형을 관찰하여 표에 기록하시오.먼저 연산 증폭기의 DC 전류가 일정하게 흐르고 출력의 공통 모드 전압이 일정하게 유지되는 범위를 찾아보기 위해서 ... 고, 실험을 진행했다. 다음과 같이 회로를 구성했다.10mV부터 50mV까지 10mV의 단위로 증가시키면서 출력 및 파형을 측정하였다.출력 파형10mV20mV30mV40mV50mV공통 ... 하고 시뮬레이션을 했다.1V를 인가했을 때 17.9mV가 나오는 것을 확인할 수 있었다. 여기서 공통모드의 이득은 0.0179라는 것을 확인할 수 있다.(6) 실험 절차 (3
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    | 리포트 | 8페이지 | 1,000원 | 등록일 2014.08.15
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  • 자료 표지
    VHDL을 이용한 Mux, Demux, incoder, decoder, FND 설계 및 실습
    '); 으로 썼는데 others라고 표기한것도 A랑 B가 단일입력이 아닌 각각 묶음으로 입력되기에 저렇게 서술한다.c. 시뮬레이션 결과A, B, Y를 그룹으로 묶어서 파형을 만든후 sel ... , J, L, o, P, r, S, t, u, y 가 있다.4. 실습 및 시뮬레이션(1) 1비트 2x1 Muxa. Schematic으로 설계b. VHDL으로 설계Y'Z ... 을 Random Value를 주어서 시뮬레이션을 돌린다. sel이 바뀌는 부분을 확인해보면 sel이 0에서는 A를 출력하다가 sel이 1이된순간 B를 출력하는것을 확인할 수 있다.d
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    | 리포트 | 16페이지 | 1,000원 | 등록일 2014.05.31 | 수정일 2014.06.02
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  • 자료 표지
    buck convertor
    제어자동화전공8Power ElectronicsBuck Convertor■ 기본이론 : Buck convertor 회로의 해석□ 회로도 및 출력파형□ 회로해석ⅰ) Mode 1 ... 다. 이는 Buck Convertor에서 Q-ON 시간t _{1}이 길면 출력전압이 높아지는 원리에 따른 것이다. 따라서 시비율 k를 점차적으로 늘려가면서 시뮬레이션을 반복하여보면시비 ... 의 변화위의 반복된 시뮬레이션에 의하여k=0.461일 때V _{a} image 5[V],I _{a} image 2[A]를 얻을 수 있었다.다음으로 출력 전압의 리플은 다음 수식
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    | 리포트 | 8페이지 | 1,500원 | 등록일 2016.01.05
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  • 자료 표지
    07파형의_미분과_적분 결과
    게 할 수 있었다. PSpice로 돌린 시뮬레이션 파형과 실험결과로 나온 실험 파형이 일치 하게 나왔다. 적분파형은 앞부분은 다르게 나왔지만 오실로스코프에 나온 파형은 어느 정도 시간 ... 와 저항에 의한 미분회로와 적분회로의 파형을 보는 것이다.실험 과정은 회로를 구성한 후 구형파를 인가하고 오실로스코프를 이용해 미분파형과 적분파형을 보면 되는 것이었다.실험결과 미분회로 ... 이 지난 후의 파형이므로 결국은 동일한 파형이라고 볼 수 있다. 회로이론을 공부하면서 전압의 변화에 따른 미분파형, 적분파형을 그리는 것을 해보았는데 매우 비슷한 그림이 나와서
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    | 리포트 | 2페이지 | 1,000원 | 등록일 2012.11.06
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  • 자료 표지
    반파 및 전파 정류 회로 예비 보고서
    은 두 경우 모두 같게 되며 따라서 시뮬레이션 그림과 같은 출력전압 파형이 나타나게 됩니다. 각각의 경우에 출력전압은 다이오드를 2개씩 지나가므로 출력전압은입니다.Full ... Circuit)반파정류는 교류전압을 인가하였을 경우 양(+)의 주기는 도통되고 음(-)의 주기는 차단시킴으로써 양(+)의 파형을 가지는 것을 말합니다. 시뮬레이션의 회로를 보면 AC전압 ... , 다이오드, 부하저항이 직렬로 연결 되어 있습니다. (+)전압 일 때 다이오드가 도통되어 시뮬레이션에 (+)전압 파형만 출력이 됩니다. 이때 출력 전압 파형은 입력 전압보다 작은것
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    | 리포트 | 3페이지 | 2,000원 | 등록일 2012.06.26
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  • 자료 표지
    예비 실험5. 능동 필터회로
    PSpice를 통한 시뮬레이션 입출력 파형 결과(주파수가 100Hz 일 때)PSpice를 통한 시뮬레이션 입출력 파형 결과(주파수가 200Hz 일 때)PSpice를 통한 시뮬레이션 입출력 ... 파형 결과(주파수가 500Hz 일 때)PSpice를 통한 시뮬레이션 입출력 파형 결과(주파수가 1KHz 일 때)PSpice를 통한 시뮬레이션 입출력 파형 결과(주파수가 2KHz ... 일 때)PSpice를 통한 시뮬레이션 입출력 파형 결과(주파수가 5KHz 일 때)→ 시뮬레이션 결과 입력전압을 Vp-p 1V로 가해 주었을 때, 주파수에 따라 이득이 달라짐을 확인
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    | 리포트 | 10페이지 | 2,000원 | 등록일 2012.03.11
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    실험09 RC 및 RL 직렬회로
    - 교류전압의 실효치[그림 9-8][그림 9-11][그림 9-8]은 교류신호의 파형이다. 그림에서 시간 축을 중심으로 위쪽 또는 아래쪽의 파형의 변화폭을 최대치 (V _{m}, 진폭 ... )라 한다. Vpp(첨두치)는 파형의 전체 진동 폭이다. 따라서 최대치는 Vpp의 1/2, 즉 반주기의 진동 폭이 된다.- 위상차 측정주기 :360 DEG= 위상차 : 위상차(각도 ... .03486512575169측정사진5.PSpice 시뮬레이션(1) RC 직렬회로의 위상차(2) RL 직렬회로의 위상차6. 결과 검토(1) RC 직렬회로의 위상차(각도)의 실험 결과가 이론값
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    | 리포트 | 5페이지 | 1,000원 | 등록일 2014.12.11
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  • 자료 표지
    원형패치 안테나 제작설계
    패치의 구조 시뮬레이션 과정 분석 제작 과정 실험 결과 및 고찰원형 패치 안테나 ? What is 송수신 간에 통신 조건을 자유롭게 하는 장점을 가지는 안테나 2012-2013 ... 력을 다룰 수 없다 . 2. 가격이 고가이다 . 3. 파형 커플링 존재 4. 전송 가능한 대역폭이 좁다 .설계 기초 - Network Analyzer 회로망분석기 또는 NA ... 를 기점으로 파형이 급격하게 변화 포트 너비를 5mm 일 때 이득이 좋다 . 그라운드에 원형 슬롯을 하였을 경우 이득 값이 급격히 낮아짐 소자를 추가 하였을 경우 이득 값이 감소1
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    | 리포트 | 17페이지 | 1,500원 | 등록일 2013.11.18
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  • 자료 표지
    결과 실험5. 능동 필터회로
    ) 차단 주파수를 측정하여 기록하라.1차 저역 통과 필터PSpice를 통한 1차 저역 통과 필터 회로 시뮬레이션오실로스코프 입출력 파형 결과(주파수가 100Hz 일 때)오실로스코프 입 ... 2차 저역 통과 필터 회로 시뮬레이션오실로스코프 입출력 파형 결과(주파수가 100Hz 일 때)오실로스코프 입출력 파형 결과(주파수가 200Hz 일 때)오실로스코프 입출력 파형 ... 가 5KHz 일 때)오실로스코프 입출력 파형 결과(주파수가 10KHz 일 때)f (Hz)오실로스코프 결과PSpice를 통한 시뮬레이션Vin (V)Vout (V)이득 A (V/V)A
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    | 리포트 | 12페이지 | 4,000원 | 등록일 2012.03.11
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    아주대 전자회로실험 결과6 선형 레귤레이터 회로
    전압의 값이V _{I`N} CONG (1+ {R _{2}} over {R _{3}} )`V _{REF}인 것이다.우리가 실제 실험한 값을 살펴보면 우선 시뮬레이션에서 R2=10K ... Ω 의 저항을 사용했었는데 실제 실험에서는 R2=1KΩ의 저항을 사용하였다. 왜냐하면 우리는 입력전압의 변화 그래프를 측정하기 위해서 파형발생기의 삼각파를 이용하였는데 Vp-p값 ... 있었다. 먼저 입력전압에 따른 shunt전류 I _{s}의 변화를 살펴보았다. 이번 실험에서도 역시 입력전압을 파형발생기의 삼각파를 이용하기위해 저항 R4=1KΩ으로 놓고 실험
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    | 리포트 | 4페이지 | 1,500원 | 등록일 2014.10.05 | 수정일 2017.08.03
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  • 자료 표지
    전자회로실험7 MOSFET 기본 특성 I 예비보고서
    RC 회로를 구성 한 후 주파수 발생기로 10kHz의 주파수 그리고 0-5V값, 구형파를 인가 하였습니다. 그에 따른과을 한 주기에 대해 시뮬레이션 한 결과 위와 같은 파형 ... u=8.9u 이 나왔습니다. 따라서 위와 같은 시뮬레이션 파형 결과를 얻었고,= 2.2RC = 7.46u R= 100K 이므로 C=33.9pF을 얻을 수 있습니다.3) MOSFET ... 산화막의 두께를 추출하게 된다.? 시뮬레이션을 통해 게이트 산화막의 두께를 추출할 수 있다.? Breadboard 연결에 관한 유의사항? 연결선은 가능한 짧게 하여 노이즈를 피하
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    | 리포트 | 6페이지 | 1,000원 | 등록일 2012.06.24
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  • 자료 표지
    전자회로실험 실험9 dc모터 속도 제어 및 측정 결과보고서 후반부
    에 따라 1, 0으로 깨끗하게 변하는 것을 확인 할 수 있었습니다. 시뮬레이션 결과와 마찬가지로 7404 소자에는 글리치가 발생하고, 7414는 깨끗한 파형이 나옴으로써 좀 더 오작동 ... 와 같이 시뮬레이션 결과 파형을 얻을 수 있었는데, 위에서부터 차례대로 QA QB QC QD의 출력을 확인하였으며, 밑으로 내려갈수록 점점 더 폭이 늘어나는 결과를 확인할 수 있 ... 후, 400Hz, 5Vpp의 정현파를 SN7414와 SN7404에 인가하여 출력 파형 특성의 차이를 알아보는 실험입니다. 결과 사진부터 살펴 보면, 두 소자의 차이점이 확연히
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    | 리포트 | 7페이지 | 1,500원 | 등록일 2013.04.25
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  • 자료 표지
    아주대 전자회로실험A+보고서 [결과3] 미분기 적분기
    .88V- 시뮬레이션 결과 출력 파형의 최대값은 약5.5V이고, 최소값은 약-5.7V인 것을 확인 할 수 있다. 즉가 약 11.2V인 것이다. 이것은 실험에서의 측정치 보다는 조금 ... 는보다 낮은 주파수에서만 미분기로 동작하게 되는데, 그래서 입력파형의 주파수를 400Hz로 실험하게 되었다. 따라서 주기는 2.5ms가 되었고, 이는 시뮬레이션값과 이론값 둘다 거의 ... 로 고정하고 출력을 측정하여 그 파형을 그린다.(3) 출력 파형의 ±를 측정하여 기록한다.(4) 출력 파형의 전압이 -인 주기와 +인 주기를 측정하여 기록하여라.전압은 125mV
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    | 리포트 | 6페이지 | 2,000원 | 등록일 2011.12.21
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  • 자료 표지
    1. Voltage follower
    를 100[㎐], 10[Vpp] 정현파를 입력단자에 인가했을 경우 입력전압 Vi와 출력 전압Vo의 파형을 오실로스코프로 관측하고 기록하라. Pspice에 의한 시뮬레이션 결과와 비교 ... ]PSpice시뮬레이션 결과 100[kHz]PSpice시뮬레이션 결과 100[kHz]…10[Vpp]일때와 마찬가지로 주파수가 높아질수록 파형의 일그러짐이 보이지만, 10[Vpp]에 비 ... 검토하시오PSpice시뮬레이션 결과오실로스코프 결과? 함수발생기의 주파수를 1~50k[㎐]로 변화시키면서 출력 전압의 크기를 측정하고 그 결과 를 검토하시오. Pspice에 의한
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    | 리포트 | 10페이지 | 1,000원 | 등록일 2012.08.05
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2025년 11월 22일 토요일
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