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전자회로실험 전자회로설계실습 다단 증폭기 과제 고급전자회로실험 oscillator 설계 능동 2차 Lpf 결과 클리퍼 클램퍼 공통이미터
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"시뮬레이션파형" 검색결과 1,541-1,560 / 3,209건

  • 자료 표지
    인덕터 및 커패시터를 이용한 전압-분배 회로와 전류-분배 회로
    다.오실로스코프의 CH2(채널2)를L _{2} 양단에 접속하여 출력 파형을 관찰하라.입력 파형과 출력 파형을 오실로스코프의 CRT 화면에 동시에 띄어 이들 파형의 진폭을 비교하라.-실험 결과 ... 파형을 관찰하라.입력 파형과 출력 파형을 오실로스코프의 CRT 화면에 동시에 띄어 이들 파형의 진폭을 비교하라.-실험 결과가 준비 에서 계산한 값과 잘 일치하는지 확인하라.-준비 ... 로 시뮬레이션 한 결과를 그림 (e)에 나타냈다. 시뮬레이션이제대로 동작하도록 즉, 플로팅 에러를 방지하기 위해R _{6}를 첨가하여C _{2}와 병렬로 연결했다.- 책에 나온 회로
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    | 리포트 | 4페이지 | 1,000원 | 등록일 2014.06.01
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  • 자료 표지
    실험5 삼상 위상제어 정류기
    시뮬레이션(Psim tool사용)을 행한다.2. 시스템 구성2.1. 과제1-삼상 반파 위상제어 정류회로: R 부하2.1.1. schematic 및 설정-점호각 20°출력전압을 측정하기 ... 습니다.이러한 점호각 설정에 맞춰 그 후 사이리스터 점호각 alpha 를 각각 20°, 140°, 260°를 입력하였습니다. 즉, 시뮬레이션은 처음에 30°의 위상각이 추가되어서 시작 ... 합니다. 출력전압이 0인 것을 개선하기 위해서 세 번 째 사이리스터에 100°를 입력하였으나 변화가 없는 것을 알 수 있었습니다. 이것은 시뮬레이션이 30°, 즉 시간이 0
    Non-Ai HUMAN
    | 리포트 | 13페이지 | 2,000원 | 등록일 2015.06.12
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  • 자료 표지
    [제어공학실험] [전기전자실험] 제어대상의 계단응답,임계이득 및 주기측정
    V _{pp}, 100Hz를 사용한다. 3.2의 전달함수를 이용하여 매트랩 시뮬레이션 및 Pspice 시뮬레이션에 의함 파형도 함께 나타내고 이들로부터 구한 각각의 값들을 비교 ... 에서 측정한 이득을 이용하여 전달함수를 구하고 매트 랩 시뮬레이션 및 Pspice 시뮬레이션에 의한 파형도 함께 나타내고 이들로부터 구한 각각의 값을 비교 검토하시오.K _{p}=43P
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    | 리포트 | 11페이지 | 1,500원 | 등록일 2014.12.29
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  • 자료 표지
    VLSI 설계 및 프로젝트 실습 (인하대학교 전자공학과) XOR, MUX Layout Simulation 결과 보고서
    시뮬레이션 결과① XOR 직접 작성한 NETLISTXOR회로의 동작은 A와 B가 같을 때 0이 되고, 다를 때 1이 되야 한다.위 결과파형에서 A=B일 때, 즉 A=1, B=1인 ... 의 Layout을 그려보고 Layout에서 기생소자를 추출하여 기생소자를 포함한 NETLIST와 직접 작성한 NETLIST를 HSPICE로 시뮬레이션하여 그 결과를 비교하는 것이 ... 다.2. 실험과정이번 실험은 크게 아래와 같은 단계로 진행되었다.① 회로 설계 (NETLIST 직접 작성)② HSPICE로 시뮬레이션③ Magic tool을 이용한 Layout 생성
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    | 리포트 | 21페이지 | 2,000원 | 등록일 2015.09.30
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  • 자료 표지
    VerilogHDL 가산기 정의와 카르노맵, 논리회로, TB 시물레이션,파형분석과 고찰
    면 carry_out이 상승하는 것을 알 수 있다.설계와 테스트벤치는 Verilog 언어를 이용하여 모델링 되었으며, 시뮬레이션으로 논리동작을 검증하고 결과 파형을 분석하여 설계 ... . Sumulation3. 파형분석과 고찰1비트의 연산을 할 수 있는 전가산기인데 , 전가산기의 Carry In과 Carry out 을 연결하여 여러 비트 병렬 2진 가산기를 설계 ... 하고 결과값을 확인하였다.[2] 4bit full Adder Module & TB1. 코드소스2. Simulation3. 파형분석과 고찰전가산기(Full Adder)는 3 개의 입력
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    | 리포트 | 13페이지 | 1,500원 | 등록일 2015.05.08
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  • 자료 표지
    서강대 고급전자회로 실험 - 실험1 소신호 증폭기 결과보고서
    1 kHz),R _{L} = 10 k를 연결한다.a) 입력 전압 진폭 (25 mV, 50 mV, 100 mV)에 따른v _{OUT} 파형? 시뮬레이션- 25mV일 때최댓값 : 1 ... 고급전자회로 실험 예비/결과 보고서실험 1. 소신호 증폭기분반학번이름조학번이름시작종료실험시작/종료시간 기재(통계 목적임)예비보고서는 아래 양식에서 ‘1. 실험결과’에 시뮬레이션 ... 구성하되, 입력 신호v _{SRC}와R _{L}은 연결하지 않는다.a) 실험회로 1의 DC 바이어스 전압? 시뮬레이션 회로도? DC 바이어스 전압, 전류바이어스V _{B} (V)V
    Non-Ai HUMAN
    | 리포트 | 12페이지 | 2,000원 | 등록일 2015.06.18 | 수정일 2015.06.24
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  • 자료 표지
    PUT와 수동소자를 이용한 톱니파발진기
    uF1100kΩ 가변120kΩ110kΩ168kΩ1200kΩ12-2 Block Diagram2-3 시뮬레이션Multisim을 이용한 회로 시뮬레이션회로파형V _{max}-1.92VV ... ---p.22-3 시뮬레이션 -------p.32-4 설계 회로 -------p.43. 설계 결과 및 분석3-1132Hz 톱니파 발진회로 측정결과 -------p.53-2 VR ... 가 방전하여 전압이 낮아짐. 그 결과 애노드 전압이 게이트 전압 보다 훨씬 낮아져 PUT가 차단됨. 콘덴서가 다시 충전되므로 위 상태를 반복해 연속적인 파형을 발생시킴. 단 저항
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    | 리포트 | 10페이지 | 1,500원 | 등록일 2014.06.30
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  • 자료 표지
    기초전자회로실험 예비, 결과 레포트(반파 정류기와 반파 피크 정류기)
    두 번째 실험은 첫 번째 실험에서 발견된 출력전압의 문제점. 즉, 맥동하는 전압파형으로 인하여 전자 회로를 위한 직류 공급 전압으로 사용할 수 없다는 단점을 보완하기위해, 출력 ... 을 이용하여 시뮬레이션 했던 모양이 그대로 나왔는데, 모양이 예쁘게 나오지 않아 애를 좀 먹었다. 이번 실험을 통해 반파 정류기의 단점을 커패시터를 이용하여 반파 피크 정류기를 만들어 리플 전압이 작을수록 출력 전압은 더 직류에 가깝게 할 수 있다는 것을 알았다.
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    | 리포트 | 2페이지 | 1,000원 | 등록일 2014.12.23 | 수정일 2015.05.07
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  • 자료 표지
    기초전자회로실험 예비, 결과 레포트(가중 가산기와 차등증폭기, 반전적분기)
    이번 실험은 가중 가산기와 차동 증폭기, 반전 적분기 회로의 입력 전압과 출력 전압 파형을 측정하는 실험이었다. 예비레포트 시뮬레이션 결과에서 예상했던 것처럼 가중 가산기회로
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    | 리포트 | 2페이지 | 1,000원 | 등록일 2014.12.23 | 수정일 2015.05.07
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  • 자료 표지
    파형정형회로 결과보고서
    } 의 파형 비교 (YT 모드)XY 모드를 이용한 출력 파형시뮬레이션 결과, YT모드 일 때V _{IN} (CH A)의 최대, 최소값은 ± 5 V,V _{out} (CH B)의 최대 ... 실험번호실험제목제출일제출자실험조학번이름13파형정형회로2012년5월 24일4200811179김선윤200811236김태완1. 실험 목적다이오드의 비선형 특성을 이용하여 2포트의 입력 ... 전압과 출력전압 사이에 비선형 전달특성을 갖는 파형 정형회로를 구현할 수 있다. 본 실험에서는 이러한 비선형 파형 정형회로의 전압전달곡선에서 꺾이는 점과 기울기 등 전달곡선의 모양
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    | 리포트 | 3페이지 | 1,000원 | 등록일 2013.12.18 | 수정일 2016.07.16
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  • 자료 표지
    서강대 고급전자회로 실험 - 실험5 Multiplier 결과보고서
    mV, 주파수 1 kHz)를 인가한다.a)v _{B3},v _{OUT1} 측정v _{B3}? ,v _{OUT1} 파형* 시뮬레이션 결과v _{B3}진폭 : (1.1465-1.1266 ... .742원을 공급하였다.a)v _{B1},v _{OUT1} 측정v _{B1}? ,v _{OUT1} 파형* 시뮬레이션 결과v _{B1}진폭 : (2.9243-2.9210)/2=1.65 ... ] 과 같이 구성하되v _{SRC}는 인가하지 않는다.a) DC 바이어스 조건 및 전압이득? 시뮬레이션 회로도? DC 바이어스 조건 측정- 시뮬레이션 측정 결과바이어스V _{OUT1} (V
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    | 리포트 | 17페이지 | 2,000원 | 등록일 2015.06.18 | 수정일 2015.06.22
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  • 자료 표지
    VLSI 설계 및 프로젝트 실습 (인하대학교 전자공학과) Half Adder,Full Adder (HA,FA) Layout Simulation 결과 보고서
    하였다. 하지만, 다른 실험과 마찬가지로 지연시간이 좀 더 긴 것을 확인할 수 있었다.③ Full Adder 직접 작성한 NETLIST직접 작성한 Full Adder를 시뮬레이션 결과파형 ... 로 시뮬레이션하여 그 결과를 비교하는 것이다.2. 실험과정이번 실험은 크게 아래와 같은 단계로 진행되었다.① 회로 설계 (NETLIST 직접 작성)② HSPICE로 시뮬레이션 ... ③ Magic tool을 이용한 Layout 생성④ Layout을 추출하여 기생 소자 추출⑤ Layout을 추출하여 얻은 NETLIST를 HSPICE로 시뮬레이션⑥ 두 시뮬레이션의 결과
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    | 리포트 | 15페이지 | 2,000원 | 등록일 2015.09.30
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  • 자료 표지
    MultiSim 을 이용한 회로 모의 실험 보고서
    .절점의생성회로 시뮬레이션회로를 시뮬레이션 하기 위해서는 툴바의 [Run]->[Stop simulation]버튼을 클릭하거나 단축키인 F5를 클릭하면 된다. 또 다른 방법은 상단 ... A 갖고있는데, Commom단자는 신호 파형을 기준 레벨을 제공한다.signal optionsFrequency (1Hz~999MHz) : 주파수 세팅Duty Cycle(1%~99 ... /하강2채널 오실로스코프2채널 오실로스코프는 2개의 채널을 이용하여 시간에 따른 신호의 파형을 실시간으로 관찰할수있다.1)Timebase 설정2)채널 설정3)트리거(Trigger
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    | 리포트 | 23페이지 | 2,500원 | 등록일 2015.06.06
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  • 자료 표지
    FPGA를 이용한 디지털 시스템 설계(인하대) 16bit Full Adder 보고서 (verilog코딩)
    에 해당하는 결과 파형을 확인할 수 있다.아래는 1bit full adder 테스트벤치코드의 시뮬레이션 결과이다.각 가로 실선의 단위는 5ns이며 총 25ns만큼 시뮬레이션하였다.왼 ... 를 이용하여 1bit , 4bit fulladder를 설계하고 최종적으로 16bit fulladder를 설계한 후 시뮬레이션하는 것이었다.2. 실험과정 및 소스코드16bit ... 에서 작성한 코드를 실제 ModelSim화면에서 컴파일한 결과와 시뮬레이션한 결과를 살펴보려 한다.6가지 코드를 작성한 후에 컴파일을 하였더니 Library에 각각에 해당하는 모듈
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    | 리포트 | 12페이지 | 2,000원 | 등록일 2015.09.25
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  • 자료 표지
    실험03-1 기본선형증폭기
    width) -> 주기 1000 us의 반PER = 100 us (period) -> 1 / (10 kHz) = 100 us- 시뮬레이션 시간500 us각 파형의 크기(V_{ pp ... width) -> 주기 1000 us의 반PER = 100 us (period) -> 1 / (10 kHz) = 100 us- 시뮬레이션 시간500us각 파형의 크기(V_{ pp ... PER = 1 ms (period) -> 1 / (1 kHz) = 1 ms시뮬레이션 시간5ms (주기의 5배로 설정)각 파형의 크기(V_{ pp})각 파형의 주기(ms)rise
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    | 리포트 | 12페이지 | 1,000원 | 등록일 2014.02.02
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  • 자료 표지
    위상편이발진기 (Phase Shift Oscillator) 프로젝트 보고서
    을 찾아 보았습니다.(R=56Ω, R₂=1.7kΩ) (R=68Ω, R₂=2.2kΩ), (R=82Ω, R₂=2.4kΩ)각 저항들을 넣어 시뮬레이션을 돌려본 결과는 다음과 같 ... 습니다.시뮬레이션엔 모두 uA741 Op-amp를 사용하였습니다.Simulation 결과1번. (R=56Ω, R₂=1.7kΩ)Frequency = 9.61kHzAmplitude = 15.46 ... 하였지만, 어떤 이유에선지 동작하지 않아서 급히 세 번째인 3번. (R=82Ω, R₂=2.4kΩ) 으로 다시 구현하였습니다.아래는 2번 회로 구성 사진입니다.파형이 나오지 않아 3번
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    | 리포트 | 7페이지 | 1,000원 | 등록일 2015.01.20
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  • 자료 표지
    기초전자공학실험1 RC, RL 미적분회로
    치에 over {tau }} (13)종합하면 RC 충전/방전회로의 저항의 전압, 캐패시터의 충전/방전 전압과 전류의 파형을 살펴보면[그림6]과 같다.○ RL충전회로의 전류, 전압 특성 ... +... 입력 파형이 정현파일 경우에 대해 미분회로를 해석해 보자.`````````````````````````````````````````````````````````````V ... .00002tau=0.00001tau=0.00000196tau=0.00000166tau=0.0000016. Experimental Results실험1. RL 미분회로시뮬레이션측 정결
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    | 리포트 | 60페이지 | 1,000원 | 등록일 2014.07.09
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  • 자료 표지
    실험 7결과 MOSFET 기본 특성 1
    )를 전압 0-5V, 주파수 5Hz로 입력한다. V _{OUT}에는 스코프의 CH2를 연결한다.출력파형이 10%-90%로 변하는 Rise-time을 측정한다. Rise-time 측정 ... 에 관한 내용은 별첨부록을 참조한다.CH1, CH2 각각에 입력, 출력 파형이 모두 나타나도록 조절한다. CH2의 경우, 화면에 펄스 하나가 표시되도록 시간 knob을 조절 ... _{R}을 측정한다. 마찬가지로 90%-10%로 감소하는 fall-time t _{F}을 측정한다.- 출력 파형을 기록한다.- t _{R}, t _{F}을 기록한다. (선형 캐패시터
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    | 리포트 | 4페이지 | 1,000원 | 등록일 2014.09.30
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  • 자료 표지
    32 33과 발진기회로 예비
    이 인가되면 낮은 전압이 출력된다.두 개의 기준전압의 사이에 신호가 인가되면 출력은 일정하게 유지된다.실험회로 및 시뮬레이션 결과실험1. 위상편이 발진기 / PSPICE 32-1a ... DC 전압을 바꿧을때의 변화는 거의 존재하지 않는다.h. 회로에 대한 AC sweep해석을 수행하라i. probe 도면에 phase 파형을 도시하여라.j. 이들 두 전압간 위상차 ... 33-1 회로를 구성하라.b. 오실로스코프를 사용하여 출력파형을 관측하여 그림 33-4에 기록하라.c. 한 사이클에 해당하는 시간을 측정하라.T = 1.9 – 1.57 = 0.33
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    | 리포트 | 9페이지 | 1,500원 | 등록일 2015.10.26 | 수정일 2016.08.09
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  • 자료 표지
    아주대 전자회로실험 설계결과3 SECOND ORDER FILTER 설계
    Magnitude response아래 사진 첨부아래 사진 첨부아래 사진 첨부사각파 인가 후 주파수 변화 출력 파형X아래 사진 첨부X[측정 파형](1) Band Pass Filter최대 ... 510Hz540Hz600Hz700Hz[측정 파형](2) High Pass Filter최대 출력전압 일 때 Vpp와 주파수차단주파수 f _{c}3dB Bandwidth20dB ... Band300Hz400Hz500Hz1000Hz[측정 파형](3) Low Pass Filter최대 출력전압 일 때 Vpp와 주파수차단주파수 f _{c}3dB Bandwidth20dB
    Non-Ai HUMAN
    | 리포트 | 7페이지 | 1,500원 | 등록일 2014.10.05 | 수정일 2017.08.03
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2025년 11월 22일 토요일
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