"플러스연산"의 검색결과 입니다.

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암기노트 연산증폭기 특성 op amp 가산기 결과 컴활2급 자료구조 균쌤 적분기 및 미분기 op amp의 기본 특성 printf 비트

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"플러스연산" 검색결과 681-700 / 10,535건

컴퓨터구조 ) 전자계산시의 논리회로에서 조합논리회로와 순서논리회로의 차이점을 제시하고 구조 및 특징을 제시하시오.

회로(logic gate)란 불 대수를 물리적 장치로 구현한 것으로, 여러 개의 논리적 입력값에 대하여 연산을 수행함으로써 하나의 출력값을 얻는 전자회로를 의미한다. 논리 회로 ... 등을 기본으로 하여 논리 연산을 수행하는 것을 의미한다. 조합 논리 회로는 입력 신호를 통해 출력을 결정하므로 기억 기능이 없으며, 반가산기, 반감산기, 전가산기, 전감산기 ... 를 조합논리식S=AB+AB=A?BC=AB반감산기는 2진수 1자리에서 두 개의 Bit를 빼고, 그 차이를 산출하는 방법으로 다음과 같이 표현 가능하다.진리표XYDB

리포트 | 5페이지 | 3,000원 | 등록일 2023.01.25

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시립대 전전설2 Velilog 결과리포트 4주차

분석 및 고찰결론참고 문헌1. 실험 목적- Xilinx ISE 프로그램에서 Verilog를 이용하여 연산회로를 설계하고 프로그래밍 해본다.2. 배경 이론- 연산회로(1) 덧셈 ... 는 방법이 같다.2) 연산회로 종류(1) 반가산기 : 두 개의 입력 비트(A, B)를 더하여 합(S)과 자리 올림 수(C)를 산출하는 논리 회로.(2) 전가산기 : 두 개의 입력 ... 의 input이 A와 B일 때, A-B는 A+(-B)와 같다. 즉, XOR게이트를 아래 그림과 같이 이용하여 가산기에서 사용한 자리올림의 입력비트 Cin을 1로 넣어주면 B의 값

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| 리포트 | 14페이지 | 1,000원 | 등록일 2021.04.16

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전자회로실험 예비보고서6 삼각파 발생회로 Triangle Wave Generator

전자회로실험 예비보고서6 삼각파 발생회로 Triangle Wave Generator1. 실험 목적-연산증폭기를 이용한 비교기, 적분기의 동작을 기초로 한 구형파 및 삼각파 발생 ... 회로의 동작을 이해할 수 있다.2. 실험 이론1) 함수파 발생회로-오른쪽 그림에서 연산증폭기 A1은 슈미트회로, A2는 적분회로이다.-A1의 출력 ②의 전압은 正, 負 어느 쪽이 ... 든지 구형파 포화전압+- V_osat이다.-②의 전압이+V_osat일 때 : 이 전압은 ②, ③ 사이의 저항 R을 지나 A2에 반전단자 ③에 가해지고 A2는 적분회로이므로 출력 ④의

Non-Ai HUMAN
| 리포트 | 5페이지 | 1,000원 | 등록일 2021.04.04

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건국대학교 전기전자기초실험2 펄스폭변조회로 결과레포트

전기전자기초실험2 결과보고서 – 펄스 폭 변조 회로학번이름실험 1. 레벨 쉬프트 회로그림 1-1의 회로를 구성하시오. (연산증폭기 LM358)그림 1-1 레벨 시프트 회로실험 ... 을 위하여 구성한 회로의 사진을 첨부한다.그림 1-1 회로를 구성한 뒤 연산증폭기에 ±5V를 입력하고 Vin에 함수발생기로 1Vpeak, 1kHz 정현파를 입력 후 오실로스코프로 입력 ... =12kΩ, R3=10kΩ, C=100nF)VREF에 아래의 전압을 -2.5V, +2.5V를 각각 인가하여 VTRI와 Vout 전압 파형을 오실로스코프로 도시하시오.[-2.5v일 때

리포트 | 10페이지 | 4,500원 | 등록일 2024.12.26

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[A+] 중앙대학교 아날로그및디지털회로설계실습 9차 예비보고서

*************00110110010101011100111111전가산기는 입력 A, B와 이전 연산의 carry bit Cin을 더하여 생긴 합 S와 그때 발생한 carry bit Cout을 출력한다.(B ... 은 아래와 같은 과정을 통해 XOR 연산으로 간소화할 수 있다.2. Cout 의 Karnaugh 맵(K-map)ABCin000111100001010111Cout의 Karnaugh ... 의 boolean 식은 아래와 같이 XOR 연산으로도 간소화할 수 있다.(C) (B)에서 구한 간소화된 불리언 식에 대한 2-level AND-OR(NAND-NAND) 또는 OR-AND(NOR

리포트 | 8페이지 | 1,000원 | 등록일 2024.02.17

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22장 능동 필터 회로 실험

} =( {X _{c}} over {sqrt {R ^{2} +X _{c}^{2}}} )V _{IN }만일 연산증폭기의 내부 차단주파수가 저역통과 필터의 차단주파수f _{c ... _{out} =V _{p} =( {R} over {sqrt {R ^{2} +X _{c}^{2}}} )V _{IN }앞에서 언급한 바와 같이 모든 연산증폭기는 그 내부에 RC회로 ... 능동 필터 회로 실험◎실험개요- 본 실험은 전압이득이나 임피던스 특성을 유지하기 위하여 트랜지스터나 연산증폭기와 같은 능동소자로 구성되는 여러 가지 능동 필터의 구성과 동작원리

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| 리포트 | 12페이지 | 1,000원 | 등록일 2020.12.19

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아주대 전자회로실험 실험6 삼각파 발생회로 예비보고서

_{i}가V _{TH} (=V _{P} )보다 작은 경우 연산증폭기의 입력이 양의 값을 가지게 되어 출력으로+V _{sat}을 출력하는 안정적인 상태가 된다. 하지만, 입력전압V ... 수명:분 반:학 번:성 명:실험6 예비보고서- 삼각파 발생회로 -1. 실험 목적- 연산증폭기를 이용하여 비교기, 적분기 동작을 기초로 한 구형파 및 삼각파 발생회로를 구성한다. ... , 15kΩ, 20kΩ저항 각 1개4) 축전기 : 0.1μF 1개5) 연산증폭기 : OP-Amp(uA741C) 2개SymbolParameterUA741CUnitV _{CC

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| 리포트 | 6페이지 | 1,000원 | 등록일 2021.07.22

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OP Amp 결과

%커패시터와 저항의 측정값의 오차가 거의 없는 것으로 볼 수 있다.2-110배의 이득을 가지는 기본 반전 연산 증폭회로로, 주기를 작게 놓으면 조밀하게 진동을 하고 있어 눈 ... 으로부터 감소하는 모습을 보이는데, 연산 증폭기의 고역 주파수 응답은 고역 주파수에서의 회로 이득에 의존한다는 것을 알 수 있다. 이것은 회로 이득이 0db일 경우 들어가는 것과 나오는 값 ... 임계점과 고역 주파수 임계점을 모두 확인 할 수 있다.2-62-1 실험은 반전 연산 증폭기고 2-6의 실험은 비반전 연산 증폭기로 2-1의 입력과 출력이 반대로 나타남을 2-6

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| 리포트 | 6페이지 | 1,000원 | 등록일 2022.06.17

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c언어에 대한 가장 중요한 장점에 대하여 작성하시오

를 이해하는 데에도 매우 유익하다.더불어, C언어는 다양한 다른 언어들의 기반이 되는 언어로 평가된다. C++은 물론, Java, Python, C# 등의 현대적 언어들도 C언어 ... 적인 가치를 체계적으로 조명하고자 한다.본론C언어의 가장 중요한 장점은 바로 '하드웨어 친화성과 효율성'이다. C언어는 메모리 제어, 포인터 연산, 비트 단위 조작 등 하드웨어 ... 이 필수적이다.뿐만 아니라, 현대적인 인공지능(AI) 기술에서도 고속 연산을 필요로 하는 부분은 여전히 C언어 또는 그 파생 언어들로 작성되고 있다.예를 들어, 머신러닝 프레임워크 중

리포트 | 3페이지 | 6,000원 | 등록일 2025.04.18

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광운대학교 전기공학실험 M2. 아날로그 및 디지털 기초 회로 응용 예비레포트 [참고용]

같다. 식 I1 = I2 + I3가 성립한다.3-1-2. 전압법칙(KVL): 기준전류방향을 따라 한 루프내에서의 전압의 합은 0이다. 그림 2에서 한 루프내에 흐르는 전류 I1=I ... 2=I3=I4와 각 저항에 의해 정의된 전압을 모두 더했을 때 0이라는 값이 나오며, 식 V - R3*I - R2*I2 + R1*I1 = 0이 성립한다.3-2. 가산기3-2-1 ... . 반가산기(HA): 올림수 없이 단지 두수를 더하는 가산기(An, Bn > Cn, Sn)진리표를 보면 C는 올림수이므로 1+1의 올림수 1이 나타나며, 반가산기의 합과 올림수의 대한

리포트 | 8페이지 | 1,500원 | 등록일 2024.01.02

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아주대학교 기초전기실험/기전실/ 실험 DC 13 14 결과보고서

{LEFT | 2.15-2.11 RIGHT |} over {2.15} TIMES 100%=1.86%테브난 ? 노턴 등가 저항 연산R _{N} =R _{1} DLINE R _{2} ` ... +`R _{3} = {3284.40 TIMES 325.88} over {3284.40+325.88} +216.09`( ohm )#``````````#```````````=296.46` ... _{th}/R _{N} 으로도 구할 수 있다.1. 전압 분배에 따라V _{th}를 유도E _{th} =12 TIMES R _{2} /(R _{1} +R _{2} )=#12 TIMES

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| 리포트 | 10페이지 | 1,000원 | 등록일 2021.07.01

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고려대학교 일반대학원 화학과 연구계획서

발광 연구, CO2를 연산화제로 사용하는 Pt-희토류 금속간 화합물에 대한 에탄 산화 탈수소화 연구, 페닐보론산과 수은종의 비가역적 반응을 이용한 아미노산 기반 형광화학농도측정기 ... 포스파타제 1의 공유 결합 억제를 위한 표적 부위 식별 연구, CO2에서 C2+로의 전기변환을 위한 금속-유기 구조 나노입자로부터 생성된 입자 경계가 풍부한 구리 나노촉매 연구

자기소개서 | 1페이지 | 3,800원 | 등록일 2024.06.23

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2020년 2학기 방송통신대학교 방통대 컴퓨터과학개론 기말과제

=*a+1;은 곧 i=i+1;가 되는 것이다. 즉, 연산 수행 시 a뿐 아니라 i값까지 변경된다.두 예시 모두 1을 증가시키는 연산은 동일하지만, plusone 함수 ... 내에서 표현할 수 있는 가장 큰 수는 +7이며 가장 작은 수는 으로 -7이다.부호화-크기 방법은 계산이 복잡하다는 단점과, -0이 존재할 수 있다는 단점을 갖는다.2의-보수 방법 ... 한 실수를 표현할 수 있으며, 소수점이 고정되어있지 않기 때문에 고정 소수점 표현에 비해 넓은 범위의 수를 표현할 수 있다. 연산속도가 느리다는 단점이 있다.고정 소수점

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| 방송통신대 | 6페이지 | 5,000원 | 등록일 2021.04.24

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[논리회로설계실험]VHDL을 활용한 CLOCK설계

의 process를 이용하여, 7segment의 값들을 각각 지정하고, 클럭의 시간을 연산하여, 현실의 1초가 지날 때 마다 segment의 값이 바뀌도록 구현한다. 각각 ... egment를 이용하여 숫자를 나타내게 된다. VHDL에서 코딩과정은 시간의 각 자리숫자를 하나씩 연산하여 나타내게 되는데, 각 자리 숫자가 나타나는 시간 간격이 매우 짧아(50 ... us) 우리 눈에는 동시에 모든 자리 숫자가 연산 되어 나타나는 것으로 보인다. 매우 짧은 시간동안 계속해서 값을 연산하여 7segment에 나타나지만, 우리 눈은 LED가 항상 켜

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| 리포트 | 12페이지 | 2,000원 | 등록일 2021.06.26

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자동 변속 기어 LED 스마트 자전거(캡스톤디자인 아이디어)

충전 어플을 통한 매일 섭취량 확인1. 자동차 자동 변속 기어 + → 경사면 기울기를 마그네틱 센서가 인식하여 자동으로 기어 변속 기존 자동차의 자동 변속 기어를 자전거에 접목 ... 를 내면서 변속을 한다 . 엑스시프터는 시프트 케이브을 잡아 당겨 변속하는 식으로 기존 기계식 변속기를 그대로 사용한다 . + 자동으로 기어 변속 시켜주는 내용과 사물인터넷을 접목 ... 플로 위의 내용 등을 보도록 고안5. 자전거 도난 방지기 + 라커를 강제로 뜯으려고 할 시 기존의 경보음이 울리는 도난 방지기에서 지속적인 라커의 흔들림 , 압력 감지를 통해 LED

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| 리포트 | 16페이지 | 2,500원 | 등록일 2022.12.06

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[방송통신대학교]알고리즘_동영상강의,기출_핵심요약노트

※ 알고리즘동영상 강의 + 최근 기출(방송통신대학교 KNOU 기준) 핵심 요약 ... (nonterminal) 노드 : 리프 노드가 아닌 것들레벨 : 루트 노드로부터의 거리(루트 노드의 레벨 : 0)트리의 높이(깊이) : 가장 큰 레벨 + 1숲 : 루트 노드를 잘랐 ... (n) = 2T(n/2) + Θ(n), T(1)=Θ(1)Θ(nlogn)합병 정렬의 수행 시간퀵 정렬의 최선 수행 시간2.T(n) = T(n-1) + Θ(n), T(1)=Θ(1)Θ

방송통신대 | 30페이지 | 3,000원 | 등록일 2023.04.09

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Verilog HDL을 이용한 Mu0 프로세서 구현 프로젝트 (코드, ModelSim결과 포함)

할지, 뺄지, +1증가시킬지 결정하여 출력한다.ACC: accumulator 누산기라고도 하며, ALU에서 출력된 연산 결과를 저장하고, memory로 전달하는 역할을 한다 ... 하여 시뮬레이션 하여 Mu0를 검증한다.Mu0 의 동작을 확인한 후 일련의 동작을 하는 Task를 동작시킨다.Task는 수열의 합인 (N>=S)를 구하는 것입니다. 수식을 풀어 설명하자면= S ... +(S+1)+(S+2)+ … +(N-1)+N 을 구하는 것이 task의 주된 동작이라고 할 수 있습니다.위 동작을 하는 task를 assembly언어로 작성하면,주소

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| 리포트 | 16페이지 | 8,200원 | 등록일 2021.01.03

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컴퓨터공학개론 중간 시험 정리

← AC + DRAC_누산 레지스터 : 연산장치의 입출력 데이터를 임시적으로 기억하는 레지스터DR_자료 레지스터 : 연상에 필요한 피연산자를 저장하는 레지스터AR_주소 레지스터 ... 하는 기술* 증강현실(AR) : 현실 세계에 컴퓨터 기술을 합성한 기술* 혼합현실(MR) : 현실과 가상의 공간을 융합한 것 (가상현실 + 증강 현실)* 확장현실(XR) : 가상현실 ... , C++, C#, Jaba 가 있다.*기계어 : 0과 1로 표현한 컴퓨터 고유 명령 형식 언어*어셈블리어 : 기계어를 자연어와 유사하게 만든 것0-3) (134p) 주소컴퓨터

시험자료 | 6페이지 | 1,500원 | 등록일 2024.12.29

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디시설, 디지털시스템설계 실습과제 11주차 인하대

었다. 그리고 test = test + 1 문장을 작성하여 20ns 마다 test의 최하위 비트부터 1씩 더해지도록 연산을 진행했다.waveform을 살펴보면(왼쪽에 포트부분의 캡쳐가 잘렸 ... 을 사용해 그대로 표현해 주었고 carry 신호는 연산 시작 시 입력하는 첫번째 cin을 제외하고 N개의 신호가 존재하므로 i = 1부터 N까지로 설정해서 c[1] 부터 생성 ... 배만큼 test포트를 선언했다. 20ns마다 1비트씩 더하기 1 연산을 진행해주기 위해서 test 포트의 하위 4비트는 4비트 y로, 이어지는 상위 4비트는 x로 할당해주

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| 리포트 | 9페이지 | 1,500원 | 등록일 2021.08.31

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배열(Array)로 구현한 스택(Stack) 구조

하는 곳 역시 메모리 말단입니다. 스택의 추상자료형에 대해 알아보자면 다음과 같습니다. 입력 연산을 Push라고 하며, 조회 연산은 Peek라고 합니다. 이 때, 조회 연산을 처리 ... 시킵니다.// 그리고 스택의 현재 topNum 값에 요소를 추가합니다.topNum ++;StackName[topNum] = TempElement;}}pop( StackName, TempElement

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| 리포트 | 4페이지 | 1,000원 | 등록일 2022.03.27 | 수정일 2024.04.17

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