"논리회로실험 결과레포트"의 검색결과 입니다.

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전전설2 레포트 FPGA 사칙연산 논리 아주대 논회실 verilog 시계 전전설3 NOT OR AND 게이트 verilog 동기 비동기

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"논리회로실험 결과레포트" 검색결과 21-40 / 557건

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[디지털 논리회로 실험] 9장. 인코더와 디코더 결과레포트

논리회로실험 A반결과9장인코더와 디코더5조이름학번실험일15.04.07제출일15.04.14전원전압 4.89VHD74LS04P , HD74LS08P , HD74LS32P , SN74 ... 하고 출력을 관찰하라.실험 9.2 2X4 디코더(1)_논리게이트를 이용하여 2X4 디코더의 회로도를 나타내었다. 회로도에 IC 핀번호를 입력하라.(2)_다음과 같이 입력 값을 인가 ... LS47P실험 9.1 4X2 인코더(1)_로직 게이트 IC들을 이용하여 4X2 인코더를 구성한 회로도이다. 회로도에 IC 핀번호를 작성하라.(2)_다음과 같이 입력 값을 인가

Non-Ai HUMAN
| 리포트 | 2페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2022.10.13

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[디지털 논리회로 실험] 16장. 동기식 카운터 결과레포트

논리회로실험 A반결과 보고서16장동기식 카운터5조이름학번실험일15.06.02제출일15.06.09측정 전압 ? 4.90V실험에 사용된 기기 및 부품 : 오실로스코프(CRO) 혹은 ... 의 최대값(15 _{10})가 되면 1이 된다.회로가 너무 복잡하여 실험도중 오류를 찾기가 힘들었다. 점프선이 너무 부족하여 회로를 구성하는데 힘들었고 점프선이 너무 복잡해 연결하기 ... 도 힘들었다. 실험을 통하여 동기식 다운 카운터의 회로구성과 동작원리를 알 수 있었으며, 동기식 2진 업, 다운 카운터의 동작원리를 알고, 74163의 동작원리도 알 수 있었다.

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| 리포트 | 3페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2022.10.09

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[디지털 논리회로 실험] 7장. 가산기와 감산기 결과레포트

논리회로실험 A반결과7장가산기와 감산기5조이름학번실험일15.04.07제출일15.04.14전원전압 4.89V실험 7.4 전가산기 회로다음 전가산기 회로를 결선하고, 출력 S와C ... =1, B=1이다.실험 7.8 전감산기 회로다음 전감산기 회로를 결선하고, 출력 D와B _{0}을 측정하여 표를 완성하라.입력출력(D)출력(B _{0})XYB측정값논리값측정값논리값 ... 다.THEREFORE A+B+CI=S+C0A=0,B=1,CI=1 이라면 0+1+1=10이므로 자리올림 BO=1, S=0이다.실험 7.5 반감산기 회로(XOR 사용)다음 반감산기 회로를 결선

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| 리포트 | 2페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2022.10.13

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[디지털 논리회로 실험] 17장. MOD-N 카운터 결과레포트

논리회로실험 A반결과17장MOD ? N 카운터5조이름학번실험일15.06.09제출일15.06.19브레드 보드 전압 : 4.91V실험에 사용된 기기 및 부품 : 오실로스코프, SN ... 이 됨을 알 수 있다.실험 17.3 74163을 이용한 MOD ? 5 카운터(1) IC 74163(4Bit 2진 업 카운터) 및 논리게이트를 이용한 MOD ? 5 카운터 회로의 회로도 ... (1) IC 74163(4Bit 2진 업 카운터) 및 논리게이트를 이용한 MOD ? 3 카운터 회로의 회로도이다.회로도에 IC 핀번호를 작성하여라.(2)Q _{B},Q _{A

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| 리포트 | 3페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2022.10.13

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[디지털 논리회로 실험] 15장. 비동기식 카운터 결과레포트

논리회로실험 A반결과 보고서15장비동기식 카운터5조이름결과실험일15.06.02제출일15.06.09측정 전압 ? 4.90V실험에 사용된 기기 및 부품 : 오실로스코프(CRO) 혹은 ... 모서리마다 출력이 반전함을 알 수 있다.실험15.3 비동기식 10진 업 카운터(1) IC 7476(Dual JK Flop-Flop) 2개를 이용한 비동기식 10진 업 카운터회로 ... 를 사용하니 회로가 너무 복잡하였다. 회로가 너무 복잡하여 오류가 나도 찾기도 힘들고 점프선을 연결하기조차 힘들어서 실험을 여러번 반복해야 했다.비동기식 3Bit 다운 카운터

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| 리포트 | 3페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2022.10.13

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[디지털 논리회로 실험] 8장. 보수와 병렬 가, 감산기 결과레포트

논리회로실험 A반결과8장보수와 병렬 가?감산기5조이름학번실험일15.04.07제출일15.04.14전원전압 4.89V, SN74LS83실험 8.3 2의 보수를 이용한 4비트 2진 가 ... 이 일정한 저항값을 같지 않았기에 측정한 실험마다 모두 다른 결과 값을 갖게 되었다.- 참고문헌 -디지털 논리실험 본 교재 제 8장http://www.engineerclub.in/2014/04/vhdl-code-for-bcd-adder.html(이미지출처) ... _{2}A _{1} -B _{4}B _{3}B _{2}B _{1}이 된다.실험 8.4. BCD 가산기다음과 같이 BCD 가산기 회로를 결선하라. 또한 표에서 2진수 입력 값을 완성

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| 리포트 | 3페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2022.10.13

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[디지털 논리회로 실험] 12장. 동기식 RS 플립플롭 결과레포트

논리회로실험 A반결과12장동기식 RS, JK 플립플롭5조이름학번실험일15.05.12제출일15.05.26실험에 사용된 기기 및 부품 : SN74LS74AN, 직류전원공급장치 ... , 디지털 실험장치, 전압계실험 12.2 7476 IC를 이용한 하강모서리 플립플롭의 동작(1) IC 7476(Dual JK Flip-Flop)을 실험하기 위한 회로도 이다. 회로도 ... ?111010?111101?111110?111101실험 12.3 7476 IC를 이용한 상승모서리 JK 플립플롭 구성(1) IC 7476(Dual JK Flip-Flop)를 이용

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| 리포트 | 2페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2022.10.13

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[디지털 논리회로 실험] 11장. 비동기식 RS 플립플롭 결과레포트

논리회로실험 A반결과12장비동기식 RS 플립플롭5조이름학번실험일15.05.12제출일15.05.12실험에 사용된 기기 및 부품 : HD74LS02P, HD74LS04P, HD74 ... LS00P실험 11.1 NOR 게이트를 이용한 비동기식 RS 플립플롭1. NOR 게이트를 이용하여 비동기식 RS 플립플롭을 구성한 회로도에 핀 번호를 작성하라.2. 다음과 같이 입력 ... ="11" 인 경우에는 출력 값을 결정할 수 없는 불확실(Unknown)상태가 된다.실험 11.2 NAND 게이트를 이용한 비동기식 RS 플립플롭1. 논리 게이트를 이용하여 비동기식

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| 리포트 | 2페이지 | 1,000원 | 등록일 2016.01.14 | 수정일 2017.10.17

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[디지털 논리회로 실험] 13장. 동기식 D, T 플립플롭 결과레포트

논리회로실험 A반결과13장동기식 D, T 플립플롭5조이름학번실험일15.05.26제출일15.06.02실험에 사용된 기기 및 부품 : 오실로스코프, HD74LS74AP, GD74LS ... 76AN,, 직류전원공급장치,디지털 실험장치, 전압계실험 13.2 D 플립플롭 응용(1) IC 7474를 이용한 지연회로의 회로도 이다. 회로도에 IC 핀번호를 작성하여라.(2 ... 력 Q=0이된다.실험 13.3 T 플립플롭 응용(1) IC 7476(Dual JK Flip-Flop)를 이용한 T 플립플롭의 회로도이다. 회로도에 IC핀 번호를 작성하라.(2) Q

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| 리포트 | 3페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2022.10.13

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논리회로 실험 Bistable or flip-flop[예비 + 결과] 레포트

한다. 다. J-K 마스터-슬레이브 플립플롭의 동작특성을 이해한다2. 기본 이론(배경 이론) 플립플롭이란 Clock 신호에 의해 입력신호에 의한 출력을 얻을 수 있는 회로 ... 로 CLK이 인가되기 전에는 전에 상태를 그래도 유지하는 기억회로이다. 또, 플립플롭의 입력 신호가 교류 결합 회로를 통하여 인가되는 형식의 것을 교류 결합 플립플롭, 직류 ... 결합 회로를 통하여 인가되는 형식을 직류 결합 플립플롭이라고 한다. 클록 펄스 입력 단자로 클록에 동기시켜 입력 신호를 주는 동기식의 플립플롭과 클록을 이용하지 않고 입력 신호

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| 리포트 | 6페이지 | 1,000원 | 등록일 2011.03.28

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논리회로실험 반가산기 결과레포트

모델링 방식 ⋅schemetic - 회로를 직접 설계하는 방법이다. 논리게이트를 불러와서 라인을 그려주면 된다. ⋅자료흐름 ... 다. xilinx tool 을 이용한 네가지 구현방법 - 회로구성, 자료흐름 모델링, 구조적 모델링, 동작적 모델링- 을 통해 반가산기를 만들어본다. 1.2 ... ource안의 시스템을 가져다쓴다. ⋅동작적 - if문, else문을 사용해 조건을 걸고 나아갈 경로를 지정해준다.3. 결과 검토 및 의견 반가산기를 네가지 방식으로 구현

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| 리포트 | 5페이지 | 1,000원 | 등록일 2008.01.14

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(ㅅㅅㄷ) 2-1 논리회로실험 예비+결과 레포트 모음입니다.

의 입력선으로부터의 2진식 정보를 최대 2n개의 독자적인 출력선으로 변환하는 조합회로이다. 예를들어 2X4디코더는 가장 간단한 디코더로서 회로는 아래와 같다. 3개의 인버터는 입력 ... 소항을 나타낸다..나. 엔코더 인코더는 디코더의 기능으로부터 반대되는 동작을 만들어 내는 디지털 회로이다. 인코더는 2(또는 그 이하)의 입력선과 n개의 출력선을 갖

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| 리포트 | 4페이지 | 3,000원 | 등록일 2011.03.28

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논리회로 실험(인코더, Latch & Flip Flop논리회로),래치와 플립플롭, 만점 결과레포트

실험 2. 7 segment 표시기를 갖는 BCD 카운터위 실험은 7490이라는 Decade Counter를 이용하여 7 Segment를 구동시키는 것이다. 7490에 Input ... egment를 순서대로 작동시킬 수 있는 것이다. 우선 회로를 동작시키기 위해서는 5V의 펄스파를 만들어야 한다. Function generator로 진폭 5V의 펄스파를 만드 ... 것이다.) 실제 실험에서 7490과 7447까지는 작동 하는 것을 오실로스코프로 확인해서 작동이 된다는 것을 알 수 있었지만, 실제 7 segment에서 a~f까지 핀배치를 몰라

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| 리포트 | 16페이지 | 2,000원 | 등록일 2008.02.28

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각종 그래프와 사진,수식이 첨부된 논리회로 실험 (BASIC GATE) 결과 레포트

를 측정한 결과③ Z를 측정한 결과※ 결과값은 A,B 값 오른쪽에 보이는데, 실험결과와 동일한 것을 알 수 있다.(4) 그림 3 (a)와 (b) 회로를 구성한 후 각 점 (X,,Y ... 한 것을 알 수 있다.◆ (b)- 회로3 (b)의 실험결과를 이용하여 Truth table을 그리면 다음과 같다.inputoutputABCXYUVW ... 하며 s다음과 같다.- 위 실험의 결과로 4개의 NAND gate로 XOR gate의 동작이 가능함을 알 수 있다.(6) 그림 4와 같이 각각의 회로를 구성한 후 그 결과를 측정

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| 리포트 | 13페이지 | 2,000원 | 등록일 2008.02.28

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논리회로 실험 결과레포트(가산기, 감산기, 디코더) 모든 그래프와 수식을 첨부한 레포트 입니다.

)InputOutput0000000101010010111010001101101101011111- 실제 회로 구성은 다음과 같이 하였다. (지면관계상 뒤에 실었습니다.)- 실험한 결과 ... 개와 출력 3개로 회로가 매우 복잡하다.-인수들은 왼쪽 식과 같은 위치를 가진다. 따라서 이를 참고하여 실험 결과를추측해 볼 수도 있다.- 위의 실험에 대한 각각의 출력치를 측정 ... 결과값을 다시 Not 시켜서 측정하면 된다. 아래의 회로는 이 식을 적용한 회로이다.- 실험에서 구성한 회로를 토대로 모든 입력에 대한 결과를 측정해서InputOutputXYB

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| 리포트 | 15페이지 | 2,000원 | 등록일 2008.02.28

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논리회로 실험 Latch & Flip-Flop 래치 & 플립플롭 결과 레포트

을 서약합니다.학 부: 전자공학부제출일: 07.10.13과목명: 논리회로 실험교수명: 박성진 교수님조: 10조학 번: 200320474 200320463성 명: 이준범 이영길실험 ... 었지만, 기 기능을 통제할 수 있느냐 없느냐에 따라서 두 회로의 차이점은 명확해 진다.실험 3. 예비과제 2에서 구한 J-K f/f 을 구성한 뒤 출력을 측정하고 결과를 검토하라 ... . 또 이 결과를 7476 침에 대한 측정 결과와 비교하라.《J-K F/F 회로 구성》《J-K F/F 실험 사진》INPUTOUTPUTJKQ1(t)Q2(t)00Q(t-1)Latch

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| 리포트 | 9페이지 | 3,000원 | 등록일 2007.10.14

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논리회로 실험(Negative Feedback 증폭기와 안정성) 모든 실험 내용과 데이터, 그래프 , 표등을 첨부한 만점 결과 레포트

의 직선성을 feedback이 있는 회로에서 좋아지는가? 그 이유는?- 위의 실험결과에서 보듯이, feedback이 있음으로 해서 직선성, 즉 linearlity가 좋아진다. 이것 ... (2), (3)과 실험 과정 (5)의 결과를 비교하여 보시오.? 실험과정의 결과는 피드백회로를 그대로 두고 회로의 특성을 구하였고, 실험과정 (5)는 피드백회로를 등가회로 ... 이득을 이용해서 회로의 증폭 안정성을 높여주는 것이라 하겠다. 그리고 이것은 전자회로에서 trade-off 현상이라고도 한다.6.4.2 실험 6-2 : 병렬-직렬(shunt-s

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| 리포트 | 16페이지 | 3,000원 | 등록일 2008.02.28

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[디지털 논리회로]HDL 디지털 논리 실험 결과 리포트 1장 2장 3장

1장만 요약해 놓습니다.2장 3장도 같은 구성입니다.▶실험 결과verilog 코드에서 작성한대로 50ns 간격을 두고 NAND,NOR 게이트에 신호가 바뀌어 들어가게 됩니다.코드 ... 인풋의 “NOR True table”을 따라 출력됩니다.▶Verlog코드(본문참조)▶결과 화면 캡쳐.(본문참조)▶토의2bit XOR 게이트를 이용 1bit 버퍼를 구현.

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| 리포트 | 4페이지 | 1,500원 | 등록일 2005.10.04

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논리회로 실험(다단증폭기,coupled amplifier) 모든 수식과 그래프, 사진을 첨부한 만점 결과레포트

mV의 차이가 발생한다.- 실험결과 : 위상차는 없었고, 약간의 진폭차를 확인할 수 있었다.② capacitor앞뒤의 진폭과 위상차- 위상차 : 최대점이 되는 시간이 같으므로 위상 ... 차는 없다.- 진폭차 : 최대점에서 약 0.769mV의 차이가 발생한다.- 실험결과 : 위상차는 없었고 약간의 진폭차를 확인할 수 있었다.③ capacitor앞뒤의 진폭과 위상차 ... - 위상차 : 0.5ms의 시간차가 생긴다. 즉 0.5ms/100ms = 5mrad의 위상차가 발생한다.- 진폭차 : 취대점에서 4.692mV의 차이가 발생한다.- 실험결과 : 0

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| 리포트 | 20페이지 | 3,000원 | 등록일 2008.02.28

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논리회로 실험(Shift Register & Ring Counter & Counter)시프트 레지스터 ,링카운터, 카운터 에관한 실험데이터 및 모든 내용을 첨부한 만점 결과 레포트

논리회로실험 7. Shift Register & Ring Counterⅰ. Parallel In / Serial Out(1) IC 1의 핀 2와 7에 연결된 PR 단자를 접지 ... 에서와 같은 내용이라 실험하는데 큰 무리는 없었다.※ Ring Counter를 실험하면서 생각하였는데, 이 카운터는 논리회로에서 배운 내용인 1-out-of-ncode를 사용하기에 적절 ... 한 unter와 잘 맞을거란 생각이 들었다.논리회로실험 8. 카운터ⅰ. 7476 J-K 플립플롭을 이용하여 예비 과제에서 구한 4단 2진 count-up 리플 카운터를 구성하고각

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| 리포트 | 11페이지 | 5,000원 | 등록일 2008.02.28

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