"논리회로실험"의 검색결과 입니다.

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verilog 전전설2 논리회로 텀프로젝트 실험12 멀티플렉서 vhdl 디지털회로실험 라인트레이서

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"논리회로실험" 검색결과 2,581-2,600 / 4,693건

디지털실험 8 결과 실험 8. CMOS-TLL interface

다. 실험 5의 회로에 뒷부분만 추가하면 만들어 진다.결과로 (1)번과 (4)번을 비교하기 위한 사진. 1이 NOR되서 0이되고 그 0이 다기 NOT되서 1이 되는 것을 보면 논리동작 ... 디지털 실험 결과보고서실험 8. CMOS-TLL interface실험 결과실험 1의 회로이다. CMOS NOR소자이다. 소자의 동작 범위를 보기 위한 실험이다.소자가 제대로 동작 ... .2V4.2V0의 회로를 구성하고, V _{DD}(핀 14번)를 +10[V]로 연결하고, 입력값에 따른 출력을 살펴보고, 또한 +5[V]로 연결하여 살펴보아라.실험 2의 회로이

리포트 | 9페이지 | 1,000원 | 등록일 2014.09.30

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VLSI 설계 및 프로젝트 실습 (인하대학교 전자공학과) CMOS AND,OR Layout Simulation 결과 보고서

를 비교하는 것이다.2. 실험과정이번 실험은 크게 아래와 같은 단계로 진행되었다.① 회로 설계 (NETLIST 직접 작성)② HSPICE로 시뮬레이션③ Magic tool을 이용 ... VLSI 설계 및 프로젝트 실습 REPORTCMOS AND, OR Layout 및 Simulation1. 실험목표이번 실험의 목표는 Magic Tool을 이용하여 CMOS AND ... 회로와 OR회로의 Layout을 그려보고 Layout에서 기생소자를 추출하여 기생소자를 포함한 NETLIST와 직접 작성한 NETLIST를 HSPICE로 시뮬레이션하여 그 결과

리포트 | 11페이지 | 2,000원 | 등록일 2015.09.30

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멀티플렉서(MUX)와 비교기(Comparator)설계

하여 출력단과 연결하는 역할을 한다.S0S1F00I001I110I211I3S1I0I1I2I3FS04X1 MUX4X1 MUX 회로도4X1 MUX 구성4X1 MUX 진리표2. 관련 기술 및 ... 이론(2) 비교기(Comparator) · 두 입력이 서로 같은지 또는 다른지를 비교(Compare)하여 알려주는 회로. · 1-bit 비교기는 두 입력이 같으면 '1'을 출력 ... 하고, 다르면 '0'을 출력하는 회로. · 1-bit 비교기에서는 단순히 입력값이 같은지 다른지만 판단해서 출력했다면 bit수를 좀 더 늘려 4-bit 비교기에서는 같은 값 뿐

리포트 | 13페이지 | 1,500원 | 등록일 2010.06.24

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서울시립대학교-전자전기컴퓨터설계실험2-제09주-Lab08-Post

Design @ 7-segment and Piezo Control, 서울시립대학교.Datasheet - HBE-Combo II-SE VHDL과 Verilog HDL을 이용한 디지털 논리 회로 설계-XILINX-090508, 한백전자 기술연구소. ... Post-lab Report전자전기컴퓨터설계실험Ⅱ9주차. Application Design 7-segment and Piezo Control실험 날짜2016. 11.07학번이름

리포트 | 8페이지 | 1,500원 | 등록일 2017.09.04

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PLC-곽정석

-기초전기전자실험PLC 실험학과(학부)기계공학부제출일자2013. 11. 21과목기초전기전자실험학번B201300186반A이름곽정석(1) PLC 언어의 종류에 대해 조사하시오 ... 기 위하여 Enable 신호를 입력(EN)과 출력(ENO)으로 가질 수 있다.- LD(Ladder Diagram : 래더 다이어그램)1)특징 : 회로도를 그대로 사용할 수 있는 구조이 ... 며, 형식은 회로도의 형식을 따른다. 즉, 기존 하드와이어 로직을 소프트웨어 형태로 입력하는 소프트와이어 방법을 사용한다. 래더 언어는 크게 릴레이 로직 명령 군과 데이터 처리

리포트 | 10페이지 | 1,000원 | 등록일 2016.06.06

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전자전기컴퓨터설계실험2(전전설2)4주차결과

신호 처리기 등등을 시뮬레이션 가능하게 한 프로그램이다.나. HBE-ComboⅡ-SEHBE-ComboⅡ-SE 장비란 FPGA를 이용한 디지털 논리회로 설계 실습을 위한 장치 ... 한 회로를 실험할 수 있다. 또한 FPGA 디바이스를 모듈화 하여 xilinx의 모듈이 장착 가능하고 디바이스로 호환하여 사용할 수 있다. 설계과정에서 사용하는 클럭의 입력은 1MHz ... 위의 결과값을 통해 논리 회로를 만들어보면 1bit 감산기는 다음과 같다.나. module instance 설계 시 주의할 점앞서 4bit 비교기에서 있어서 맨 왼쪽 bit

리포트 | 19페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10

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2019 한국수력원자력 공채 상반기 합격자소서

회전 참관을 통한 실무에서의 기본적인 업무를 확인할 수 있었으며두 번째 시퀀스제어는 전기전자팀에서 배가 움직이게 하는 터빈에 달려있는 전동기의 3상 교류전압 논리회로 즉, 시퀀스 ... 회로에 관한 기본적인 구상도를 배울 수 있었습니다. 이를 통해서도 전기직군의 전반적인 실무에 관해 지식을 쌓을 수 있는 경험이 되었습니다.이는 한국수력원자력의 직무 중 전력설비 ... 의 하위 프로그램인 QUANSER를 사용하여 Qball을 제어하고 있습니다. 이에 관련되어 자동제어, 전기공학 및 실험2 과목을 이수하여 MATLAB에 관련된 프로그램 숙달을 위한

자기소개서 | 5페이지 | 3,000원 | 등록일 2020.06.20

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전자전기컴퓨터설계실험2(전전설2)6주차결과

을 시뮬레이션 가능하게 한 프로그램이다.나. HBE-ComboⅡ-SEHBE-ComboⅡ-SE 장비란 FPGA를 이용한 디지털 논리회로 설계 실습을 위한 장치로 회로에서 많이 사용 ... 되는 Switch, LED와 같은 주변 장치를 위주로 구성하여 장비의 크기를 간단하게 만든 모델이다. 가장 큰 특징으로는 Breadboard를 가지고 있어 다양한 회로를 실험할 수 있 ... 해놓고 실험을 하였다.Ⅴ. 결론 (Conclusion)순차회로의 원리를 알고 특히 sipo를 이용하는 실험이었다. 지난번 실험이었던 invert bcd to excess-3를 응용

리포트 | 13페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2017.02.10

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AND, OR, NOT, NAND, NOR 및 EXCLUSIVE-OR 게이트

논리 회로 실험(예비 레포트)학과학번이름(0) 실험 제목◆ AND, OR, NOT, NAND, NOR 및 EXCLUSIVE-OR 게이트(1) 실험 목적◆ AND, OR, NOT ... , NAND, NOR 및 EXCLUSIVE-OR 게이트의 기능을 공부한다.◆ 게이트의 회로기호, 진리표 및 부울대수에 의한 논리 함수의 표현방법을 공부하고, 세이트의 기능 측정 ... ’을 출력하며 논리합이라 한다. 논리식으로 나타내면 다음과 같다.Z=A+B=A∪B◆ OR 게이트의 진리표와 회로기호는 다음과 같다.입력출력ABZ000011101111OR게이트의 진리표

리포트 | 6페이지 | 1,000원 | 등록일 2008.09.17

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디지털실험 3예비 2비트 전가산기

디지털 실험 예비보고서실험 3. 2비트 전가산기실험 목적1. 반가산기와 전가산기의 원리를 이해한다.2. 가산기를 이용한 논리회로의 구성능력을 키운다.이론2진 연산(Binary ... 의 2진 digit가산은 합 digit와 자리올림 digit의 2개의 digit로 결과가 얻어진다.반가산기(Half Adder)2진 덧셈을 살펴보면 2-입력(A,B)의 논리회로 ... gate)전원공급기, 함수발생기, 오실로스코프실험 방법1.다음 회로를 구성하고 진리표를 작성하라ABCS0000010110011110실험 1의 회로도와 시뮬레이션 결과이다. 1비트

리포트 | 7페이지 | 1,000원 | 등록일 2014.09.30

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DSP실험 lab2

적으로 처리하는 논리회로를 말 한다.2. 신호처리에 특화되어있다1.부동 소수점(Floating-point) 연산을 통합 해서 직접 데이터 형태로 처리한다. 높은 수준의 병렬 처리 ... < DSP 실험 - LAB02 >1. fixed point number는 2진법 표시의 데이터로, 가정 소수점의 위치를 고정하여 수치를 표시한 데이터이다. 반면에 floating

리포트 | 3페이지 | 1,000원 | 등록일 2016.09.20

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Verilog HDL

Pre-Lab Report- Title: Lab#03_Verilog HDL -담당 교수담당 조교실 험 일학 번이 름목 차1. Introduction (실험에 대한 소개 ... & Basis of the assumption2. Materials & Methods (실험 장비 및 재료와 실험 방법)가. 실험을 통해 구하고자 하는 데이터와 이를 획득하기 위한 ... 실험 순서나. Materials (Equipment’s, Devices) of this Lab다. Matters that require attentions3. Supposed

리포트 | 57페이지 | 1,000원 | 등록일 2016.04.06

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디지털실험및설계 예비(플립플롭)

디지털 논리실험 및 설계#2 플립플롭 (예비)담당교수님 : 교수님제출일자 : 2015. 03. 23조 :학번 :이름 :1. 실험 이론순서논리회로에를 구성하는 기본소자이며, 흔히 ... 1비트의 정보를 저장하는 회로를 플립플롭이라고 한다. 플립플롭은 두 개의 안정된 상태를 출력으로 갖는다. 이때 출력 값이 상반된 상태에 있다. 종류에는 RS 플립플롭, D 플립플롭 ... , T 플립플롭, JK플립플롭 등이 있다.(1) 기본 RS 플립플롭기본적인 RS 플립플롭은 두 개의 NAND게이트로 회로를 만들 수 있다. 여기서 S와 R은 set과 reset

리포트 | 10페이지 | 1,500원 | 등록일 2015.12.05

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순서논리회로 1 플립플롭 예비보고서

■실험의 목적- 이번 실험은 순서논리회로 1: 플립플롭 이라는 실험이며, 순서논리회로의 기반이 되는 플립플롭의 동 작 원리를 살펴보고 전반적인 이해를 도모 하도록 하는 실험입니다 ... 하자면 4가지 종류가 있으며, 그 입력회로의 구성에 따라서 RS플립플롭, D플립플롭, T플립플롭, JK플립플롭 등으로 구분됩니다.■실험의 세부적인 이론 및 방향(1)RS 플립플롭 ... .■실험의 이론- 우선 실험의 이론을 살펴보자면, 플립플롭은 0과 1, 이 두 개의 안정된 상태를 출력으로 갖습니다.이 때 두 개의 출력은 항시 상반된 상태에 있으며, 한 쪽

리포트 | 1페이지 | 1,500원 | 등록일 2014.11.28

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디지털실험 2결과 논리 게이트

디지털 실험 결과보고서실험 2. 논리 게이트실험 결과실험 1.SN 7408로 회로를 결선하고, 1) B=0, 2) B=1, 3) B=open 상태에 대하여 진리표를 작성하라.사진 ... =0A=1, B=open 일 때 Y=0B=open의 회로이다. 그냥 단자를 허공에 띄워놓았다.실험에서 측정된 결과를 보면 AND 소자의 특성대로 잘 측정된 것을 볼 수 있 ... 다. open했을 때는 0을 입력해 주었을때와 결과가 같았지만 왠지 파형이 조금 떨리는 것 같기도 하다.실험 2. 4입력 AND 게이트의 진리표를 작성하라.사진설명실험 2번의 회로이다. 1

리포트 | 8페이지 | 1,000원 | 등록일 2014.09.30

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[A+보고서] 아주대 전자회로 실험 - 예비4 정궤환회로

하는데 최선을 다할 것을 서약합니다.학 부: 전자공학부제출일: 2014.04.03과목명: 전자회로 실험교수명: 최 연 익분 반: 목 8.5학 번: 200920149성 명: 이 승 목실 ... 험4. 정궤환회로1. 실험 목적- 연산증폭기를 사용한 정궤환 회로를 구성하여, 슈미트 트리거(Schmitt trigger)회로의 특성을 관찰하고, 이를 이용한 사각파 발생기를 구성 ... ), 가변저항(1kΩ), 연산 증폭기3. 실험 이론1) 슈미트 트리거 회로- 안정된 두 가지의 상태를?가지고?있고, 쌍안정 멀티바이브레이터와 같이 상반된 두 가지의 동작 상태를?가지

리포트 | 5페이지 | 1,000원 | 등록일 2015.04.06

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디지털실험 설계1 결과 7447소자의 등가회로 설계

디지털실험 결과보고서설계1. 7447소자의 등가회로 설계실험 결과아래의 PLA회로를 구성하고 그 기능이 7447소자(7세그먼트 디코더)의 등가인지 7세그먼트로 확인위의 회로 ... (7447소자에 입력을 준 실험 4번의 결과)위와 같은 결과를 나오게 하는 것이 이번 실험의 목표였다.고찰이번 실험은 디코더와 PLA, ROM 에 대해 이해하고 목적에 맞는 회로를 구성 ... 하는 방법을 익혀서 SN7447(BCD to 7-Segment 디코더)의 등가회로를 구성하는 실험이었다. 설계에는 디코더를 이용한 방법과 PLA를 이용한 방법이 있었는데 선 열결

리포트 | 3페이지 | 1,000원 | 등록일 2014.09.30

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서울시립대학교 전자전기컴퓨터설계실험2 제04주 Lab03 Pre

.Datasheet - HBE-Combo II-SE VHDL과 Verilog HDL을 이용한 디지털 논리 회로 설계-XILINX-090508, 한백전자 기술연구소. ... Pre-lab Report전자전기컴퓨터설계실험Ⅱ4주차. Verilog HDL실험 날짜2016. 9. 26학번이름Professor조교실험 소개실험 목적HDL(Hardware ... Description Language)를 이용한 AND 및 NAND Gate 설계를 해보고, Verilog HDL 문법을 익힌다.실험에 필요한 배경 지식Verilog HDLHiLo

리포트 | 8페이지 | 1,500원 | 등록일 2017.09.04

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디지털 시스템 실험 Simple Computer 1 - Data Path 예비보고서

Circuit은 입력 A,B에 대해 {S1,S0}의 Selection Bit에 따라 AND, OR, XOR, NOT의 논리 연산을 수행하는 회로이다. 다음은 Logic Circuit ... 디지털 시스템 설계 및 실험 예비 보고서작성자:학번:실험조:실험일:실험제목Simple Computer - Data Path실험목표1. 컴퓨터 시스템의 기본적인 구조를 이해한다.2 ... }의 입력을 통해 8가지의 산술 연산을 수행한다.Arithmetic Circuit은 다음과 같은 회로 구성을 통해 구현할 수 있다.4.1.2 Logic CircuitLogic

리포트 | 10페이지 | 1,000원 | 등록일 2016.04.08

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디지털논리설계 카운터설계

디지털 논리 설계실험번호실험일시학번성명디지털시계1. 목 적(1)디지털시계를 논리게이트를 이용하여 디지털시계를 설계하고 구성한다.(2)디지털시계를 위해서 필요한 구성논리게이트 ... 은 디지털 시계를 설계하기 위해서 기본적으로 필요한 것이 무엇인지 살펴보았고, J-K F/F과 논리 게이트를 이용하여 회로를 설계했다.MAXⅡPLUS를 이용하여 기본전인 논리 연산 ... 의 특징을 이해한다.(3)논리게이트를 이용하여 디지털시계를 설계함으로 설계의 개념과 설계 과정을 이해한다.2. 이 론?J-K 플립플롭?J-K플립플롭 의 진리표와 여기표?10진 카운터

리포트 | 10페이지 | 1,000원 | 등록일 2015.01.22

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