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위상 측정 디지털시스템실험 논리 전력거래소 아두이노 전기회로 기초디지털실험 아주대 labview 전전설2 시립대 전전설1
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"디지털실험 결과" 검색결과 221-240 / 13,977건

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    A+ 디지털 시스템 실험 FPGA 및 Verilog의 이해, Verilog를 통한 FPGA 프로그래밍 방법 이해 <디지털 시스템 실험 2주차 결과보고서>
    디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 및 실험 결과보고서디지털 시스템 설계 및 실험 2016 전기전자공학부이름 :학번 :실험제목FPGA ... 을 FPGA를 통해 검증한다.실험결과1) MODULE 1의 예제구현하게 될 논리 회로이다. 베릴로그 코드Model Sim을 통해 시뮬레이션 하기위한 TB 코드토의2주차 실험은 간단한 논리 ... 회로를 베릴로그로 코드한 후, 시뮬레이션으로 확인하는 실험이다.TB코드에는 처음에는 A,B,C,D가 0에서의 결과값과 A,C에 1이 들어간 후의 결과 값 마지막으로 B,D에 1
    Non-Ai HUMAN
    | 리포트 | 3페이지 | 1,500원 | 등록일 2017.01.01 | 수정일 2017.01.04
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    A+ 디지털 시스템 실험 기본적인Combinational Circuit <3주차 결과보고서>
    디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 및 실험 결과보고서디지털 시스템 설계 및 실험 2016 전기전자공학부이름 :학번 :실험제목기본적인 ... 한다.② Binary-to-BCD Convertor 설계한다.실험결과2-to-4 라인 디코더이다. 00일 때부터 11일 때의 D0~D4 출력 값 을 보여주고 있다.3-to-8 라인 디코더이 ... Combinational Circuit① Decoder 설계② Binary-to-BCD Convertor 설계실험목표① 2-to-4, 3-to-8 라인 디코더를 설계
    Non-Ai HUMAN
    | 리포트 | 4페이지 | 1,500원 | 등록일 2017.01.25 | 수정일 2017.07.06
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    A+ 디지털 시스템 실험 Sequential Circuit 설계 및 구현 <7주차 결과보고서>
    디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 및 실험 결과보고서디지털 시스템 설계 및 실험 2016 전기전자공학부이름 :학번 :실험제목 ... Sequential Circuit 설계 및 구현실험목표① 동기식 UP/DOWN 카운터를 설계한다.② 카운터를 이용한 Sequential Circuit을 설계한다.실험결과1. 동기식 UP ... FPGA 결과토의이번 실험은 6주차 실험 결과를 이용해 Up/Down 카운터를 설계하고 이를 응용하는 회로를 설계해 보는 실험이었다. Up/Down 카운터는 JK 플립플롭 4개를 이용
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    | 리포트 | 8페이지 | 1,500원 | 등록일 2017.07.05
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    A+ 디지털 시스템 실험 Latch & Flip-Flop <6주차 결과보고서>
    디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 및 실험 결과보고서디지털 시스템 설계 및 실험 2016 전기전자공학부이름 :학번 :실험제목 ... 을 이용하여 BCD Ripple Counter를 설계한다.실험결과1. SR Latch 설계[그림 1] SR Latch 시뮬레이션 결과 (입력 : S,R,CLR | 출력 : Q,Q_n ... egment 구현 코드에서 Binary to BCD 부분을 삭제하고 BCD Ripple counter를 추가해 한 모듈로 만들고 FPGA 보드에 올려 실험 결과를 확인했다. CLR
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    | 리포트 | 11페이지 | 1,500원 | 등록일 2017.07.05
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    디지털실험 10 결과 4-phase clock 발생기
    디지털 실험 결과보고서실험 10. 4-phase clock 발생기실험 결과1. 처럼 회로를 만들고, 클럭 입력에 구형파를 인가하라. 오실로스코프를 플립플롭 출력 Q _{A ... 기 때문이고 실험 1의 결과와 함께 해석해 보면 이 디코더의 결과는 AB순서가 아닌 BA의 최소항 순서로 결정된다. 실험 1을 보면 결과가 00인 경우의 다음 결과는 Q _{A}Q ... 로 디코더 출력이 결정되는 것을 알 수 있고, 아래의 두 번째 결과 사진을 보고 Q _{B}Q _{A}=11인 경우가 10인 경우보다. 클락 기준으로 한주기, 실험 1의 결과를 기준
    Non-Ai HUMAN
    | 리포트 | 6페이지 | 1,000원 | 등록일 2014.09.30
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    중앙대 실험 예비결과3-2 아날로그디지털 실험설계
    1V인걸로 보아 만족스런 결과를 얻었다고 생각된다.(2) Buck Converter① Buck Converter 회로를 구성한다.② PWM 제어회로를 이용하여 스위칭 신호를 넣 ... ㏀ 까지 실험을 하였으나 실험을 하는 중간 중간 세이브 하는 것을 잊어버려서 캡쳐하진 못했지만, 가변저항의 크기가 클수록 전압의 크기가 커지는 것을 알 수 있었다. 가변저항의 크기가 작
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    | 리포트 | 4페이지 | 5,000원 | 등록일 2013.12.06 | 수정일 2013.12.07
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    [디지털 논리회로 실험] 8장. 보수와 병렬 가, 감산기 결과레포트
    이 일정한 저항값을 같지 않았기에 측정한 실험마다 모두 다른 결과 값을 갖게 되었다.- 참고문헌 -디지털 논리실험 본 교재 제 8장http://www.engineerclub.in/2014/04/vhdl-code-for-bcd-adder.html(이미지출처) ... 논리회로실험 A반결과8장보수와 병렬 가?감산기5조이름학번실험일15.04.07제출일15.04.14전원전압 4.89V, SN74LS83실험 8.3 2의 보수를 이용한 4비트 2진 가 ... _{2}A _{1} -B _{4}B _{3}B _{2}B _{1}이 된다.실험 8.4. BCD 가산기다음과 같이 BCD 가산기 회로를 결선하라. 또한 표에서 2진수 입력 값을 완성
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    | 리포트 | 3페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2022.10.13
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    [디지털 논리회로 실험] 12장. 동기식 RS 플립플롭 결과레포트
    논리회로실험 A반결과12장동기식 RS, JK 플립플롭5조이름학번실험일15.05.12제출일15.05.26실험에 사용된 기기 및 부품 : SN74LS74AN, 직류전원공급장치 ... , 디지털 실험장치, 전압계실험 12.2 7476 IC를 이용한 하강모서리 플립플롭의 동작(1) IC 7476(Dual JK Flip-Flop)을 실험하기 위한 회로도 이다. 회로도 ... ?111010?111101?111110?111101실험 12.3 7476 IC를 이용한 상승모서리 JK 플립플롭 구성(1) IC 7476(Dual JK Flip-Flop)를 이용
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    | 리포트 | 2페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2022.10.13
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    인하대학교 전자공학과 전자회로실험2 결과보고서 ADC(아날로그 디지털 컨버터)
    전자회로실험2 결과보고서학과학년학번조성명전자공학과3학년121312822조김영호실험 제목ADC(Analog to Digital Converter)1. ADCADC는 Analog ... -to-Digital Converter의 약자이다. 아날로그 전기 신호를 디지털 전기 신호로 변환하는 전자 회로이다. 아날로그는 연속이고, 디지털은 discrete (정확히 ... 가 클수록 디지털 신호는 원래 아날로그 파형과 비슷할 것이고 더 고품질의 신호일 것이다. 하지만 데이터가 많아지기 때문에 통신을 할 경우 통신 속도가 더욱 빨라져야 할 것이다.2
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    | 리포트 | 6페이지 | 1,000원 | 등록일 2017.12.25
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  • 자료 표지
    서강대학교 디지털논리회로실험 8주차결과
    디지털논리회로실험실험8. Multiplier Design담당교수 : 김 영 록제 출 일 : 2013. 11. 12.(화)학 과 : 전자공학과성 명 :1. 실험 제목 ... Multiplier Design2. 실험 목적● 4 bit 곱셈기를 설계한다.● 설계한 곱셈기를 구현하여 동작을 확인한다.3. 실험 내용 및 결과분석① 구조설계● Multiplier의 구조 ... 게끔 summation을 수행한다. 이 때 Adder를 통과한 값들이 shift register를 통해 한 자리씩 Shift되어 더해지므로 원하는 결과값을 얻을 수 있게 해준다
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    | 리포트 | 5페이지 | 2,000원 | 등록일 2014.01.02
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    서강대학교 디지털논리회로실험 7주차결과
    디지털논리회로실험실험7. Finite State Machines담당교수 : 김 영 록제 출 일 : 2013. 11. 05.(화)학 과 : 전자공학과성 명 :1. 실험 제목 ... Machine을 구분하고 각각의 특성을 이해한다.● 비동기 Counter의 동작을 분석한다.3. 실험 내용 및 결과분석① Flip-Flop Conversion● D Flip ... Finite State Machines2. 실험 목적● Finite State Machine (FSM) 회로를 설계하고 분석할 수 있는 능력을 갖춘다.● Mealy와 Moore State
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    | 리포트 | 8페이지 | 2,000원 | 등록일 2014.01.02
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    서강대학교 디지털논리회로실험 6주차결과
    디지털논리회로실험실험6.Flip-flops and ShiftRegisters담당교수 : 김 영 록제 출 일 : 2013. 10. 29 (화)학 과 : 전자공학과성 명 ... , JK flip-flop의 동작원리를 이해한다.3) Shift register의 동작원리를 이해한다.2. 실험 결과1. SR latch의 회로를 TTL로 구현하고 입력값을 조작하여 그 ... 하여 출력 LED가 어떻게 반응 하는 지를 보았다.3. 결과 분석 및 토의이번 실험은 SR latch부터 flip/flop 까지 작동을 알아보고 이것을 응용하여 VHDL로 구현
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    | 리포트 | 5페이지 | 2,000원 | 등록일 2014.01.02
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    서강대학교 디지털논리회로실험 4주차결과
    디지털논리회로실험실험4. Mux, Demux, Comparator담당교수 : 김 영 록제 출 일 : 2013. 10. 08.(화)학 과 : 전자공학과성 명 :1. 실험 제목 ... 원리를 이해한다.● Exclusive-OR gate의 동작 원리와 비교기 구조를 이해한다.3. 실험 내용 및 결과분석① Tri-state buffer● Tri-state ... 된다. Inverter, AND, OR 등 비교적 간단히 표현된다. 실험시 진리표와 같은 결과를 얻어 내었다.▲ 그림 7. XOR또한 XNOR Logic을 Test한 결과 위의 진리표
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    | 리포트 | 9페이지 | 2,000원 | 등록일 2014.01.02
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    서강대학교 디지털논리회로실험 3주차결과
    디지털논리회로실험실험3. Decoders and Encoders담당교수 : 김 영 록제 출 일 : 2013. 10. 01.(화)학 과 : 전자공학과성 명 :1. 실험 제목 ... 0001011011101101110110111Target을 위와 같이 두고 만든 logic으로 실험한 결과값들이 위와 동일하게 출력되어 맞는 Logic임을 확인하였다. 실제 Gate들을 이용 ... 하여 TTL로 진행한 실험에서도 High-Low를 판정하여 같은 결과를 얻어내었다.② 7-segment Decoder● 위에서 구한 Logic Equation을 이용하여 Block
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    | 리포트 | 8페이지 | 2,000원 | 등록일 2014.01.02
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    서강대학교 디지털논리회로실험 9주차결과
    디지털논리회로실험실험9. Memory elements : ROM/RAM담당교수 : 김 영 록제 출 일 : 2013. 11. 19.(화)학 과 : 전자공학과성 명 :1. 실험 제목 ... . 실험 내용 및 결과분석① Step 1~7● 구현한 회로는 다음과 같다. 여기에서 중요하게 살펴봐야 할 신호는 DIP_SW[3..0]으로 입력해주는 FPGA[3..0]신호이다. 이 ... 가 select되게 되므로 16개의 data가 나올 것으로 예측되었다.▲ 그림 9.15실험결과 DIP_SW[3..0]신호를 한 번 변경할 때마다 /OE 와 /CE 신호에 연결
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    | 리포트 | 7페이지 | 2,000원 | 등록일 2014.01.02
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    서강대학교 디지털논리회로실험 5주차결과
    -adder 및 full-adder의 동작원리를 이해한다.● ALU (74x181) 소자의 기능을 이해한다.3. 실험 내용 및 결과분석① Arithmetic Comparator ... 1. 실험 제목 Arithmetic comparator, Adder and ALU2. 실험 목적● Arithmetic comparator의 동작원리를 이해한다.● Half
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    | 리포트 | 9페이지 | 2,000원 | 등록일 2014.01.02
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    디지털실험 11 - 멀티 바이브레이터 결과레포트
    ◈ 11장. 멀티 바이브레이터-결과 레포트-2조 2008065321권태영1. 실험 결과 및 정리← 400㎲ →←345㎲→○ 실험 1, 2 의 결과를 기입하라.- 위 파형은 LM ... .45 ∴ 45%○ 실험 3의 결과를 기입하라.- LM555 타이머의 동작을 나타내고 실험 1 의 결과와RA=RB=33㏀, C=0.01㎌을 사용한 점이 다르다.- 1번 실험 결과 ... 었다.우선 첫 번째 실험을 살펴 보면,파형은 LM555 타이머의 동작을 나타내고, 관측된 주파수 = 1.315 kHz계산결과 값은 (주파수 ==== 0.00138 × 10= 1.38
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    | 리포트 | 4페이지 | 1,000원 | 등록일 2012.03.09
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    디지털실험 2 - 논리게이트 결과레포트
    아 헤맸지만 디지털 공학에서 이론으로 배웠던 내용들을 다시 상기하여 논리회로를 보았더니 훨씬 수월하게 진행되었다. 시간상 못하였던 실험들은 시뮬레이션 결과를 통해 분석해서 확실하게 모든 소자들의 기능들을 익혀야 겠다. ... ◈ 2장. 논리 게이트-결과 레포트-2조 2008065321권태영1. 실험 결과 및 정리○ 실험 1의 결과를 기입하라.A=0 B=0 일 때의 실험사진A=0 B=0 일 때의 실험 ... 때의vdc를 측정하였습니다.○ 실험 2의 결과를 기입하라.ABCDY00
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    | 리포트 | 6페이지 | 1,000원 | 등록일 2012.03.09
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    서강대 고급전자회로 실험 - 실험 8. Digital Filter Design - 결과 보고서
    고급전자회로 실험 결과 보고서실험 8. Digital filter design분반학번이름조학번이름시작종료실험시작/종료시간 기재(통계 목적임)실험 11.1 다음의 filter ... 하여 합성된 곡을 들어본 결과 원곡과 거의 유사하게 들린다는 것을 확인할 수 있었다.실험 2Lab 7의 두 번째 실험에서 제작한 작은별 곡(2,3,4차 하모닉 성분 포함)으로부터, 기 ... 까지 filtering함y1=filter(A.Numerator,1,signal);figure(1)spectrogram(y1, 512, 500, 512, Fs); % filtering 결과를 s
    Non-Ai HUMAN
    | 리포트 | 15페이지 | 2,000원 | 등록일 2015.06.18 | 수정일 2015.06.22
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  • 판매자 표지 자료 표지
    [디지털 논리회로 실험] 13장. 동기식 D, T 플립플롭 결과레포트
    논리회로실험 A반결과13장동기식 D, T 플립플롭5조이름학번실험일15.05.26제출일15.06.02실험에 사용된 기기 및 부품 : 오실로스코프, HD74LS74AP, GD74LS ... 76AN,, 직류전원공급장치,디지털 실험장치, 전압계실험 13.2 D 플립플롭 응용(1) IC 7474를 이용한 지연회로의 회로도 이다. 회로도에 IC 핀번호를 작성하여라.(2 ... 력 Q=0이된다.실험 13.3 T 플립플롭 응용(1) IC 7476(Dual JK Flip-Flop)를 이용한 T 플립플롭의 회로도이다. 회로도에 IC핀 번호를 작성하라.(2) Q
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    | 리포트 | 3페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2022.10.13
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2025년 11월 28일 금요일
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