전자공학실험 29장 - 연산증폭기의 주파수특성 예비결과

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2016.04.19
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전자공학실험 29장
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목차

1. 실험 목적
2. 관련이론
3. 실험 기기 및 부품
4. 실험 내용 및 절차
5. 실험 결과
6. 실험 결과 논의

본문내용

1. 실험 목적
(1) 실용 연산증폭기의 주파수 특성을 이해한다.
(2) 유한한 대역폭이 연산증폭기를 이용한 증폭기에 어떤 영향을 미치는지를 이해한다.
(3) 실용 연산증폭기의 유한한 대역폭 특성을 극복하기 위한 설계법을 이해한다.

2. 관련이론
2.1 유한한 대역폭의 영향
실용 연산 증폭기의 주파수 특성은 다음의 식(29.1)과 같이 1-폴 시스템으로 간주 할 수 있다.

<중 략>

4. 위의 그래프를 보고 주파수 응답의 특징을 설명하시오.
이상적인 연산 증폭기와는 달리 실제의 연산 증폭기는 주파수에 따라서 이득이 변화한다. [그림 R2]에 나타난 바와 같이 741 2단 연산증폭기의 전압이득을 주파수의 함수로 나타내었다. 10kHz까지의 낮은 주파수에서는 전압이득은 16.67V로 값이 일정하나 주파수를 높게할수록 그래프가 감소하는 기울기를 보이는 것을 알 수 있다. 이 기울기는 이득이 1, 즉 0dB이 될 때까지 계속 감소하고 이득이 1이 될 때의 주파수를 단위이득 또는 차단주파수라고 한다.

참고 자료

없음

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