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디지털 로직 실험 멀티플렉서를 이용한 조합 논리

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최초등록일 2015.07.20 최종저작일 2015.03
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디지털 로직 실험 멀티플렉서를 이용한 조합 논리
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    목차

    1. 실험 목표
    2. 사용 부품
    3. 실험 순서
    4. 데이터 및 관찰 내용
    5. 평가 및 복습 문제
    6. 추가 실험 고찰

    본문내용

    1. A와 B라는 두 개의 2비트 수 중 A가 B보다 크거나 같은지를 알아내기 위해 두 수를 비교해야 한다고 가정하여라. 이는 비교기를 사용하여 A>B와 A=B 출력을 OR 연산하면 된다. 다른 방법은‘이론 요약’에서 설명한 8:1 MUX를 사용하는 것이다. 실험 보고서의 표 12-1에 비교기에 대해 일부분만 완성한 진리표를 나타내었다. 입력은 비교되는 두 수를 나타내는 A₂, A₁과 B₂, B₁이다. A₂, A₁과 B₂가 MUX의 SELECT입력으로 연결되는 것에 주의하여라. B₁비트는 필요할 때 연결이 가능하고, 진리표의 분리된 열에 나타내었다. 출력이 A≥B로 되는 논리를 결정하고 표 12-1 진리표의 X열을 완성하여라. 첫 번째 두 항목은 예로써 이미 완성 되어 있다.2. 두 항목 그룹으로 된 출력 X를 살펴보아라. X 항목의 첫 번째 쌍은 B₁의 해당 항목의 보수가 된다. 그러므로 첫 번째 줄에서와 같이 데이터는 에 연결되어야 한다. 마지막 열에 0,1,B₁, 중 하나를 기입하여 표 12-1을 완성하여라.3. 표 12-1의 데이터를 사용하여 실험 보고서의 그림 12-4 회로를 완성하여라. 진리표의 출력X는 74151A의 출력 Y와 같다. 제조업체의 데이터 시트를 참조하여 로 되어 있는 STROBE 입력을 어떻게 연결해야 하는지 결정하여라. 회로를 구성하고 모든 가능한 입력을 점검하여 회로를 테스트하여라.

    <중 략>

    패리티 검사란 데이터의 저장과 전송의 정확성을 유지하기 위하여 에러를 검출해 내는 가장 간단한 방법으로서 전송되는 2진 정보에 여분의 에러검출용 비트를 한 개 추가해 전송하는 방법. 이때 사용되는 에러검출용 비트를 패리티비트(parity bit)라고 한다. 패리티 비트를 이용하는 방법에는 짝수 패리티 검출(even parity check) 방식과 홀수 패리티 검출(odd parity check) 방식이 있다.

    참고자료

    · 없음
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