[논리회로실험]반가산기 전가산기

*요*

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최초 등록일: 2007.09.14
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HYU용 실험레포트 반가산기 전가산기입니다
2 Section으로 구성했으며 레포트용으로 유용합니다

본문내용

[전 가산기] (FA : Full Adder)
전가산기는 아래와 같이 이전단에서 발생한 자리 올림수(Ci)를 포함하여 2개의 1Bit 2진수 A, B를 더하여 그의 합(S)과 자리 올림수(C0)를 출력하는 3개의 비트를 가산할 수 있는 논리연산회로이다.
3. 실험방법
(1) 전원이 꺼진 상태에서 그럼 4-1의 회로를 연결하여라.
(2) 전원을 켜고 sw1 및 sw2를 조작하여 표 4-6의 모든 입력조건에 대한 출력전압 S와 C를 기록하여라.
(3) 전원을 끄고 그림 4-2의 회로를 연결하여라.
(4) 전원을 켜고 sw1 및 sw2를 조작하여 표 4-7의 모든 입력조건에 대한 출력전압 S와 C를 기록하여라.
(5) 전원을 끄고 그림 4-3의 회로를 연결하여라
(6) 전원을 켜고 sw1, sw2 및 sw3를 조작하여 표 4-8의 모든 입력조건에 대한 출력전압 S와 Ci+1을 기록하여라.

참고 자료

http://photon.kyunghee.ac.kr/~khyoo/lecsub
http://icbn2.tree.cc/Adding Binary.htm
http://tjsys.allin2.com/8051/arch/chart3-1-2a.htm

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