아날로그및디지털회로설계실습 7주차 위상제어루프

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목차

1. 서론
2. 실험결과
3. 결론

본문내용

1. 서론

위상 제어 루프 회로의 이론을 학습하고 간단한 위상 제어 루프 회로를 구성하여 주파수 동기화 (Phase Locking) 원리를 이해한다.

2. 실험결과

1-3-1 위상제어루프의 용도

이론부의 위상 제어 루프를 이해하여 요약, 설명하고 실제 사용되는 분야에 대해 서술한다.

전압제어 발진기의 출력 신호와 기준 신호가 위상 검출기를 통과하여 위상 차이에 해당되는 파형이 루프 필터에 인가된다. 루프필터는 LPF이므로 위상 검출기의 저주파성분인 평균 전압만을 출력으로 내보내는데 이 값이 전압 제어 발진기의 입력으로 들어가는 loop를 구성하게 된다. 발진기의 출력 주파수와 기준 신호의 주파수가 다를 경우 두 신호의 위상차에 의해 위상 검출기의 출력 파형은 계속 변하게 되고 이에 따라 출력 전압도 계속 변하게 된다. 이러한 동작은 발진기의 출력 주파수와 기준 신호의 주파수가 같아질 때까지 계속된다. 두 주파수가 같아지면 위상 검출기의 파형은 일정한 형태를 지니며 루프 필터를 통과한 전압도 고정되어 위상이 고정된다. 이 경우, 출력 주파수와 입력 주파수는 완전히 동일하고 위상차만 존재하게 된다.
RF에서 PLL이 하는 용도는 두가지가 있다. 첫 번재로는 주파수원이 흔들리지 않도록 고정해주는 것이다. 두 번째는 주파수원을 정확하게 가변하는데에 있다. 예를 들어서 500MHz의 주파수원을 1MHz 간격으로 다른 주파수로 바꾸고 싶을 때, 501MHz, 502MHz 이런 식으로 가변할 때 필요하다. 또한 PLL에서 위상을 맞춘다는 것은 디지털 회로에서 클럭 동기화를 할 수 있다는 말입니다. 디지털 클럭을 이용하는 디지털 신호 전송에 있어서 들어오는 신호가 0인지 1인지를 명확히 구분하려면, 적어도 0과 1을 판별해야 하는 range를 먼저 정확히 정의해야 합니다. 이것은 결국 하나하나의 클럭이 시작되고 끝나는 지점을 명확히 알아야 하는 것을 뜻합니다.

참고 자료

아날로그 및 디지털회로 설계실습 교재