디지털시스템실험 6주차 결과보고서

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고려대학교 전기전자공학부 디지털시스템실험
17학년도 A학점 레포트입니다.

본문내용

1. SR Latch 를 설계한다.
2. SR Latch 를 이용하여 D-Type Positive-Edge-Triggered Flip-Flop 을 설계한다.
3. D Flip-Flop 을 이용하여 Negative-Edge-Triggered JK Flip-Flop 을 설계한다.
4. Negative-Edge-Triggered JK Flip-Flop 을 이용하여 BCD Ripple Counter 를 설계한다.
5. D Flip-Flop 을 이용하여 4 bit register와 4 bit shift register 를 설계한다.

<중 략>

2. 결과값 분석
4bit ripple counter의 결과
4bit register의 결과 clock이 1일 때 값이 변경된다. /clock이 0일 때 저장된 값이 변경되지 않는다.

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없음

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