실험 23_연산 증폭기 응용 회로1 결과보고서

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"실험 23_연산 증폭기 응용 회로1 결과보고서"에 대한 내용입니다.

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(1) 실험회로 1과 2에서 연산 증폭기의 전압 이득이 반전 증폭기, 비반전 증폭기의 전압 이득에 미치는 영향을 연산 결과의 정확도와 연관 지어 설명하시오.
: 실험회로1(반전 증폭기회로)의 이론적인 전압이득은 이다. 하지만 이 식은 연산증폭기의 전압이득이 무한대라는 가정에서 도출된 식이다. 만약 연산증폭기가 유한한 전압이득을 가지고 있다면 전압이득은 으로 근사시킬 수 있고, 이 식을 통해 우리는 연산증폭기의 전압이득이 높을수록 이상적인 값으로부터의 오차가 줄어듦을 알 수 있다.
실험회로2(비반전 증폭기)의 전압이득은 로 표현된다. 이는 반전증폭기와 마찬가지로 연산증폭기의 전압이득이 무한대로 가정했을 때의 결과 값이다. 그러나 연산증폭기의 전압이득이 무한대가 아니라면 전압이득은 식로 근사된다. 따라서 연산증폭기의 전압이득이 클수록 비반전 증폭기의 전압이득은 이론값에 가까워진다는 것을 알 수 있다.

참고 자료

단계별로 배우는 전자회로 실험(이강윤 저자)

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