전자공학실험1 예비(9장)
- 최초 등록일
- 2012.04.08
- 최종 저작일
- 2011.04
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소개글
전자공학실험 보고서
목차
1. Latches/Filp-flops
2. SR(Set-Reset) latch
3. D latch
4. JK flip-flop
본문내용
실험 9. 래치와 플립플롭
?? 목적
SR 래치와 D 래치에 대한 논리회로의 이해. 각 래치에서 출력을 예측할 수 없는 경우를 분석. 주종 JK 플립플롭과 지트리거 JK 플립플롭의 구조와 동작원리 이해.
?? 내용
순서 논리회로는 현재 출력이 현재 입력뿐만 아니라 이전 입력 상태들의 영향을 받는 논리회로 이다. 출력이 입력으로 귀환되는 루프가 있고 이 루프상에서 정보가 저장되는 기억소자 역할을 한다.
1. Latches/Filp-flops
기본적인 기억소자로서 1비트의 정보를 저장할 수 있는 가장 간단한 형태가 래치회로이다. 래치는 모든 입력 신호의 변화에 대해 clock 펄스와 관계없이 출력이 언제든지 변화 될 수 있는 소자이다. 반면 플립플롭은 clock 펄스에 따라 입력 상태가 샘플되어 출력상태를 변화시키는 소자를 일컫는다.
2. SR(Set-Reset) latch
SR=00 : 이전상태 유지 , SR=01 : 리셋상태 , SR=10 : 셋 상태 , SR=11 : 출력 모두 ‘0’
참고 자료
없음