32비트 ALU Verilog설계

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32비트 ALU Verilog설계 입니다.

본문내용

ALU결과 보고서
1.실습목표
CPU에서 산술 연산 논리장치인 ALU(Arithmetic Logic Unit)을 설계하고 검증한다.
2.이론
ALU(산술 논리장치)는 두 숫자의 산술연산(덧셈 뺄셈 등등)과 논리연산 (AND OR XOR)등을 계산하는 디지털 회로이다.
opcode
operator
000
not A
001
not B
010
and
011
or
100
xor
101
xnor
110
add
111
sub
ALU는 opcode에 따라서 여러 가지 연산을 하는 장치이다.
ALU를 통해 연산한 값을 status flag를 갖는다.
N(Negative):연산결과의 sign bit가 1인 경우
Z(Zero):연산결과가 0인 경우
C(Carry):연산결과 carry가 발생한 경우
V(Overflow):연산결과 overflow가 발생한 경우 (V=cout[N] cout[N-1])
ALU는 status flag는 비교연산을 위해 사용된다. A와 B를 비교할 때 A-B를 수행한 결과 N=1이면 AB이다.
ALU회로도

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