서울시립대학교 전전설2 7주차 결과레포트(코딩 성공적, A+, 10점 만점 11점)

소개글

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목차

1. Results of this Lab (실험 결과)
가. Results of Lab 0.
나. Results of Lab 3(응용과제).

2. Discussion (토의)
가. Data analysis

3. Conclusion (결론)
가. Summarize experiment contents & purpose of this Lab
나. Studies from this Lab

4. Reference (참고문헌)

본문내용

1. Results of this Lab (실험 결과)
(1) Results of Lab 0
- Button SW로부터 입력신호 in이 들어올 때 clk의 negative edge에서 시작하여 한 클럭 주기동안 생성되는 in-syn 신호를 생성하라.
설계 1) clk만을 활용해 순차회로 구현을 완료하였다.

<중 략>

2. Discussion (토론)
가. Data analysis (compare results, reasons of error)
1) 실습 0
이 실습은 버튼에 입력이 들어올 때, 한 클럭 주기에 in_syn신호를 출력해주는 장치를 디자인하는 실습이었다.
여러가지 방법이 존재하는데, 이번 실험에서는 negedge clk에 맞춰 delay라는 변수를 선언해 중복 입력을 막아주었습니다.
delay변수는 in의 이전 clk 값을 저장하고 있는데, in과 delay가 (1,0)인 경우에만 값을 출력하도록 선언을 해주어서 우리가 원하는 출력을 얻을 수 있었습니다.

참고 자료

FSM, https://ko.wikipedia.org/wiki/%EC%9C%A0%ED%95%9C_%EC%83%81%ED%83%9C_%EA%B8%B0%EA%B3%84