[전기회로] Opamp 전기회로 예비

소개글

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목차

*실험목적
*실험이론
1. 전압플라워
2. 반전증폭기
3. 비반전증폭기
4. 가산기
5. 미분기와 적분기
*사용기기및 부품
*참고문헌

본문내용

그림 1은 연산증폭기의 등가회로와 기호를 보인 것이다. 그림 1a()의 등가회로는 두 입력단자 를 연결한 입력저항 차동모드입력()과 차동모드이득()의 곱으로 나타난 종속전원 와 출력저항 및 출력 를 보이고 있다. 출력이 공통모드 입력 와 무관하므로 이 등가회로는 이상적인 연산증폭기의 경우 공통모드이득 가 0, 즉 CMRR이 무한대라는 것을 나타내며, 일반적으로 이러한 조건은 실제로도 만족된다. 또, 는 대락 이상, 즉 거의 무한대로 볼 수 있을 정도로 크며, 입력저항 도 외부회로의 저항들보다 매우 커서 무한대로 간주되는 반면, 출력저항 는 보통 100Ω 이하로서 일반적으로 무시할 수 있다. 일반적으로 안정한 연산증폭기에서 출력 는 유한하지만 증폭률 가 거의 무한대이므로 은 거의 0에 가까운 것을 알 수 있다. 즉 연산증폭기의 입력은 거의 단락되어 있다. 더구나 가 매우 크므로 를 흐르는 전류 역시 거의 0이다.

참고 자료

전자공학의 기초 (이영근 저) - 광림사; 677-679p.