FPGA Board를 이용한 FSM회로의 구현 (up-counter) 예비레포트

소개글

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목차

1. 실험 제목
2. 실험 목표
3. 실험 장비 및 부품
4. 관련이론
5. Vivado Simulation Result
6. 참고문헌

본문내용

1) FPGA
FPGA(Field-Programmable Gate Array)는 설계 가능 논리 소자와 프로그래밍이 가능한 내부 회로가 포함된 반도체 소자이다. 설계 가능 논리 소자는 AND, OR, XOR, NOT, 더 복잡한 디코더나 계산기능의 조합 기능같은 기본적인 논리 게이트의 기능을 복제하여 프로그래밍할 수 있다.[1]
넓은 평야 (field)의 바둑판처럼 규칙적인 구획을 가진 배열 (Array)을 프로그래밍Filed(사용자)에서 프로그래밍이 가능한 Gate array(디지털 회로 반도체)이다.
간편하게 설계한 로직을 반복적으로 이식할 수 있고, 업데이트가 가능하다는 등의 장점이 있지만, 대량으로 생산하는 경우 비용이 높고 칩의 면적이 크고 발열이 많다는 등의 단점도 있다.

2) Hardware Description Language (HDL)
Hardware Description Language는 전자회로를 정밀하게 기술하는 데 사용하는 컴퓨터 언어이다. 흔히 HDL이라고 줄여 쓰기도 한다. 회로의 원하는 동작을 기술할 수도 있고, 원하는 회로 구조를 기술할 수도 있으며 시뮬레이션을 통해 제대로 동작하는지 검증할 수도 있다.

참고 자료

WIKIPEDIA, “Field-programmable gate array”
WIKIPEDIA, “Hardware description language”
김동민 외, 『디지털공학 실험』, 그린, 2003
차재복, “Synchronous Counter 동기식 카운터”, 정보통신기술용어해설