전기전자공학기초실험-차동 증폭기 회로

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소개글

"전기전자공학기초실험-차동 증폭기 회로"에 대한 내용입니다.

본문내용

전자16장. 차동 증폭기 회로

1. 실험 목적
차동 증폭기 회로에서 직류동작과 교류증폭을 이해한다.

2. 실험이론
(1) BJT 차동 증폭기
차동 증폭기는 플러스와(+) 마이너스(-) 입력단자를 가진 회로이다. 두 인가된 입력신호에서 위상이 반대인 신호성분은 크게 증폭되지만 동상인 신호 성분은 출력에서 상쇄된다. 그림은 단순 BJT 차동증폭기 회로로서 +입력은 Vi+ , -입력은 Vi-, 그리고 위상이 서로 반대인 출력Vo1과Vo2를 가지고 있다. 통상적으로 커패시터를 사용하지 않으며, 입력신호는 DC결합으로 연결되고, 양의 전원(Vcc)와 음의 전원(VEE)가 DC 바이어스를 제공한다. 이 실험에서 두 트랜지스터의 re값이 같다고 가정하였을 때, 차동 전압이득의 크기는
AV = -RC/2re가 되고 두입력에 공통인 신호에 대한 이득의 크기는 AV = RE/2RE 가 된다.

(2) FET 차동 증폭기
FET에 대한 차동 증폭기 전압이득의 크기는 BJT 보다 단순하며 다음과 같이 표시할 수 있다
Avd = -gmRD/2

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