A+받은 연산증폭기 기초 결과보고서 PSPICE

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최초 등록일: 2022.12.28
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본문내용

1. 실험 장비
① 신호(함수) 발생기
② 직류 전원 장치
③ 오실로스코프
④ 프로브
⑤ 브레드 보드
⑥ 연결도선
⑦ BNC 코넥터-악어클립 케이블
⑧ OP AMP
2. 실험 내용 및 방법
연산증폭기는 전압 이득과 입력저항이 매우 크고 출력저항이 아주 작은 차동증폭기이다. 차동증폭기란 입력 단자가 두 개인 증폭기로서 출력 전압이 두 입력전압의 차에 비례하는 증폭기를 말한다. 그림 1은 연산증폭기의 회로기호를 나타낸 것이며, 그림 2는 이것의 등가 회로이다. 두 개의 입력 단자와 한개의 출력 단자가 있으며 ‘+’와 ‘-’의 전원 단자가 꼭 있어야 하고 접지 단자는 없다. 출력전압과 입력전압의 관계식은 다음과 같다.
         
그림 1 연산증폭기의 회로 기호
그림 2 연산증폭기의 등가 회로
여기서 G는 개방회로 전압 이득이고,  는 비반전 입력전압,  는 반전 입력전압이다.

참고 자료

전기전자기초실험 대한 전자공학회 편 청문각

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