<전자회로설계실험>FET증폭기와 스위칭

최초 등록일
2015.12.14
최종 저작일
2014.06
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<전자회로설계실험> FET 증폭기와 스위칭(공통 소스 JFET 증폭기/공통 드레인 JFET 증폭기) 실헙입니다.

목차

1. 실험
2. 목표
3. 관련이론
4. 필요부품
5. 실험방법 및 결과
6. 고찰

본문내용

1. 실험
FET 증폭기와 스위칭 (1부-공통 소스 JFET 증폭기 / 2부-공통 드레인 JFET 증폭기)

2. 목표
(1) 1부 – 공통 소스 증폭기의 직류 및 교류 파라미터를 계산하고 측정할 수 있다.
(2) 2부 – 공통 드레인 증폭기의 직류 및 교류 파라미터를 계산하고 측정할 수 있다.

3. 관련이론
(1) 공통 소스 JFET 증폭기
그림은 공통 소스 JFET 증폭기 회로를 나타내고 있다. 이와 같은 작은 교류 신호가 게이트에 결합되면 게이트-소스 전압이 변하게 되고 이것이 정현파 드레인 전류를 발생시키며 드레인 전류를 통해서 흐르는 교류전류가 츨력에 나타나는 증폭된 교류신호이다.
게이트-소스 전압의 증가는 드레인 전류를 증가시킨다.

이것은 드레인 전압이 감소하고 있음을 의미한다. 입력전압의 +반주기에서 출력의 –반주기를 발 생시키기 때문에 공통 소스 증폭기에서 위상 반전을 얻을 수 있다.

참고 자료

없음

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