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"시립대" 검색결과 61-80 / 11,265건

  • 워드파일 시립대 전전설2 [3주차 예비] 레포트
    전자전기컴퓨터설계실험 Ⅱ Pre-report 3주차: Logic Design using Verilog HDL 1. Introduction (실험에 대한 소개) 가. Purpose of this Lab 이번 실험에서는 Verilog HDL 언어를 사용하여 논리회로를 설..
    리포트 | 8페이지 | 2,000원 | 등록일 2019.07.29
  • 워드파일 시립대 전전설2 [4주차 결과] 레포트
    Purpose of this Lab 베릴로그의 기본 문법인 always와 initial 구문의 차이점에대해서 이해를 하고 테스트벤치에서의 토글링을 하는 방법을 always로 설계를하여 ... 이진화 십진법, 3초과 부호와 같은 여러가지 수학적 연산을 수행하는 가산기를 구성할 수 있지만, 대부분의 가산기는 2진수의 합을 계산한다. 2의 보수나 1의 보수를 이용하여 음수를
    리포트 | 12페이지 | 2,000원 | 등록일 2019.07.29
  • 워드파일 시립대 전전설2 [1주차 예비] 레포트
    전자전기컴퓨터설계실험 Ⅱ Pre-report 1주차: TTL gates Lab on Breadboard 1. Introduction (실험에 대한 소개) 가. Purpose of this Lab - TTL 소자인 HD74LS08 (AND), HD74LS32(OR), ..
    리포트 | 8페이지 | 2,000원 | 등록일 2019.07.29
  • 워드파일 시립대 전전설2 [5주차 예비] 레포트
    디멀티플레서에 대해서 설명을 해보겠다. 디멀티플렉스는 멀티플렉서와 반대로 동작을 한다. ... 대부분의 디코더는 Low 상태를 이루도록 설계되어 있고, 선택된 출력 단자가 Low이면 다른 모든 단자는 High가 된다. ... 입력 조합에 대해서 M개의 출력 단자 중에서 1개만 High의 값이 출력되고, 나머지의 출력 단자에서는 Low의 값이 출력된다.
    리포트 | 8페이지 | 2,000원 | 등록일 2019.07.29
  • 워드파일 시립대 전전설2 [6주차 결과] 레포트
    즉 CLK 하나로 A,B에 대해서 각각 CLK1 CLK2로 작동을 하는 것을 알수있다. ... Purpose of this Lab 인코더와 디코더의 원리를 이해하고 case문과 if와 else if들의 조건문에 대해서 이해를 하고 조건문을 이용해서 인코더와 디코드를 설계하고
    리포트 | 16페이지 | 2,000원 | 등록일 2019.07.29
  • 워드파일 시립대 전전설2 [4주차 예비] 레포트
    Purpose of this Lab 베릴로그의 기본 문법인 always와 initial 구문의 차이점에대해서 이해를 하고 테스트벤치에서의 토글링을 하는 방법을 always로 설계를하여 ... 이진화 십진법, 3초과 부호와 같은 여러가지 수학적 연산을 수행하는 가산기를 구성할 수 있지만, 대부분의 가산기는 2진수의 합을 계산한다. 2의 보수나 1의 보수를 이용하여 음수를
    리포트 | 8페이지 | 2,000원 | 등록일 2019.07.29
  • 워드파일 시립대 전전설2 [8주차 예비] 레포트
    전자전기컴퓨터설계실험 Ⅱ pre-report 8주차: 7-segment, Piezo 1. Introduction (실험에 대한 소개) 가. Purpose of this Lab 7세그먼트의 동작을 익히고 Verilog HDL 언어를 사용하여 7-segment, Piez..
    리포트 | 8페이지 | 2,000원 | 등록일 2019.07.29
  • 워드파일 시립대 전전설2 [1주차 결과] 레포트
    전자전기컴퓨터설계실험 Ⅱ Post-report HDL을 사용한 디지털회로 설계 툴 (Xilinx ISE) 사용법 1. Introduction (실험에 대한 소개) 가. Purpose of this Lab ISE 시뮬레이션을 이용하여 simulation Run time..
    리포트 | 10페이지 | 2,000원 | 등록일 2019.07.29
  • 워드파일 시립대 전전설2 [7주차 예비] 레포트
    전자전기컴퓨터설계실험 Ⅱ Pre-report 7주차: Sequential Logic 2 1. Introduction (실험에 대한 소개) 가. Purpose of this Lab 유한 상태 기계 출력인 Moore Machine에 대하여 이해를 하고 Mealy mach..
    리포트 | 7페이지 | 2,000원 | 등록일 2019.07.29
  • 워드파일 시립대 전전설2 [8주차 결과] 레포트
    전자전기컴퓨터설계실험 Ⅱ Post-report 8주차: 7-segment, Piezo 1. Introduction (실험에 대한 소개) 가. Purpose of this Lab 7세그먼트의 동작을 익히고 Verilog HDL 언어를 사용하여 7-segment, Pie..
    리포트 | 12페이지 | 2,000원 | 등록일 2019.07.29
  • 워드파일 시립대 전전설2 [9주차 결과] 레포트
    전자전기컴퓨터설계실험 Ⅱ Post-report 9주차: Display Control 1. Introduction (실험에 대한 소개) 가. Purpose of this Lab Verilog HDL 언어를 사용하여 character display를 위한 VFD장치 제어를..
    리포트 | 11페이지 | 2,000원 | 등록일 2019.07.29
  • 워드파일 시립대 전전설2 [6주차 예비] 레포트
    Purpose of this Lab 인코더와 디코더의 원리를 이해하고 case문과 if와 else if들의 조건문에 대해서 이해를 하고 조건문을 이용해서 인코더와 디코드를 설계하고
    리포트 | 7페이지 | 2,000원 | 등록일 2019.07.29
  • 워드파일 시립대 전전설2 [3주차 결과] 레포트
    전자전기컴퓨터설계실험 Ⅱ Post-report 3주차: Logic Design using Verilog HDL 1. Introduction (실험에 대한 소개) 가. Purpose of this Lab 이번 실험에서는 Verilog HDL 언어를 사용하여 논리회로를 ..
    리포트 | 10페이지 | 2,000원 | 등록일 2019.07.29
  • 워드파일 시립대 전전설2 [2주차 결과] 레포트
    전자전기컴퓨터설계실험 Ⅱ Post-report HDL을 사용한 디지털회로 설계 툴 (Xilinx ISE) 사용법 1. Introduction (실험에 대한 소개) 가. Purpose of this Lab ISE 시뮬레이션을 이용하여 simulation Run time..
    리포트 | 8페이지 | 2,000원 | 등록일 2019.07.29
  • 워드파일 시립대 전전설2 [7주차 결과] 레포트
    세번째 실험에서는 moore 머신 밀리 머신의 개념에 대해서 익혔고 case문에의 latch설정의 에러가 발생되지 않기 위해서 default문을 작성해서 작성을 하였다. default를
    리포트 | 8페이지 | 2,000원 | 등록일 2019.07.29
  • 워드파일 시립대 전전설2 [2주차 예비] 레포트
    전자전기컴퓨터설계실험 Ⅱ Pre-report 2주차: HDL을 사용한 디지털회로 설계 툴 (Xilinx ISE) 사용법 1. Introduction (실험에 대한 소개) 가. Purpose of this Lab 이번 실험에서는 Verilog HDL 언어를 사용하여 논..
    리포트 | 8페이지 | 2,000원 | 등록일 2019.07.29
  • 워드파일 시립대 전전설2 [5주차 결과] 레포트
    Purpose of this Lab MUX와 DEMUX의 작동원리를 키박스로 확인을 하고 인코더와 디코더의 원리를 이해하고 case문과 if와 else if들의 조건문에 대해서 이해를 ... 그림에서 예를 들어 AB 입력 값이 01일 경우에는 출력선 D1만이 1이고 나머지 출력선 D0 D2 D2은 모두 0이 되며 나머지 입력값의 조합에 대해서도 한 출력선이 나머지 출력선과
    리포트 | 14페이지 | 2,000원 | 등록일 2019.07.29
  • 한글파일 시립대_전전설2_Velilog_예비리포트_7주차
    Verilog HDL 실습 7주차예비리포트 Major 전자전기컴퓨터공학부 Subject 전자전기컴퓨터설계실험2 Professor Student ID Number Name submit date 목록 1. 실험 목적 2. 배경 이론 3. 실험 코드 분석 4. 참고 문헌 1..
    리포트 | 14페이지 | 2,000원 | 등록일 2021.12.11 | 수정일 2022.04.21
  • 한글파일 [서울시립대] A+ 전자전기컴퓨터설계2 2주차(Schemetic)결과레포트(예비레포트포함,시립대)
    전자전기컴퓨터설계실험 2 결과 레포트 실험 제2주 (2021. 10. 12) Lab#02 『Xilinx Spartan3』 FPGA chip, 『ISE』 digital design tool 학번 : 이름 : Ⅰ.서론 실험 내용: Xilinx ISE의 특징과 역할, 그 역..
    리포트 | 10페이지 | 1,000원 | 등록일 2021.12.30 | 수정일 2022.01.03
  • 워드파일 시립대 전전설2 Velilog 결과리포트 7주차
    Verilog HDL 실습 8주차 결과 리포트 Major 전자전기컴퓨터공학부 Subject 전자전기컴퓨터설계실험2 Professor Student ID Number Name submit date 목록 실험 목적 배경 이론 실험 장비 시뮬레이션 결과와 실험결과 비교 (1..
    리포트 | 8페이지 | 2,000원 | 등록일 2021.12.11
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