"가산기와디코더" 검색결과 121-140 / 237건

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  전가산기 구성 예비보고서09

  이렇게 만들어진 8개의 함수를 8-입력 Multiplexer에 입력할 수 있고 이때 출력은 3개의 변수로 제어 가능하다. (4) 전가산기(Full adder) 74LS153은 전가산기를 ... ▣ 목 적 (1) 전가산기 구성을 위해 2개의 4입력 Multiplexer 사용을 익힌다. (2) 2개의 4-입려 Multiplexer를 감산기로 사용을 것을 익힌다. ▣ 원 리 ( ... 따라서 멀티플렉서의 논리식은 Y= bar{S} (D _{0} bar{A} bar{B} +D _{1} bar{A} B+D _{2} A bar{B} +D _{3} AB)가 되어 디코더와

  리포트 | 4페이지 | 1,000원 | 등록일 2013.12.10

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  전자공학실험1 결과(7장)

  Dual 4x1 MUX를 이용하여 전가산기를 구현하라. ... 이용하여 전가산기를 구현하라. 2)MUX 회로는 2레벨 AND-OR 구조이어서 단일 출력을 갖는 sum-of-products 형태의 조합논리회로 설계에 유용하게 사용될 수 있다. ... 연습문제 1)n-to- 디코더는 개의 모든 minterm 출력을 내는 AND array로 보면 n개의 입력 변수를 갖는 조합논리회로 설계에 유용하게 사용될 수 있다. 3x8 디코더를

  리포트 | 7페이지 | 1,000원 | 등록일 2012.04.08

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  디지털실험 한학기 예비&결과 모음

  그림 회로이다. 왼쪽 붉은 집게가 입력이고 오른쪽 집게가 출력이다. 그라운드는 아래쪽에 모아 놨다.이번 실험에서 사용한 전원공급장치이다. 0V와 5V를 줘야하기 때문에 채널 두 개를 모두 사용한다. 사진은 실험 1-1의 5V를 입력하는 경우이다.Vin에 0V를 입력한 ..

  리포트 | 1페이지 | 4,000원 | 등록일 2014.09.15

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  [디지털회로실험] (실험5) 멀티플렉서, 디멀티플렉서, 엔코더, 디코더 / (실험6) 7-세그먼트 디코더

  시뮬레이션 결과 실험 6-(1) 7-세그먼트 디코더 회로의 동작 확인 ? 회로도 ? 시뮬레이션 결과

  리포트 | 3페이지 | 1,000원 | 등록일 2014.10.21 | 수정일 2016.06.13

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  디지털 공학 자유과제 주사위게임 설계

  감산을 하기위해 7483 4비트 가산기를 이용했다. 감산을 하기위해 두 번째 주사위의 입력을 보수화 시켰다. ... 또한 주사위의 값을 결정하는 두 개의 3비트 BCD 코드를 비교하는 과정에서 비교기를 쓰지 않고 7483가산기를 사용하여 감산 시 음수발생과 양수발생의 성질을 이용하여 값을 비교 하였다 ... , QD는 6진 디코더 회로인 7442의 입력 A B C에 연결되어 디코더 회로로 동작하고, 입력 D는 쓰지 않으므로 접지 시킨다.

  리포트 | 10페이지 | 2,000원 | 등록일 2013.01.15

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  전기전자공학

  -가산기 : 이진수 연산(덧셈이나 뺄셈)을 처리하는 것. ? ... 가산기 (1) 1비트 반가산기 입력 : 2개의 입력(x, y) 출력 : 두 개의 출력(합 출력인 S와 캐리 출력인 C) (1) 1비트 저가산기 입력 : 3개의 입력(x, y, Cin ... 디코더 ? 멀티 플렉서 2n 개의 입력값 중의 하나를 출력으로 연결하는 논리회로 2n 개의 입력 중 하나를 선택하기 위한 별도의 n개의 선택 입력선 ?

  리포트 | 6페이지 | 1,500원 | 등록일 2014.03.13

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  [컴퓨터입문] 연산과 논리회로

  B S C 0 0 0 0 0 1 1 0 1 0 1 0 1 1 0 1 {회로도 5) 전가산기 { 1 정의 : 전가산기는 두 자리 이상의 2개의 2진비트수를 가산할 때 반가산기에서 생기는 ... 종류로는 4X2,8X2,10X4등 여러종류가 있다. (4) 반가산기 1 정의 : 반가산기는 서로 가산이 되는 데이터의 각각 1자리의 2진수를 더하여, 합과 Carry를 구하는 회로이다 ... 그리고, 두 개의 반가산기와 OR회로로 구성되어 있다. 2 논리식 : 3 진리표 {전가산기 회로도 { 입력 출력 A B C1 S C0 0 0 0 0 0 0 0 1 1 0 0 1 0

  리포트 | 4페이지 | 1,000원 | 등록일 2004.12.06

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  멀티플렉서와 디멀티플렉서

  가산기와 감산기 (2) 반가산기를 이용하여 전가산기를 구성하고 그 결과를 확인하라. ... 반가산기를 이용하여 구성한 전가산기에서는, x,y,z 세 개의 입력값을 모두 더하여 그 결과를 C ( )과 S ( )의 값인 2진법으로 표현하여 출력하는 기본적인 전가산기 모델입니다 ... 그리고, 계산 시간이 빠르나 더하는 비트 수만큼 전가산기가 필요하므로 많은 수의 계산을 필요로 하는 가산기의 경우 회로가 복잡하게다.

  리포트 | 14페이지 | 1,000원 | 등록일 2010.12.20

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  실험4. 논리 게이트와 부울 함수의 구현 예비

  종류로는 반가산기, 전가산기, 반감산기, 디코더, 인코더, 멀티플렉서, 디멀티플렉서 등이 있다. 1) 반가산기(Half-Adder,HA) : 2개의 비트 X,Y를 더한 합 S와 자리올림 ... C를 구하는 회로이다. 2) 전가산기(Full-Adder,FA) : 2개의 비트 X, Y와 밑의 자리로부터 자리 올림한 C(Carry)까지 고려하여 비트 3개를 덧셈하는 회로이다. ... 3) 디코더(Decoder) : 입력으로 들어오는 2진 신호의 조합을 검출하여 유일한 출력만을 생성하는 회로. n개의 입력 변수가 있을 때는 2n개의 출력을 가진다. 4) 멀티플렉서

  리포트 | 7페이지 | 1,000원 | 등록일 2013.02.02

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  [A+ 결과보고서] 아주대 논리회로실험 실험4 '멀티플렉서 & 디멀티플렉서'

  가산기의 실험결과와 마찬가지로 강의노트에 있는 그대로 빵판에 회로를 잘 구성했기 때문에 실험결과가 모두 같았던것같다. 3.실험에 대한 고찰 -이번 실험은 멀티플렉서와 디멀티플렉서를 ... -디코더칩의 구조와 동작에 대해서 이해한다. 2.실험결과 ●멀티플렉서 실험결과 MUX 입력 출력 E S1 S0 D3 D2 D1 D0 +5V X X X X X X 0, 0 0 0 +5 ... +5 0 0 +5 0 +5 +5 0 +5 +5 +5 0 0 +5 +5 +5 0 0 0 +5 - 멀티플렉서(MUX)는 여러 개의 입력 중 원하는 입력을 출력으로 내보내는 데이터 선택기이다

  리포트 | 6페이지 | 1,000원 | 등록일 2015.03.27

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  BCD to EX-3 가감산기 설계 보고서

  회로도 설명: 첫 번째 74LS83N 가산기를 거친 3초과 코드는 그대로 세 번째 74LS83N 가산기로 입력되어지고 두 번째 74LS83N 가산기를 거친 3초과 코드는 74LS86N ... XNOR게이트로 들어가는 이유는 74LS83N 가산기는 가산기 기능만을 가지고 있기에 XNOR게이트를 통해 반전 즉 보수를 취해 감산을 하기 위해서입니다. ... 이렇게 입력된 값은 74LS83N 가산기를 거쳐서 B4B3B2B1이 0011(3)을 입력 받았기에 가산기를 거친 출력 값은 입력 값에 3이 더해진 3초과 코드(ex: 0000을 입력하면

  리포트 | 11페이지 | 1,000원 | 등록일 2011.05.25

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  멀티플렉서

  멀티플렉서의 가산 및 감산 74 LS153 3. Multiplexer 의 가산 및 감산 멀티플렉서 전가산기 3. Multiplexer 의 가산 및 감산 멀티플렉서 전감산기 3. ... A B D 0 = A'B' D 1 = A'B D 2 = AB' D 3 = AB 디코더 디멀티플렉서 Multiplexer 가산 - 감산 3. ... 디멀티플렉서와 디코더 2. Demultiplexer 란 ?

  리포트 | 15페이지 | 1,500원 | 등록일 2010.09.05

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  실험9. Multiplecxer 가산-감산 예비

  실 험 목 적 ◎ 전가산기 구성을 위해 2개의 4입력 Multiplexer 사용을 익힌다. ◎ 2개의 4-입력 Multiplexer를 감산기로 사용하는 것을 익힌다. □ 이 론 Multiplexer는 ... 이렇게 만들어진 8개의 함수를 8-입력 multiplexer에 입력할 수 있고 이때 출력은 3개의 변수로 제어 가능하다. 74LS153은 전가산기를 구성하는데 사용할 수 있다. ... 따라서 멀티플렉서의 논리식은 가 되어 디코더와 유사하다.

  리포트 | 6페이지 | 1,000원 | 등록일 2013.02.02

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  5.Digital Circuit 2 Adder & Comparator(7483,7485,7447)

  가산기를 통해 얻은 출력(S0~S3)은 두번째 가산기(7485)의 A0~A3의 입력핀에 연결한다. ... 실험결과 실험 1 : 7483, 7485, 7447를 이용한 단일 FND 출력 실험결과분석 : 7483(가산기)와 7485(비교기), 7447을 이용하여 FND에 0~9까지의 숫자를 ... A0~A2, B0~B2의 값을 첫번째 가산기(7485)에 입력을 하고 A3, B3, C0 에는 GND(0)과 연결시킨다.

  리포트 | 6페이지 | 1,000원 | 등록일 2013.07.23

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  자판기시스템(최종본)

  설계목표 1. 10 진수 가산기 관련이론 BCD 코드는 16 진수 이기 때문에 합이 10 이상이면 6 을 더함으로서 0~9 까지의 값을 출력하도록 할 수 있다 . 관련이론 2. ... D-flip flop 74175 10 IC 2-input AND 74LS08 10 IC 2-input OR 74LS32 10 IC NOT 74LS04 4 IC 7-segment 디코더 ... 가감산기 S 에 0 이 입력되게 되면 가산이 되고 S 에 1 이 입력되게 되면 감산이 되는 회로의 기능을 하게 된다 . 관련이론 3.

  리포트 | 12페이지 | 2,000원 | 등록일 2011.11.13

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  [디지털통신] 채널부호화

  수신기에는 상보관계의 블록 디코더가 사용된다. ... 수신기에는 Viterbi 디코더가 사용된다. ... 매 클록마다 1비트 이상의 비트로 천이되어 nro의 가산기 출력에서 차례로 전환된다. ? 부호화 율은 ?

  리포트 | 7페이지 | 1,500원 | 등록일 2012.06.18

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  MAXPLUS로 예를 든 조합회로와 순차회로

  조합 회로의 소자로는 게이트 그 자체가 기본이고 반가산기, 전가산기, 감산기 종류, 디코더, 멀티플렉서 등이 있다. ... 전 가산기에서의 합은 자리 올림 수가 없는 경우에는 반 가산기와 같고 자리올림수가 있는 경우에는 반 가산기에서 나온 자리올림수와 논리합을 한 결과가 같기 때문에 전 가산기는 두 개의 ... 전가산기는 두 자리 이상의 2개의 2진 비트수를 가산할 때 반가산기에서 생기는 캐리를 다음 단계에서 입력받아 처리할 수 있도록 한 회로이다.

  리포트 | 15페이지 | 1,000원 | 등록일 2010.06.11

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  [실험레포트] 논리회로실험

  ..FILE:결과리포트.zip ..FILE:5번째 가산기 감산기 디코더/2진 카운터.htm 전기.전자 실험실습 Ⅲ권/디지탈회로(PART12~17) 실험 3 : 2진 계수기(Binary

  리포트 | 24페이지 | 5,000원 | 등록일 2008.04.12

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  디지털공학(논리회로) 전가산기 설계

  전가산기의 진리표에 따라 디코더의 출력을 알맞게 OR소자로 연결하여 Sum과 Carry를 구해내야 할 것이다. 2. ... 분석 제작해야할 회로는 1의 보수 계산이 가능한 전가산기이다. ... MUX의 출력은 곧 전가산기용 Decoder의 입력으로 들어가야 할 것이다.

  리포트 | 4페이지 | 2,000원 | 등록일 2009.12.06 | 수정일 2022.12.12

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  실험9. Multiplecxer 가산-감산 결과

  전가산기는 입력값이 세 개, 출력값이 두 개다. 74153은 멀티플렉서 두 개를 포함하므로 각각이 가산기의 출력 S와 C_out을 표현하게 된다. ... 실험2는 74153 멀티플렉서를 가지고 전가산기를 구성하는 것이다. ... 따라서 멀티플렉서의 논리식은 가 되어 디코더와 유사하다.

  리포트 | 6페이지 | 1,000원 | 등록일 2013.02.02

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