"circuit simulation"의 검색결과 입니다.

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기아실 peak detector 다이오드 정특성 아주대 전자회로2 verilog 신호등 tft output d플립플롭cadenc 기초디지털실험 전압 배율기

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"circuit simulation" 검색결과 121-140 / 394건

서강대학교 기초전자공학실험 - 실험 4. 오실로스코프의 사용법 결과 보고서

있고전압분배에 의해 가 된다.- R3 전압 그래프4. 검토사항- PSpice를 이용하여 시간축, 주파수축으로 분석하는 방법을 알아보고, 각자 회로를 구성하여simulation ... Engineering Circuit Analysis 11/ed, WILEY, 2015, pp. 38-39.1. 제목 : 실험 5. PSpice를 이용한 회로의 Simulation2 ... , 전류의 크기가 나타난다.5. 참고 문헌① 서강대학교 전자공학과, 기초전자공학실험 [3주차], 서강대학교, 2017, pp. 9-15.② Irwin & Nelms, Basic Engineering Circuit Analysis 11/ed, WILEY, 2015, pp. 90-97.

Non-Ai HUMAN
| 리포트 | 14페이지 | 1,000원 | 등록일 2020.04.20 | 수정일 2020.04.24

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[중앙대 전기회로설계실습]설계실습3 분압기(Voltage Divider) 설계 결과보고서

kΩ, R2=3kΩ을 사용해 회로를 설계하여 PSpice를 이용하여 simulation을 해보니 다음과 같았다.이 회로가 설계조건을 만족하는지 확인해보겠다.(a) IC chip ... 로 고정되어 있는 DC power supply를 이용하여 정격전압이 3V±10%,정격전류가 3mA±10%인 IC chip에 전력을 공급할 수 있는 분압기를 설계해보았다. 분압기를 설계 ... 에 걸리는 전압=1.71V -> 불만족(b) IC chip이 전력을 소비하지 않을 때, 즉 전압이 걸려도 전류가 흐르지 않는 무부하(open circuit) 상태일 때, IC c

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| 리포트 | 5페이지 | 1,000원 | 등록일 2019.03.22 | 수정일 2019.03.23

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경희대 기초회로실험 결과보고서(lab 6Y)

19와 같이 simulation 결과보기를 수행하여야 한다.)그림 21에 보였다. 단 TF 해석에서는 동작점에서의 4단자 등가회로에 대한 정보를 제공하지만 이는 어디까지나 교류 ... 를 선택한다. 그림 22에서는 V1과 V(OUT)를 측정하고 Marker를 배치하였으며, simulation 결과를 그림 24에 보였다.실험결과:**** 10/16/16 17:08 ... :\Users\윤희찬\AppData\Roaming\SPB_Data\pspice2-PSpiceFiles\SCHEMATIC1\B_DC_SWEEP2.sim ]**** CIRCUIT

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| 리포트 | 13페이지 | 1,000원 | 등록일 2016.12.24

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아주대 전자회로실험 설계 예비보고서 3. OP -AMP- RC Filter 설계

한 의미를 갖는다.- The Antoniou inductance-simulation circuit-Inductor I/V property- Input Impedance- 그렇 ... 다면 우리가 사용하는 위에서 오른편에 보이는 Antoniou inductance simulation circuit이 이러한 특성을 보이는지 확인하기 위한 절차는 주파수 영역에서 회로 ... : 10kOMEGA (3개), 620OMEGA (2개), 580OMEGA (2개)- MC1458 data sheet- The Antoniou inductance-simulation

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| 리포트 | 6페이지 | 1,500원 | 등록일 2015.10.06

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1주차 결과 Chapter 1. PSpice Simulation

SimulationBias simulationFigure 1-1. Bias simulation circuitAs attached, the simulation circuit tells us ... , w Common Emitter(CE) circuitFigure 1-12. CE circuit simulation resultFigure 1-11 demonstrates the c ... value of between R3 and V1 is 2.5V.DC sweep circuitFigure 1-2. DC sweep circuitThe above circuit is the

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| 리포트 | 11페이지 | 1,000원 | 등록일 2015.02.07

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전자전기컴퓨터설계실험1(전전설1) (8) 노턴의 정리, 테브닌의 정리, 그리고 최대전력전달

어야 한다).(2)Network B를 분리시켜 Network A의 출력단자를 단락하였을 때 흐르는 단락전류(short circuit current) Isc를 구한다.(3)Network ... A에서 전원을 제거하고 (독립전압원 : short, 독립전류원 : open, 종속전원 : 그대로 유지) 구한 등가저항 Rth와 Isc를 병렬로 접속한다.-> Network B ... 의 제어변수도 같은 Network 안에 있어야 한다).(2)Network B를 분리시켜 Network A의 출력단자를 개방하였을 때 나타나는 개방전압 (open circuit

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| 리포트 | 11페이지 | 2,000원 | 등록일 2019.09.19 | 수정일 2021.04.29

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휘스톤브릿지 실험 보고서

다.(circuit simulation)3) DC power supply? 직류 전원을 공급해주는 장치를 의미한다.? 전압,전류를 마음대로 조절할수 있고, 한개의 출력뿐 아니라 2개~3개 ... , 1A의 전류가 흐르는 도체의 저항이다.[도체의 형태와 저항] 저항 R은 길이 l에 비례하고 단면적 S에 반비례한다.[저항률] 도체(導體) 1m3의 정육면체가 마주보는 면 A, B

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| 리포트 | 7페이지 | 2,000원 | 등록일 2018.12.30 | 수정일 2021.09.13

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염료감응형 태양전지 결과레포트 (A+)

anthocyanins based DSSCs under simulated AM-1.5 solar light여기서 AM (air mass)란, 다음식과 같이 표현된다. 이 때, L = 태양빛 ... absorption (excitation)Dye +hv -> Dye*Electron injection (k~10-12sec)Dye* + TiO2 -> Dye+ + eCB- (TiO2)Dye ... regeneration (k~10-6sec)2Dye+ + 3I- -> 2Dye + I3-Electrolyte regeneration (reduction)I3- + 2e-catalyst

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| 리포트 | 9페이지 | 2,000원 | 등록일 2019.10.01

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시립대 전전설2 [2주차 결과] 레포트

of this LabISE 시뮬레이션을 이용하여 simulation Run time을 설정하여 원하는 파형을 출력하는 것이다. 이번 실험에서는 AND 게이트와 Half adder ... .researchgate.net/figure/Half-adder-circuit-diagram_fig1_2720153892) https://es.scribd.com/document ... 의 입력을 받아 올림수(C)의 합(S)과 새로운 올림수 두 개의 출력을 출력하는 가산, 즉 두 비트를 더하여 합과 올림수를 만들어내는 회로로 2진 비트를 쓰는 컴퓨터 회로이다. 그림

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| 리포트 | 8페이지 | 2,000원 | 등록일 2019.07.29

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VHDL에 의한 논리 시스템 해석 및 설계

simulation을 이용. Size : 10,000-100,000 gate급1990년대 - EDA (Electronic Design Automation : 전자회로 설계 자동화 ... 으로 해석할 수 있다.설계 언어가 가져야 할 특징으로는 다음이 있다. 형식적으로 정확하게 되어 있고, 해석시 사람에 따라 다르게 해석하지 않을 것. 컴퓨터를 이용하여 읽을 수 있고 s ... imulation하여 동작을 확인 할 수 있을 것.다. Logic system용 소프트 웨어를 사용하여 그 언어를 사용하여 표현된 것을 논리회로로 변환 할 수 있을 것. 그 언어

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| 리포트 | 38페이지 | 5,000원 | 등록일 2017.12.30

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Lab#07 Sequential Logic Design2

)-XC3S200-Xilinx ISE.-ISim (simulator)-XST (Synthesis tool)나. Methods1) Moore machine가) 프로젝트를 생성 ... Pre-Lab ReportLab#07 Sequential Logic Design2@ FSM and Clocked_Counter담당 교수강 상 혁담당 조교박 재 민실 험 일실 험 ... . Referrence101. Introduction가. Purpose of this labSequential Logic Circuit의 작동원리를 이해하고 Verilog HDL을 통하

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| 리포트 | 23페이지 | 1,500원 | 등록일 2016.09.11

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Chapter 4. BJT Amplifier Design Experiments 2

. PSPICE simulation circuitAs you can see the diagram, the above diagram is the circuit which we made by ... 1.Make the circuit on Fig. 4.2 using PSPICE and look for Gain and BW when C4 is 1pF. Figure 4-1 ... using PSPICE. The left side of transistor denotes the current-mirror for supplying the constant c

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| 리포트 | 17페이지 | 1,000원 | 등록일 2015.02.07

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전기전자기초실험 Combination Logic Circuit Design 결과레포트 (영어)

;endcaseendendmoduleThe simulation of 4 to 1 MUX verilog source0~200ns200ns~500ns500ns~800ns800ns~1000nsS (S ... 'b1)XYZ=3'b000;endendmoduleThe simulation of 8 to 3 Encorer verilog source0~100100~200200~300300 ... to 1 MUXmodule MUX_4_TO_1 (I0, I1, I2, I3, Y, S);inputI0, I1, I2, I3;input[1:0]S;outputY;regY;always

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| 리포트 | 7페이지 | 1,000원 | 등록일 2017.12.01

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연세대학교 전기전자응용실험 개정판(2014) - 아날로그

1.Bias simulationAs attached, the simulation circuit tells us that a series of resistors equal a s ... , which denotes the value of circuit, as we expected. Also, we expect the voltage drop between R1 and R2 s ... . DC sweep circuit The above circuit is the same circuit we mentioned a previous experiment. So

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| 리포트 | 6페이지 | 5,000원 | 등록일 2015.02.07

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아주대학교 아날로그IC 설계2 ooo 교수님

+Vth+Vds(sat)3=0.8이상이으로 1V로 정하였다.2. plot circuit schematic and DC biasing point(DC simulation ... 하는 총 current consumption이 400이하가 만족 되었다.3. Run AC simulation and derive AC gain(without Rz and Cc)원 ... 하고 그에 따른 값을 계산하여서 위의 식으로부터 CC를 2.59pF의 값을 얻었다.5. Derive Phase margin from AC simulation (with Rz and

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| 리포트 | 6페이지 | 1,500원 | 등록일 2016.06.14

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디지털 시스템실험, Verilog 코딩, Sequential Circuit (신호등) 구현, FPGA보드에서 신호등 사진 결과

은 5초, 3초, 2초로 바뀌게끔 counter가 5번지나면 green에서 yellow로 바뀌는 이론을 이용하여 coding을 하였다. 처음에 coding을 하고 simulation ... 디지털 시스템 설계 및 실험 KEEE209 전기전자전파 공학부디지털 시스템 설계 및 실험 결과보고서실험제목Sequential Circuit 설계 및 구현실험목표① 동기식 UP ... /DOWN 카운터를 설계한다.(기본)② 카운터를 이용한 Sequential Circuit을 설계한다.(신호등을 설계하였다)실험결과이번 실험은 각종 Flip-flop을 구현하고 최종

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| 리포트 | 3페이지 | 2,000원 | 등록일 2015.12.05 | 수정일 2018.05.16

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RC and RL Circuits

Post-Lab Report- Title: Lab#10_RC and RL Circuits -담당 교수담당 조교실 험 일실 험 조학 번이 름목 차< 초록 (Abstract) >1 ... 적으로 계산하고 simulation해본다. 또한 simulation 결과에 의한 time constant와 이론적으로 계산한 결과와 비교해본다. (구형파 전원을 인가)=RC=10*10 ... ^3*100*10^(-6)=1s파형에서 1s 일 때 V의 값은 1.58V정도이므로 위에서 구한 이론값과 simulation값이 일치.저항R을 10 k, 캐패시터C를 220uF으로 하

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| 리포트 | 21페이지 | 3,000원 | 등록일 2016.04.06 | 수정일 2017.03.08

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아주대 통합설계프로젝트1 전파테크(이해영교수님) 결과2 Wireless RF system and ADS advanced education

we simulated the circuit of Chebyshev Bandpass filter, which is one of various filter, using ADS ... an use this design way for speedy simulation and tuning of complex circuit. it is valuable time.3. Exp.com ... GHz (-5dBm-size) into a mixer as well. like above the circuit. And the mixer has -5dBm Gain. This gain

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| 리포트 | 7페이지 | 1,500원 | 등록일 2014.10.05 | 수정일 2017.08.03

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7. 가산기감산기예비보고서

PSpice circuit][가산기 PSpice simulation]4. 결론가산기는 input이 V1과 V2로 두 개가 있을 뿐이지 중첩의 원리를 적용하여 하나의 input ... (Superposition's principle)를 적용하여,1)V _{2} ``=`0{V _{1}} over {R _{1}} `=`-` {V _{out}} over {R _{F}}THEREFORE

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| 리포트 | 3페이지 | 1,000원 | 등록일 2015.11.29

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아주대 전자회로실험 설게3 OP AMP RC Filter 결과

어 보면 아래와 같음을 알 수가 있었고 이것은 spice simulation의 결과와 그래프 개형이 같은 것을 확인해 볼 수가 있었다. 그리고 이 결과로부터 주파수가 2배가 되었을 때 ... 었고 이것은 spice simulation의 결과와 그래프 개형이 같은 것을 확인해 볼 수가 있었다. 그리고 이 결과로부터 주파수가 2배가 되었을 때 -12dB가 감소하는 것을 알 수 ... accepting a personal obligation to our profession, its members and the communities we serve, do hereby c

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| 리포트 | 11페이지 | 1,000원 | 등록일 2016.06.15 | 수정일 2016.06.16

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