전기전자 실험레포트 (예비) - 선형증폭기회로

최초 등록일
2020.10.26
최종 저작일
2019.08
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"전기전자 실험레포트 (예비) - 선형증폭기회로"에 대한 내용입니다.

목차

1. 실험 목적
2. 실험 이론
3. 시뮬레이션

본문내용

1. 실험목적
연산 증폭기를 이용하면 포화되기 전까지 선형성을 유지하는 증폭기 뿐만 아니라 가감산, 미적분, 지수 및 로그등과 같은 연산이 가능하다. 그리고 연산 증폭기를 정밀측정기에 사용하려면 CMRR, Slew Rate, Offset 전압 및 전류등과 같은 속성을 알아여 하므로 이러한 기능들을 확인한다.

2. 실험이론
연산 증폭기를 반전 입력단자와 비반전 입력단자를 가진 이득이 매우 큰 증폭기이다. 이 증폭기는 외부에 저항을 추가하여 연산증폭기 자체의 이득보다는 훨씬 작지만 외부 저항 만에 의해 결정되는 이득이 정확한 증폭기를 만들 수 있다. 또, 각 입력신호마다 원하는 크기의 전압이득을 갖도록 하면서 이들을 합하는 회로를 만들 수도 있다. 반전증폭기를 원할 경우 다음 그림에 보인 것처럼 저항을 반전입력 단자에 연결하여야 하며, 이때의 출력전압은 (1)과 같고, 비반전 증폭기 회로를 보인 것으로 출력전압은 (2) 와 같다.

참고 자료

없음

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