MOSFET Amplifier Design1 with PSPICE - degenerated CS stage

doubleE
최초 등록일
2020.02.10
최종 저작일
2019.12
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소개글

전자회로 프로젝트 "MOSFET Amplifier Design1"에 대한 내용입니다.

목차

1. Problem
2. Solution with PSPICE Simulation

본문내용

문제) The degenerated CS stage depicted below must provide a voltage gain of 4 with a power budget of 2mW while the voltage drop across RS is equal to 200mV. If the overdrive voltage of the transistor must not exceed 300mV and R1+R2 must consume less than 5% of the allocated power, design the circuit.

(a) Since 5% of power is dissipated by R1+R2, the rest 95% of 2mW is consumed by the drain current. Find the drain current.
(b) Determine RS for the voltage drop across this to be 200 mV.
(c) Determine W/L for the overdrive voltage of 300mV.
(d) For the voltage gain of 4, determine RD.
(e) Determine R1+R2 for 5% of the total power to be dissipated here
(f) Determine R1 and R2 to generate the required gate voltage.

<중 략>

즉, 위의 Saturation region으로 가정하고 계산한 결과는 잘못된 것이고 이 때문에 SPICE 시뮬레이션에서 나타난 결과 값이 문제에서 주어진 Gain에 비해 작은 것입니다.
또한 MOSFET의 곡선에서 확인 할 수 있듯이 Triode region은 이차함수로 나타나기 때문에 Gain이 문제에서 주어진 값과 어느정도 차이가 있는 것입니다.

참고 자료

없음
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