전자회로 설계 및 실험2, 21. 비선형 연산 증폭기 결과보고서

최초 등록일
2018.09.19
최종 저작일
2017.12
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목차

1. 실험제목
2. 실험목표
3. 기초 이론
4. 실험 과정
5. 실험 시뮬레이션
6. 실험 결과 및 분석
7. 고찰

본문내용

실험제목: 비선형 연산 증폭기 회로와 능동 필터

실험목표
1. 비교기(comparator)의 동작 원리를 이해한다.
2. 능동 반파 정류기(active half-wave rectifier)의 출력을 살펴본다.
3. 능동 피크 검출기(active peak detector)의 출력값을 측정한다.
4. 리미터(limiter)를 이용하여 출력 크기(수준)를 제어한다.
5. 능동 필터 중 저역 통과 필터와 고역 통과 필터의 주파수 특성을 살펴본다.

기초 이론
1. 비교기
[그림 1]은 비교기를 나타낸다. 가장 간단한 비교기는 연산 증폭기를 개방 루프로 사용하여 구현할 수 있다. 이 때 두 입력 단자 사이의 미세한 전압 차이가 증폭되어 출력은 최대 또는 최소의 값을 갖는다. 출력이 최대가 되는 경우는 비반전 입력단의 입력이 큰 경우이며 출력이 최소가 되는 경우는 그 반대이다.

[그림 1] (a) 비교기, (b) 입출력 특성

참고 자료

Fundamentals of Microelectronics, 2nd Ed, Razavi. Ch 15.

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