디지털 공학 순서논리회로 플립플롭 예비보고서

최초 등록일
2013.03.29
최종 저작일
2012.03
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목차

1. 목적

2. 이론
2.1 기본 RS 플립플롭
2.2 RS 플립플롭
2.3 PR/CLR RS 플립플롭
2.4 D플립플롭
2.5
2.6 주종 플립플롭
2.7 JK 플립플롭

본문내용

1. 목적
순서논리회로의 기반이 되는 플립플롭을 RS, D, T, JK 주종 플립플롭 등을 대상으로 하여 동작 원리를 살펴보고 전반적인 이해를 도모하도록 한다.

2. 이론
입력 신호의 순서에 따라서 동작 및 출력이 달라지는 순서논리회로에 관해서 실험하고자 한다. 순서논리회로를 구성하는 기본소자는 플립플롭이다. 플립플롭은 쌍안정 멀티마이브레이터를 일컫는 것으로 0과 1, 두 개의 안정된 상태를 출력으로 같는다. 이때 두 개의 출력은 항시 상반된 상태에 있으며, 한쪽의 출력을 Q라 하면, 다른 한쪽의 출력은 Q가 된다. 플립플롭은 기억소자로 사용되며 EH한 주파수를 분할하거나 카운터를 제작하는 등을 널리 응응용된다. 입력회로의 구성은 RX 플립플롭, D플립플롭, D 플립플롭, T플립플롭, JK 플립플롭등으로 나타낸다.

2.1 기본 RS 플립플롭
가장 단순한 형태의 RS플립플롭은 단지 두 개의 NAND 게이트나 NOR 게이트로 구성할 수 있다. 각각의 입력과 NAND게이트 사이에 NOT 게이트가 하나씩 연결된 것으로 보면 된다.

참고 자료

없음

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