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[A+, 에리카] [A+] 2021-1학기 논리설계및실험 Decoder, 7segment 실험결과보고서2025.05.011. Decoder Decoder는 2진수 입력값을 10진수 값으로 변환하여 출력하는 회로입니다. 입력값 a, b를 받아 d3, d2, d1, d0의 값으로 출력하며, 총 4개의 minterm을 만듭니다. and 게이트와 not 게이트를 이용하여 논리회로를 구성할 수 있습니다. 2. 7segment 7segment는 LED 7개와 dp가 복합적으로 연결된 형태로, 0~9까지의 숫자를 display를 통해 표현할 수 있습니다. common-anode type과 common-cathode type으로 나뉘며, 각 led의 not gat...2025.05.01
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Semiconductor Device and Design - 42025.05.101. Diode's fabrication process Diode의 제조 공정에는 합금 방식과 확산 방식의 두 가지 일반적인 기술이 사용됩니다. 합금 방식은 n형 반도체 표면에 알루미늄 펠릿을 녹여 pn 접합을 형성하는 방식이며, 확산 방식은 n형 반도체를 수용체 불순물 증기가 있는 챔버에서 가열하여 수용체 원자가 n형 결정 내부로 확산되어 pn 접합을 형성하는 방식입니다. 확산 공정에서는 n형 물질의 일부만 노출되도록 하여 p 영역의 크기를 정밀하게 제어할 수 있습니다. 2. Capacitor's fabrication proces...2025.05.10
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5주차 결과 보고서 19장 논리회로 응용 및 Karnaugh Map (1)2025.05.031. 논리회로 응용 논리회로 응용 및 Karnaugh Map 실험을 통해 논리식의 간략화와 논리회로 구성을 실험하였습니다. 주어진 부울 대수식을 이용하여 논리회로를 설계하고, 카르노 맵을 활용하여 간략화하는 과정을 수행하였습니다. 실험 결과를 통해 간략화된 회로와 원래 회로의 출력이 동일함을 확인하였습니다. 2. Karnaugh Map Karnaugh Map을 활용하여 주어진 부울 대수식을 간략화하는 과정을 수행하였습니다. Karnaugh Map을 통해 얻은 간략화된 식과 부울 대수식을 이용한 간략화 결과가 동일함을 확인하였습니다....2025.05.03
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전자계산시 논리회로에서 조합논리회로와 순서논리회로의 차이점2025.01.031. 조합 논리회로 조합 논리회로는 현재의 입력 값만으로 출력 값이 결정되는 논리회로로 입력, 논리 게이트, 출력으로 구성된다. 출력 값은 0과 1의 조합 함수이며 기억회로를 가지지 않는다. 조합논리회로의 종류에는 반가산기, 반감산기, 전가산기, 전감산기가 있다. 2. 순서 논리회로 순서논리회로는 이전의 출력 값과 현재의 입력 값에 따라 출력이 결정되는 회로이기 때문에 기억장치가 반드시 필요하다. 플립플롭은 1비트를 기억하는 논리회로로 동기식과 비동기식으로 구분된다. 순서논리회로에는 RS플립플롭, JK플립플롭, T플립플롭 등이 있다...2025.01.03
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SR 플립플롭을 이용한 간단한 도어락과 조도센서를 이용한 LED2025.05.111. SR 플립플롭 SR 플립플롭은 값을 저장할 수 있는 성질을 가지고 있어, 이를 활용하여 간단한 도어락을 만들 수 있다. 사용자가 입력한 값을 기억하고, AND 게이트를 통해 맞는 비밀번호를 입력했을 경우 도어락에 열림 신호를 보낼 수 있다. 2. 조도센서 CdS 소자를 활용한 조도센서를 사용하여 어두운 환경에서도 도어락을 쉽게 찾을 수 있도록 LED를 자동으로 켤 수 있다. CdS 소자의 저항 값이 커지면 트랜지스터가 작동되어 LED에 불이 들어오게 된다. 3. 도어락 설계 SR 플립플롭을 이용하여 비밀번호를 기억하고, AND...2025.05.11
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홍익대_디지털논리회로실험_8주차 예비보고서_A+2025.01.151. Gated D Latch Gated D Latch는 Gated S-R Latch와 매우 유사하다. S와 R에 1이 동시에 입력되는 것을 막기 위해 R에 인버터를 이용해 를 입력하는 Gated S-R Latch가 Gated D Latch라고 할 수 있다. EN이 0일 때는 NAND 게이트가 무조건 1을 출력하므로 Q의 출력 값이 변하지 않는 NC상태이다. EN이 1이고 D에 1이 입력되면 D를 입력으로 받는 NAND 게이트의 결과가 0, 를 입력으로 받는 NAND 게이트의 결과가 1이므로 Q = 1, =0이 출력된다. EN이 1...2025.01.15
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MOSFET, MOSCAP 측정 실험 Report2025.01.121. MOSFET MOSFET은 전압 제어용 소자로 Gate, Source, Drain의 3 단자로 구성되어 있습니다. Gate에 인가되는 전압으로 Source와 Drain의 전류 흐름을 제어할 수 있으며, 제작 방식에 따라 증가형 MOSFET과 공핍형 MOSFET으로 구분할 수 있습니다. 본 실험에서는 Keithley 4200-SCS를 이용하여 MOSFET의 I-V 특성을 분석하였고, On-off ratio, Threshold Voltage, Subthreshold swing, Mobility, DIBL 현상 등을 확인하였습니다....2025.01.12
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논리식 최소항 표현, 진리표 작성 및 간소화2025.01.041. 부울대수 부울대수는 영국의 수학자 George Boole이 1854년 제시한 용어로, 기호에 따라 논리함수를 나타내는 수학적 방법이다. 이후 미국의 수학자 Claude E. Shannon이 부울대수를 이용해 스위칭 회로에 응용할 수 있다는 사실을 밝혔고, 이에 따라 부울대수를 스위칭 대수로 부르기도 한다. 부울대수는 AND, OR, NOT 등의 논리적 연산으로 정의되는 수학적 학설로, 디지털 논리 시스템에서 회로 연구와 분석에 필요한 논리수학이다. 2. 논리식 변환 주어진 논리식 은 곱의 합형인 SOP(Sum of Produc...2025.01.04
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반도체 장치 및 설계 - 112025.05.101. PLA (Programmable Logic Array) PLA(Programmable Logic Array)의 레이아웃, 동작 원리, 구조에 대해 설명합니다. PLA 구현 절차로는 SOP(Sum of Products) 형태로 준비하고, 최소 SOP 형태로 줄이며, AND 매트릭스의 입력 연결과 OR 매트릭스의 입력 연결, 그리고 반전 매트릭스의 연결을 결정한 후 PLA를 프로그래밍하는 것을 설명합니다. 2. 유한 상태 기계 (Finite State Machine) 유한 상태 기계의 두 가지 유형인 Moore 상태 기계와 Mea...2025.05.10
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[디지털공학개론] 부울대수의 규칙(교환법칙, 결합법칙, 분배법칙, 드모르강의 정리)들을 각각 증명해보자.(단, 부울대수식은 변수 3개(A,B,C)를 모두 사용한다.)2025.01.221. 교환법칙의 증명 교환법칙은 부울대수에서 두 변수 간의 순서를 교환해도 결과가 동일하다는 것을 의미한다. 이는 덧셈과 곱셈 모두에 적용되며, OR 연산과 AND 연산 모두에서 성립함을 증명하였다. 교환법칙은 논리 회로의 대칭성을 보장하는 데 기여한다. 2. 결합법칙의 증명 결합법칙은 연산의 순서를 어떻게 결합해도 결과가 동일하다는 것을 의미한다. 이는 덧셈과 곱셈 모두에 적용되며, OR 연산과 AND 연산 모두에서 성립함을 증명하였다. 결합법칙은 논리식을 단순화하고 회로를 최적화하는 데 유용하다. 3. 분배법칙의 증명 분배법칙은...2025.01.22
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